液晶显示器

摘要

公开了一种液晶显示器。该液晶显示器包括：定时控制器，其输出R数字视频数据对、G数字视频数据对、B数字视频数据对和时钟对；多个源驱动集成电路(IC)，其每一个从所述定时控制器接收R、G和B数字视频数据中的每一对和时钟对，以产生正模拟数据电压和负模拟数据电压；以及源印刷电路板(PCB)，在该源印刷电路板上形成有三个数据总线对和时钟线对，所述三个数据总线对和所述时钟线对将所述定时控制器的输出端子连接到所述源驱动IC的输入端子。

权利要求

1.一种液晶显示器，该液晶显示器包括：

定时控制器，其输出R数字视频数据对、G数字视频数据对、B数字视频数据对和时钟对，R、G、B数字视频数据中的每一对包括正数据和负数据，时钟对包括正时钟和负时钟；

多个源驱动集成电路IC，其每一个从所述定时控制器接收R、G和B数字视频数据中的每一对和时钟对，以产生正模拟数据电压和负模拟数据电压且将所述正模拟数据电压和负模拟数据电压提供到液晶显示板的数据线；以及源印刷电路板PCB，在该源印刷电路板上形成有三个数据总线对和一时钟线对，所述三个数据总线对和所述时钟线对将所述定时控制器的输出端子连接到所述源驱动IC的输入端子。

2.根据权利要求1所述的液晶显示器，其中R、G和B数字视频数据中的每一对的正数据和负数据通过所述三个数据总线对同时传输到所述源驱动IC，其中所述时钟对的正时钟和负时钟通过所述时钟线对同时传输到所述源驱动IC。

3.根据权利要求2所述的液晶显示器，其中R、G和B数字视频数据中的每一对具有

300mV-600mV的摆动宽度。

4.根据权利要求1所述的液晶显示器，其中从所述定时控制器输出的所述时钟对的传输频率比输入到所述定时控制器的时钟信号的输入频率大4倍。

5.根据权利要求2所述的液晶显示器，其中传输所述R数字视频数据对的数据总线对连接到所述定时控制器的第一数据输出端子，且以T字形分割以连接到各个源驱动IC的第一数据输入端子，其中传输所述G数字视频数据对的数据总线对连接到所述定时控制器的第二数据输出端子，且以T字形分割以连接到各个源驱动IC的第二数据输入端子，其中传输所述B数字视频数据对的数据总线对连接到所述定时控制器的第三数据输出端子，且以T字形分割以连接到各个源驱动IC的第三数据输入端子，其中所述时钟线对连接到定时控制器的时钟输出端子，且以T字形分割以连接到各个源驱动IC的时钟输入端子。

6.根据权利要求5所述的液晶显示器，其中所述定时控制器产生用于控制各个源驱动IC的输出定时的源输出使能信号和用于控制从所述源驱动IC输出的数据电压的极性的极性控制信号。

7.根据权利要求6所述的液晶显示器，其中所述源PCB包括用于将所述源输出使能信号和所述极性控制信号同时传输到所述源驱动IC的控制信号总线。

8.根据权利要求7所述的液晶显示器，其中各条控制信号总线连接到所述定时控制器的控制信号输出端子，且以T字形分割以连接到各个源驱动IC的控制信号输入端子。

说明书

液晶显示器

技术领域

[0001] 本发明的实施方式涉及一种液晶显示器。

背景技术

[0002] 本申请要求2009年5月15日提交的韩国专利申请No.10-2009-0042413的优先权，此处以引证的方式并入其全部内容，就像在此进行了完整阐述一样。

[0003] 有源矩阵型液晶显示器利用薄膜晶体管(TFT)作为开关元件来显示运动画面。因为有源矩阵型液晶显示器的薄外形，有源矩阵型液晶显示器已被实施在电视机以及诸如办公设备和计算机的便携式设备的显示设备中。因此，阴极射线管(CRT)正被有源矩阵型液晶显示器快速代替。

[0004] 液晶显示器一般包括液晶显示板、向液晶显示板提供光的背光单元、将数据电压提供到液晶显示板的数据线的数据驱动电路、连接到该数据驱动电路的源印刷电路板(PCB)等。源PCB连接到液晶显示板的一侧。包括数据总线、时钟线、控制信号总线等的大量的线形成在源PCB上。因此，在相关技术液晶显示器中难以减小源PCB的尺寸。因此，难以实现液晶显示器的薄外形且降低源PCB的生产成本。

发明内容

[0005] 本发明的实施方式提供一种能够减小印刷电路板(PCB)的尺寸的液晶显示器。

[0006] 在一个方面，一种液晶显示器包括：定时控制器，其输出R数字视频数据对、G数字视频数据对、B数字视频数据对和时钟对，R、G、B数字视频数据中的每一对包括正数据和负数据，时钟对包括正时钟和负时钟；多个源驱动集成电路(IC)，其每一个从所述定时控制器接收R、G和B数字视频数据中的每一对和时钟对，以产生正模拟数据电压和负模拟数据电压且将所述正模拟数据电压和负模拟数据电压提供到液晶显示板的数据线；以及源印刷电路板(PCB)，在该源印刷电路板上形成有三个数据总线对和时钟线对，所述三个数据总线对和所述时钟线对将所述定时控制器的输出端子连接到所述源驱动IC的输入端子。

附图说明

[0007] 附图被包括在本说明书中以提供对本发明的进一步理解，并结合到本说明书中且构成本说明书的一部分，附图示出了本发明的实施方式，且与说明书一起用于解释本发明的原理。附图中：

[0008] 图1是例示根据本发明的实施方式的液晶显示器的框图；

[0009] 图2是例示源驱动集成电路(IC)的框图；

[0010] 图3示意性地例示了定时控制器和源驱动IC之间的连接结构；

[0011] 图4例示了源印刷电路板(PCB)上的数据总线、时钟线和控制信号总线；

[0012] 图5和6是示出微型LVDS数据和微型LVDS时钟的示例的波形图。

具体实施方式

[0013] 根据本发明的实施方式的液晶显示器的制造方法包括：用于清洁液晶显示板的基板的工序、用于对基板进行构图的工序、用于形成和摩擦配向层的工序、用于密封基板和滴注液晶的工序、用于安装驱动电路的工序、模块组装工序等。

[0014] 基板清洁工序是利用清洁溶液从液晶显示板的上和下玻璃基板的表面上去除污染材料的工序。基板构图工序包括：用于在下玻璃基板上形成各种薄膜材料且对各种薄膜材料进行构图的工序，其中所述各种薄膜材料例如包括数据线和选通线的信号线、薄膜晶体管(TFT)和像素电极；以及用于在上玻璃基板上形成各种薄膜材料且对各种薄膜材料进行构图的工序，其中所述各种薄膜材料例如黑底、滤色器和公共电极。在用于形成和摩擦配向层的工序中，将配向层分别涂敷在上和下玻璃基板上，且然后使用摩擦布对配向层进行摩擦或者对其进行光配向处理。在执行上述工序之后，在液晶显示板的下玻璃基板上形成像素阵列。像素阵列包括接收视频数据电压的数据线、与数据线交叉且顺序地接收扫描信号(即，选通脉冲)的选通线、在数据线和选通线的各交叉处形成的TFT、分别连接到TFT的液晶单元的像素电极、存储电容器等。产生扫描信号的选通驱动电路的移位寄存器可以在基板构图工序中与像素阵列同时形成。黑底、滤色器以及公共电极形成在液晶显示板的上玻璃基板上。在诸如扭曲向列(TN)模式和垂直对准(VA)模式的垂直电场驱动方式中，在上玻璃基板上形成公共电极。在诸如共面切换(IPS)模式和边缘场切换(FFS)模式的水平电场驱动方式中，在下玻璃基板上形成公共电极和像素电极。偏振板分别附接到上和下玻璃基板上，且保护膜分别附接到偏振板上。

[0015] 在密封基板和滴注液晶的工序中，在真空室中，将密封剂提取到上和下玻璃基板中的一个基板上，且将液晶滴注到另一玻璃基板上。假设在真空室内，液晶滴注到下玻璃基板上，紫外可固化密封剂形成在上玻璃基板上。将其上形成有紫外可固化密封剂的上玻璃基板倒置且固定在上工作台上，且将其上滴注有液晶的下玻璃基板固定到下工作台上。因此，将上和下玻璃基板对准。随后，在通过驱动真空泵以将真空室的压力调节到预定真空压力的状态下，向上和下玻璃基板之一施加压力，以将上和下玻璃基板彼此密封。在这种情况下，上和下玻璃基板之间的液晶层的单元间隙被设置为大于设计中所设定的单元间隙的值。随后，将氮(N2)注入到真空室中以将真空室的压力调节为大气压。因此，因为密封后的玻璃基板内的压力和真空室的压力之间的差异，液晶层的单元间隙被设置为设计中所设定的单元间隙。在单元间隙被设置为设计值的状态下，将来自紫外光源的紫外线通过上玻璃基板或下玻璃基板照射到紫外可固化密封剂上，以固化该紫外可固化密封剂。

[0016] 在用于安装驱动电路的工序中，数据驱动电路的源驱动集成电路(IC)通过玻上芯片(COG)工艺或带式自动焊接(TAB)工艺连接到下玻璃基板的数据线，且源驱动IC连接到其上安装有定时控制器的源印刷电路板(PCB)。在选通驱动电路中，选通驱动电路的选通驱动IC可以通过TAB工艺连接到下玻璃基板的选通线，或选通驱动电路可以通过面板内栅极(Gate In Panel，GIP)工艺与像素阵列同时地直接形成在下玻璃基板上。在本实施方式中，因为定时控制器安装在源PCB上，所以可以省略相关技术中的其上安装有定时控制器的控制PCB。

[0017] 在模块组装工序中，使用诸如主支架、底盖和壳盖的外壳组件，将背光单元和液晶显示板组装为液晶模块。

[0018] 根据本发明的实施方式的液晶显示器的制造方法还可以包括检查工序和修复工序。

[0019] 检查工序包括IC的检查、下玻璃基板上的诸如数据线和选通线的信号线的检查、用于检测TFT和像素电极是否有缺陷的电学检查、在执行密封基板和滴注液晶的工序之后进行的电学检查、用于通过开启液晶模块的背光单元来检测液晶模块是否有缺陷的照明检查等。对通过检查工序确定为可修复缺陷的缺陷信号线和缺陷TFT执行修复工序。

[0020] 现在将详细描述本发明的实施方式，在图1至6中例示出了其示例。

[0021] 如图1所示，根据本发明的实施方式的液晶显示器包括：液晶显示板10、位于液晶显示板10下方的背光单元16、连接到液晶显示板10的数据线D1至Dm的数据驱动电路12、连接到液晶显示板10的选通线G1至Gn的选通驱动电路13、用于控制数据驱动电路12和选通驱动电路13的定时控制器11、以及产生液晶显示板10的驱动电压的DC-DC转换器15。

[0022] 液晶显示板10包括彼此相对设置的上玻璃基板和下玻璃基板，液晶层夹在该上玻璃基板和下玻璃基板之间。液晶显示板10包括显示视频数据的像素阵列。下玻璃基板的像素阵列包括在数据线D1至Dm与选通线G1至Gn的各个交叉处形成的TFT以及连接到该TFT的像素电极1。液晶显示板10通过利用通过TFT施加到像素电极1的数据电压和通过TFT施加到公共电极2的公共电压Vcom之差来驱动像素阵列的各个液晶单元Clc，通过控制由背光单元16提供的光的透射量，来显示视频数据的图像。

[0023] 黑底、滤色器和公共电极2形成在液晶显示板10的上玻璃基板上。在诸如TN模式和VA模式的垂直电场驱动方式下，在上玻璃基板上形成公共电极2。在诸如IPS模式和FFS模式的水平电场驱动方式下，在下玻璃基板上形成公共电极2和像素电极1。

[0024] 偏振板分别附接到液晶显示板10的上和下玻璃基板上。用于设置液晶的预倾角的配向层分别形成在上玻璃基板和下玻璃基板上。

[0025] 可应用于本发明的实施方式的液晶显示板可以按任意液晶模式以及TN、VA、IPS和FFS模式来实施。根据本发明的实施方式的液晶显示器可以以任意类型的液晶显示器来实施，包括背光液晶显示器、透射反射型液晶显示器和反射型液晶显示器。在背光液晶显示器和透射反射型液晶显示器中，背光单元是必须的。背光单元16可以实施为直下型背光单元或侧光型背光单元。在直下型背光单元中，多个光学片和散射板堆叠在液晶显示板10下面，且多个光源位于散射板下面。在侧光型背光单元中，多个光源与导光板的侧面相对设置，且多个光学片位于液晶显示板10和导光板之间。背光单元的光源可以使用热阴极荧光灯(HCFL)、冷阴极荧光灯(CCFL)、外部电极荧光灯(EEFL)以及发光二极管(LED)中的一种或至少两种。

[0026] 数据驱动电路12包括多个源驱动IC。各源驱动IC根据从定时控制器11接收的微型低压差分信令(LVDS)接口标准的各对R、G和B数据以及从定时控制器11接收的微型LVDS时钟，对R、G和B数字视频数据进行采样和锁存，以将锁存的R、G和B数字视频数据转换成并行数据。各个源驱动IC响应于极性控制信号POL，利用来自DC-DC转换器15的正或负伽马基准电压VGMA1至VGMA10，将经解串行(deserialized)的数字视频数据转换成将充入到液晶单元Clc中的正或负模拟视频数据电压，且然后响应于来自定时控制器11的源输出使能信号SOE，将正/负模拟视频数据电压提供到数据线D1至Dm。源驱动IC可以通过COG工艺或TAB工艺连接到数据线D1至Dm。

[0027] 选通驱动电路13包括多个选通驱动IC。各个选通驱动IC包括移位寄存器，该移位寄存器响应于来自定时控制器11的选通控制信号将选通驱动电压顺序地进行移位，以随后将选通脉冲(即，扫描脉冲)提供到选通线G1至Gn。选通驱动IC可以通过TAB工艺连接到下玻璃基板的选通线G1至Gn，或可以通过GIP工艺直接形成在下玻璃基板上。

[0028] 定时控制器11通过诸如LVDS接口和转换最小化差分信令(TMDS)接口这样的接口接收电路，来接收R、G和B数字视频数据以及诸如垂直同步信号Vsync、水平同步信号Hsync、数据使能信号DE、点时钟CLK的定时信号。定时控制器11以微型LVDS接口方式将R数据对、G数据对、B数据对同时传输到源驱动IC，从而减少各个电磁接口(EMI)的摆动宽度和数据传输路径上的数据电压。定时控制器11利用定时信号Vsync、Hsync、DE和CLK来产生用于控制源驱动IC的操作定时的数据控制信号和用于控制选通驱动IC的操作定时的选通控制信号。定时控制器11可以基于(60×i)Hz的帧率(其中“i”是正整数)将各个数据控制信号和选通控制信号的频率相乘，使得以60Hz的帧率输入的数字视频数据能够以(60×i)Hz的帧率在液晶显示板10的像素阵列中再现。

[0029] 数据控制信号包括源输出使能信号SOE、极性控制信号POL等。如果定时控制器11和数据驱动电路12之间的信号传输方式是微型LVDS接口，则可以省略在现有晶体管到晶体管(TTL)接口中使用的源起始脉冲和源采样时钟。源输出使能信号SOE控制数据驱动电路12的输出定时。当提供到数据线D1至Dm的数据电压的极性反转时，数据驱动电路12的各个源驱动IC响应于源输出使能信号SOE来将电荷共享电压或公共电压Vcom提供到数据线D1至Dm，且在源输出使能信号SOE的低逻辑周期中将数据电压提供到数据线D1至Dm。电荷共享电压是被提供有相反极性的数据电压的相邻数据线的平均电压。极性控制信号POL每N个水平周期反转从数据驱动电路12输出的数据电压的极性，其中N是正整数。

[0030] 选通控制信号包括选通起始脉冲GSP、选通移位时钟GSC、选通输出使能信号GOE等。选通起始脉冲GSP控制第一选通脉冲的定时。选通移位时钟GSC是用于使选通起始脉冲GSP移位的时钟。选通输出使能信号GOE控制选通驱动电路13的输出定时。

[0031] 系统板14通过LVDS接口传送电路或TMDS接口传送电路来将诸如垂直同步信号Vsync、水平同步信号Hsync、数据使能信号DE和点时钟CLK的定时信号以及从广播接收电路或外部视频源接收的R、G和B数字视频数据传输到定时控制器11。系统板14包括诸如定标器的图形处理电路和电源电路。图形处理电路以与液晶显示板的分辨率相符的方式对R、G和B数字视频数据的分辨率进行插值，且执行关于R、G和B数字视频数据的信号插值处理。电源电路产生将被提供到DC-DC转换器15的电压Vin。

[0032] DC-DC转换器15调节从系统板14的电源电路接收的电压Vin，以产生液晶显示板10的驱动电压。液晶显示板10的驱动电压包括15V-20V的高电位源电压Vdd、约3.3V的逻辑源电压Vcc、等于或大于15V的选通高电压VGH、等于或小于-3V的选通低电压VGL、7V-8V的公共电压Vcom、正或负伽马基准电压VGMA1至VGMA10、1.2V-1.8V的核心电源电压(core power voltage)等。高电位源电压Vdd是将充入到液晶显示板10的液晶单元Clc中的最大数据电压。逻辑源电压Vcc是诸如定时控制器11、源驱动IC和选通驱动IC的数字逻辑元件的源电压。选通高电压VGH是被设置为等于或大于像素阵列中所形成的TFT的阈值电压的选通脉冲的高逻辑电压。选通低电压VGL是被设置为小于像素阵列中所形成的TFT的阈值电压的选通脉冲的低逻辑电压。选通高电压VGH和选通低电压VGL被提供到选通驱动电路13。公共电压Vcom被提供到液晶单元Clc的公共电极2。源驱动IC可以在源输出使能信号SOE的高逻辑周期中将公共电压Vcom作为电荷共享电压提供到数据线D1至Dm。在普通方式的存储中，存储电容器Cst的存储电极形成在液晶显示板10的下玻璃基板上，使得存储电极与像素电极1交叠，在该存储电极和像素电极1之间夹有绝缘层。在普通方式的存储中，公共电压Vcom可以提供到存储电极。核心电源电压是用于以微型LVDS接口方式产生数据电压的逻辑电压。

[0033] 图2是例示了源驱动IC的框图。

[0034] 如图2所示，各个源驱动IC 12a包括移位寄存器21、数据接收单元22、第一锁存阵列23、第二锁存阵列24、数字-模拟转换器(DAC)25、电荷共享电路26和输出电路27。

[0035] 数据接收单元22从定时控制器11接收微型LVDS数据和微型LVDS时钟，以利用微型LVDS接口恢复方法来恢复TTL电平的R、G和B数字视频数据，且产生TTL电平的源采样时钟SSC。如图4至6所示，微型LVDS数据包括含有正数据和负数据的R数据对(即，差分信号)、含有正数据和负数据的G数据对(即，差分信号)以及含有正数据和负数据的B数据对(即，差分信号)。微型LVDS时钟包括含有正时钟和负时钟的时钟对(即，差分信号)。例如，如图6所示，当正数据P的逻辑电平为高电平时，数据接收单元22从由定时控制器11接收到的微型LVDS数据中输出逻辑值“1”。而且，如图6所示，当正数据P的逻辑电平为低电平时，数据接收单元22从由定时控制器11接收到的微型LVDS数据中输出逻辑值“0”。因此，数据接收单元22对数据进行恢复以将恢复后的数据提供到第一锁存阵列23。

[0036] 移位寄存器21对源采样时钟SSC进行移位以产生采样时钟。当第一锁存阵列23接收超过第一锁存阵列23中的锁存操作的数目的数据时，移位寄存器21产生进位信号CAR。第一锁存阵列23响应于从移位寄存器21顺序接收的采样时钟来采样由数据接收单元22恢复的R、G和B数字视频数据，对与各条水平线相对应的采样的R、G和B数字视频数据进行锁存，且同时输出与各条水平线相对应的R、G和B的锁存数字视频数据。

[0037] 第二锁存阵列24对从第一锁存阵列23接收到的与各条水平线相对应的R、G和B数字视频数据进行锁存。然后，第二锁存阵列24和其它源驱动IC 12a的第二锁存阵列24在源输出使能信号SOE的低逻辑周期中，同时输出锁存的R、G和B数字视频数据。

[0038] DAC 25包括接收正伽马补偿电压GH的P解码器、接收负伽马补偿电压GL的N解码器、以及响应于极性控制信号POL来选择P解码器的输出和N解码器的输出的复用器。P解码器对从第二锁存阵列24接收的R、G和B数字视频数据进行解码，以输出与R、G和B数字视频数据的灰度级相对应的正伽马补偿电压GH。N解码器对从第二锁存阵列24接收的R、G和B数字视频数据进行解码，以输出与R、G和B数字视频数据的灰度级相对应的负伽马补偿电压GL。复用器响应于极性控制信号POL来选择正伽马补偿电压GH和负伽马补偿电压GL。

[0039] 在源输出使能信号SOE的高逻辑周期中，电荷共享电路26使相邻数据输出通道短路(short)，以输出相邻数据电压的平均值作为电荷共享电压。否则，在源输出使能信号SOE的高逻辑周期中，电荷共享电路26输出公共电压Vcom以减小正数据电压和负数据电压中的锐变。输出电路27利用缓冲器来减小提供到数据线D1至Dk(其中k是小于m的正整数)的正/负数据电压的信号衰减。

[0040] 图3和4示意性地例示了定时控制器11和源驱动IC 12a之间的连接结构。

[0041] 如图3和4所示，定时控制器11安装在源PCB 30上，且各个源驱动IC 12安装在源带载封装(TCP)上。源PCB 30的输出端子连接到源TCP的输入端子。源TCP的输出端子利用各向异性导电膜(ACF)而附接到液晶显示板10的下玻璃基板上，且连接到数据线D1至Dm。

[0042] 定时控制器11并不将从系统板14接收到的TTL电平(约3.3V)的R、G和B数字视频数据分成奇数数字视频数据和偶数数字视频数据。定时控制器11将TTL电平的R、G和B数字视频数据中的每一个转换成具有约300mV至600mV的摆动宽度的微型LVDS数据，以将微型LVDS数据与微型LVDS时钟一起传输到源驱动IC 12a。传输到源驱动IC 12a的微型LVDS时钟的频率比输入到定时控制器11的点时钟的频率约大4倍。

[0043] 如果定时控制器11将R、G和B数字视频数据中的每一个分为奇数数字视频数据和偶数数字视频数据，则传输到各个源驱动IC 12a的微型LVDS数据包括R奇数数据对、R偶数数据对、G奇数数据对、G偶数数据对、B奇数数据对以及B偶数数据对。在这种情况下，必须在源PCB 30上形成至少12条数据总线。相反，在本发明的实施方式中，因为R、G和B数字视频数据中的每一个未分成奇数数字视频数据和偶数数字视频数据，所以源PCB 30上的仅6条数据线(即，三对数据线)就足以传输R数据对、G数据对和B数据对。结果，可以通过减小源PCB 30的尺寸来降低源PCB 30的生产成本。

[0044] 从定时控制器11输出的微型LVDS数据和微型LVSD时钟通过图4中示出的数据总线和时钟线传输到各个源驱动IC 12a。数据总线连接到定时控制器11的数据输出端子且连接到源驱动IC 12的数据输入端子。时钟线连接到定时控制器11的时钟输出端子且连接到源驱动IC 12a的时钟输入端子。更具体而言，传输该R数字视频数据对的第一对数据总线连接到定时控制器11的第一数据输出端子，且以T字形分割以连接到各个源驱动IC12a的第一数据输入端子。传输该G数字视频数据对的第二对数据总线连接到定时控制器
11的第二数据输出端子，且以T字形分割以连接到各个源驱动IC 12a的第二数据输入端子。传输该B数字视频数据对的第三对数据总线连接到定时控制器11的第三数据输出端子，且以T字形分割以连接到各个源驱动IC 12a的第三数据输入端子。该时钟线对连接到定时控制器11的输出端子且以T字形分割以连接到各个源驱动IC 12a的时钟输入端子。

[0045] 用于控制源驱动IC 12a的数据控制信号SOE和POL通过控制信号总线同时传输到各个源驱动IC 12a。各条控制信号总线连接到定时控制器11的控制信号输出端子且以T字形分割以连接到各个源驱动IC 12a的控制信号输入端子。数据总线、时钟线以及控制信号总线形成在源PCB30上。

[0046] 为方便解释，图4仅示出了两个源驱动IC 12a，不过，可以在根据本发明的实施方式的液晶显示器中使用两个或更多个源驱动IC。

[0047] 图5和6是示出微型LVDS数据和微型LVDS时钟的波形图。

[0048] 在图5和6中，“Data CLK”表示由系统板14产生的点时钟，且“miniLVDS CLK”表示由定时控制器11产生的微型LVDS时钟。微型LVDS时钟与微型LVDS数据一起被传输到各个源驱动IC 12a。而且微型LVDS数据包括含有复位波形的正数据P和负数据N。定时控制器11将各个R、G和B数字视频数据和时钟转换成正数据P和负数据N，且通过所述数据总线对和时钟线对将各包括正数据P和负数据N的R数据对、G数据对、B数据对和时钟对传输到各个源驱动IC 12a。因为R、G和B数字视频数据中的每一个并未通过定时控制器11分成奇数数字视频数据和偶数数字视频数据，所以R、G和B数字视频数据通过三个数据总线对传输到各个源驱动IC。对第一数据进行采样的第一源驱动IC 12将在复位波形RS之后产生的起始脉冲ST的产生时间点识别作为数据采样操作的起始时间点，以开始对在起始脉冲ST之后提供的数据进行采样。

[0049] 如上所述，在根据本发明的实施方式的液晶显示器中，因为将R、G和B数字视频数据(其每一个未分成奇数数字视频数据和偶数数字视频数据)通过三个数据总线对传输到各个源驱动IC，所以可以减小源PCB的尺寸。结果，可以提供薄外形的液晶显示器，且可以降低源PCB的生产成本。

[0050] 尽管参照多个示例性实施方式描述了实施方式，应理解的是本领域技术人员可建议落入本公开的原理的精神和范围内的许多其它修改和实施方式。更具体地，在本公开、附图以及所附的权利要求的范围内，在主题组合设置的组成部分和/或设置中可以做出各种变型和修改。除了组成部分和/或设置中的变型和修改之外，替换使用对于本领域技术人员也是明显的。