访存控制方法、装置及系统

摘要

本发明实施例提供一种访存控制方法、装置及系统。该方法包括：处理器执行内存设置指令，内存设置指令包括指令码、原始内存地址范围和目标值，指令码是内存设置指令的标识信息；处理器执行所述内存设置指令后生成内存设置信息，内存设置信息包括目标内存地址范围和所述目标值；所述处理器向内存控制器发送所述内存设置信息，以使内存控制器依据内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

权利要求

1.一种访存控制方法，其特征在于，包括：

处理器执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和目标值，所述指令码是所述内存设置指令的标识信息；

所述处理器执行所述内存设置指令后生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；

所述处理器向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

2.根据权利要求1所述的方法，其特征在于，所述原始内存地址范围表示的地址为虚拟地址；所述处理器执行所述内存设置指令后生成内存设置信息，包括：所述处理器将所述虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息。

3.根据权利要求1或2所述的方法，其特征在于，所述处理器包括高速缓存；所述方法还包括：所述处理器将所述高速缓存中存储的所述目标内存地址范围对应的目标区域的值进行写回或无效。

4.根据权利要求3所述的方法，其特征在于，所述处理器向内存控制器发送所述内存设置信息之后，还包括：所述处理器接收所述内存控制器返回的标记信息，所述标记信息是所述内存控制器成功设置内存后返回给所述处理器的信息。

5.根据权利要求4所述的方法，其特征在于，所述处理器接收所述内存控制器返回的标记信息之后，还包括：所述处理器产生中断。

6.一种访存控制方法，其特征在于，包括：

内存控制器接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和目标值，所述内存设置信息是所述处理器执行内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

7.根据权利要求6所述的方法，其特征在于，所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值之后，还包括：所述内存控制器向所述处理器返回标记信息，所述标记信息用于表示所述内存控制器成功设置内存。

8.一种访存控制装置，其特征在于，包括：

指令执行模块，用于执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和目标值，所述指令码是所述内存设置指令的标识信息；

内存设置信息生成模块，用于生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；

发送模块，用于向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

9.根据权利要求8所述的访存控制装置，其特征在于，所述原始内存地址范围表示的地址为虚拟地址；

所述内存设置信息生成模块具体用于将所述虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息。

10.根据权利要求8或9所述的访存控制装置，其特征在于，还包括：高速缓存一致性处理单元，用于将高速缓存中存储的所述目标内存地址范围对应的目标区域的值进行写回或无效。

11.根据权利要求10所述的访存控制装置，其特征在于，还包括：接收模块，用于接收所述内存控制器返回的标记信息，所述标记信息是所述内存控制器成功设置内存后返回给处理器的信息。

12.根据权利要求11所述的访存控制装置，其特征在于，还包括：中断模块，用于所述接收模块接收到所述标记信息后产生中断。

13.一种内存控制器，其特征在于，包括：

内存设置信息接收模块，用于接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和目标值，所述内存设置信息是所述处理器执行内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

内存设置模块，用于依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

14.根据权利要求13所述的内存控制器，其特征在于，还包括：标记信息发送模块，用于向所述处理器返回标记信息，所述标记信息用于表示所述内存控制器成功设置内存。

15.一种访存控制系统，其特征在于，包括内存、如权利要求8-12任一项所述的访存控制装置和权利要求13或14所述的内存控制器。

说明书

访存控制方法、装置及系统

技术领域

[0001] 本发明实施例涉及通信技术领域，尤其涉及一种访存控制方法、装置及系统。

背景技术

[0002] 随着处理器技术的持续发展，访存性能已成为影响处理器性能的主要因素。在诸多访存模式中，内存设置(memset)类是较为重要的一种。

[0003] 内存设置类访存通常用于初始化一段连续的内存空间，其实例包括但不限于：应用程序中对数组连续元素的特定赋值、memset库函数、GPU中对帧缓冲区的清除。这类访存的特点主要为访存范围大、访存模式简单。

[0004] 但是，内存设置类访存需要处理器逐一执行访存指令，从而占用了处理器的大量处理时间，导致处理器的处理效率大大下降。

发明内容

[0005] 本发明实施例提供一种访存控制方法、装置及系统，以提高处理器的处理效率。

[0006] 本发明实施例的一个方面是提供一种访存控制方法，包括：

[0007] 处理器执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0008] 所述处理器执行所述内存设置指令后生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；

[0009] 所述处理器向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0010] 本发明实施例的另一个方面是提供一种访存控制方法，包括：

[0011] 内存控制器接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述内存设置信息是所述处理器执行所述内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0012] 所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0013] 本发明实施例的另一个方面是提供一种访存控制装置，包括：

[0014] 指令执行模块，用于执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0015] 内存设置信息生成模块，用于生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；

[0016] 发送模块，用于向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0017] 本发明实施例的另一个方面是提供一种内存控制器，包括：

[0018] 内存设置信息接收模块，用于接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述内存设置信息是所述处理器执行所述内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0019] 内存设置模块，用于依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0020] 本发明实施例的另一个方面是提供一种访存控制系统，包括内存、所述的访存控制装置和所述的内存控制器。

[0021] 本发明实施例提供的访存控制方法、装置及系统，通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

附图说明

[0022] 图1为本发明实施例提供的访存控制方法流程图；

[0023] 图2为本发明实施例提供的访存控制方法适用的系统结构图；

[0024] 图3为本发明另一实施例提供的访存控制方法流程图；

[0025] 图4为本发明另一实施例提供的访存控制方法流程图；

[0026] 图5为本发明另一实施例提供的访存控制方法流程图；

[0027] 图6为本发明实施例提供的访存控制装置的结构图；

[0028] 图7为本发明另一实施例提供的访存控制装置的结构图；

[0029] 图8为本发明实施例提供的内存控制器的结构图；

[0030] 图9为本发明另一实施例提供的内存控制器的结构图；

[0031] 图10为本发明实施例提供的访存控制系统的结构图。

具体实施方式

[0032] 图1为本发明实施例提供的访存控制方法流程图；图2为本发明实施例提供的访存控制方法适用的系统结构图。本发明实施例针对内存设置类访存需要处理器逐一执行访存指令，从而占用了处理器的大量处理时间，导致处理器的处理效率大大下降，提供了访存控制方法，该方法具体步骤如下：

[0033] 步骤S101、处理器执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0034] 如图2所示，本发明实施例提供的访存控制方法适用的系统包括处理器20、内存控制器21和内存22，处理器20具体可以为中央处理器(Central Processing Unit，简称CPU)、图形处理器(Graphics Processing Unit，简称GPU)或内存设置类访存的设备；处理器20通过内存控制器21访问内存22，并不直接访问内存22，处理器20包括地址转换单元201和高速缓存一致性处理单元202，内存控制器21包括访存单元211。当处理器20需要对内存22的某一区域进行内存设置时，处理器20执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息。

[0035] 步骤S102、所述处理器执行所述内存设置指令后生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；

[0036] 处理器20执行所述内存设置指令后生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述目标内存地址范围为处理器20需要设置的内存22中的目标区域的地址范围，该地址范围具体为上下界。

[0037] 步骤S103、所述处理器向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0038] 处理器20生成内存设置信息后，将该内存设置信息发送给内存控制器21，内存控制器21中的访存单元211依据该内存设置信息访问内存22，具体的，访存单元211将内存22中该目标内存地址范围对应的目标区域的值设置为所述目标值。

[0039] 本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

[0040] 图3为本发明另一实施例提供的访存控制方法流程图。本发明实施例提供的方法具体步骤如下：

[0041] 步骤S301、处理器执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0042] 在本发明实施例中，内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息。

[0043] 步骤S302、所述原始内存地址范围表示的地址为虚拟地址；所述处理器将所述虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息；

[0044] 若处理器20执行的内存设置指令时，内存设置指令包括的原始内存地址范围表示的地址为虚拟地址，如图2所示，则处理器20中的地址转换单元201将该虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值。

[0045] 目标内存地址范围和原始内存地址范围指向的是同一内存区域，不同之处在于原始内存地址范围用虚拟地址表示，目标内存地址范围用物理地址表示。

[0046] 步骤S303、所述处理器向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0047] 本发明实施例通过处理器中的地址转换单元将该虚拟地址转换为物理地址，保证了内存控制器对内存设置信息正确识别。

[0048] 图4为本发明另一实施例提供的访存控制方法流程图。在图1或图3对应的实施例基础上，处理器还可以包括高速缓存，优选的，本发明实施例在图3对应的实施例基础上，处理器还可以包括高速缓存，相应的访存控制方法具体步骤如下：

[0049] 步骤S401、处理器执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0050] 所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息。

[0051] 步骤S402、所述原始内存地址范围表示的地址为虚拟地址；所述处理器将所述虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息；

[0052] 步骤S403、所述处理器将所述高速缓存中存储的所述目标内存地址范围对应的目标区域的值进行写回或无效；

[0053] 在本发明实施例中，处理器还包括高速缓存，该高速缓存可能存储有所述目标内存地址范围对应的目标区域的值，本发明实施例主要用于对内存进行访问设置，由于高速缓存和内存的地址分配方式是一致的，同一地址指向高速缓存和内存的区域是一致的，为了防止设置后的内存与高速缓存中已经存储的值不同，在内存控制器21访问设置内存22之前，高速缓存一致性处理单元202将所述高速缓存中存储的所述目标内存地址范围对应的目标区域的值进行写回或无效。

[0054] 步骤S404、所述处理器向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值；

[0055] 步骤S405、所述处理器接收所述内存控制器返回的标记信息，所述标记信息是所述内存控制器成功设置内存后返回给所述处理器的信息；

[0056] 当内存控制器21成功设置内存后返回给处理器20标记信息。

[0057] 步骤S406、所述处理器产生中断。

[0058] 由于内存控制器21设置内存22的过程中，处理器20可能在执行其他程序，当处理器20接收到内存控制器21返回的标记信息后产生中断以便停止执行其他处理操作并响应内存设置。

[0059] 本发明实施例在内存控制器访问设置内存之前，高速缓存一致性处理单元将高速缓存中存储的目标内存地址范围对应的目标区域的值进行写回或无效，避免了设置后的内存与高速缓存中已经存储的值不同，保证了内存与高速缓存中的数据一致性。

[0060] 图5为本发明另一实施例提供的访存控制方法流程图，本发明实施例针对内存设置类访存需要处理器逐一执行访存指令，从而占用了处理器的大量处理时间，导致处理器的处理效率大大下降，提供了访存控制方法，该方法具体步骤如下：

[0061] 步骤S501、内存控制器接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述内存设置信息是所述处理器执行所述内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；

[0062] 如图2所示，本发明实施例提供的访存控制方法适用的系统包括处理器20、内存控制器21和内存22，处理器20具体可以为中央处理器(Central Processing Unit，简称CPU)、图形处理器(Graphics Processing Unit，简称GPU)或内存设置类访存的设备；处理器20通过内存控制器21访问内存22，并不直接访问内存22，处理器20包括地址转换单元201和高速缓存一致性处理单元202，内存控制器21包括访存单元211。当处理器20需要对内存22的某一区域进行内存设置时，处理器20执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息。

[0063] 处理器20执行所述内存设置指令后生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述目标内存地址范围为处理器20需要设置的内存22中的目标区域的地址范围，该地址范围具体为上下界。

[0064] 处理器20生成内存设置信息后，将该内存设置信息发送给内存控制器21。

[0065] 步骤S502、所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0066] 内存控制器21中的访存单元211依据该内存设置信息访问内存22，具体的，访存单元211将内存22中该目标内存地址范围对应的目标区域的值设置为所述目标值。

[0067] 本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

[0068] 在图5对应的实施例的基础上，步骤S502之后，还包括：

[0069] 所述内存控制器向所述处理器返回标记信息，所述标记信息用于表示所述内存控制器成功设置内存。

[0070] 具体的，当内存控制器21成功设置内存后返回给处理器20标记信息。图6为本发明实施例提供的访存控制装置的结构图。本发明实施例提供的访存控制装置可以执行访存控制方法实施例提供的处理流程，该访存控制装置可以为上述实施例中的处理器21或者是处理器21中的一个模块，如图5所示，访存控制装置40包括指令执行模块41、内存设置信息生成模块42和发送模块43，其中，指令执行模块41用于执行内存设置指令，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；内存设置信息生成模块42用于生成内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值；发送模块43用于向内存控制器发送所述内存设置信息，以使所述内存控制器依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0071] 本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

[0072] 图7为本发明另一实施例提供的访存控制装置的结构图。在上述实施例的基础上，所述原始内存地址范围表示的地址为虚拟地址；内存设置信息生成模块42具体用于将所述虚拟地址转换为物理地址获得所述目标内存地址范围并生成内存设置信息。

[0073] 访存控制装置40还包括高速缓存一致性处理单元202，高速缓存一致性处理单元202用于将高速缓存中存储的所述目标内存地址范围对应的目标区域的值进行写回或无效。

[0074] 访存控制装置40还包括接收模块44，接收模块44用于接收所述内存控制器返回的标记信息，所述标记信息是所述内存控制器成功设置内存后返回给所述处理器的信息。

[0075] 访存控制装置40还包括中断模块45，中断模块45用于接收模块44接收到所述标记信息后产生中断。

[0076] 本发明实施例提供的访存控制装置可以具体用于执行上述图1所提供的方法实施例，具体功能此处不再赘述。

[0077] 本发明实施例通过处理器中的地址转换单元将该虚拟地址转换为物理地址，保证了内存控制器对内存设置信息正确识别；在内存控制器访问设置内存之前，高速缓存一致性处理单元将高速缓存中存储的内存地址范围对应的目标区域的值进行写回或无效，避免了设置后的内存与高速缓存中已经存储的值不同，保证了内存与高速缓存中的数据一致性。

[0078] 图8为本发明实施例提供的内存控制器的结构图。本发明实施例提供的内存控制器可以执行访存控制方法实施例提供的处理流程，如图8所示，内存控制器80包括内存设置信息接收模块81和内存设置模块82，其中，内存设置信息接收模块81用于接收处理器发送的内存设置信息，所述内存设置信息包括目标内存地址范围和所述目标值，所述内存设置信息是所述处理器执行所述内存设置指令后生成的信息，所述内存设置指令包括指令码、原始内存地址范围和所述目标值，所述指令码是所述内存设置指令的标识信息；内存设置模块82用于依据所述内存设置信息将内存中所述目标内存地址范围对应的目标区域的值设置为所述目标值。

[0079] 本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率。

[0080] 图9为本发明另一实施例提供的内存控制器的结构图。在图8的基础上，内存控制器80还包括标记信息发送模块83，标记信息发送模块83用于向所述处理器返回标记信息，所述标记信息用于表示所述内存控制器成功设置内存。

[0081] 本发明实施例提供的内存控制器可以具体用于执行上述图5所提供的方法实施例，具体功能此处不再赘述。图10为本发明实施例提供的访存控制系统的结构图。该访存控制系统可用于执行上述实施例所述的访存控制方法，如图10所示，访存控制系统100包括访存控制装置40、内存控制器80和内存90，其中，访存控制装置40为图6或图7对应的实施例所述的访存控制装置40，内存控制器80为图8或图9对应的实施例所述的内存控制器80。

[0082] 该访存控制系统可用于执行上述实施例所述的访存控制方法，具体过程与上述实施例一致，此处不再赘述。

[0083] 综上所述，本发明实施例通过处理器执行内存设置指令，并将内存设置信息发送给内存控制器，由内存控制器执行内存设置的操作，处理器可执行其他操作，避免内存设置占用处理器的大量处理时间，提高了处理器的处理效率；通过处理器中的地址转换单元将该虚拟地址转换为物理地址，保证了内存控制器对内存设置信息正确识别；在内存控制器访问设置内存之前，高速缓存一致性处理单元将高速缓存中存储的目标内存地址范围对应的目标区域的值进行写回或无效，避免了设置后的内存与高速缓存中已经存储的值不同，保证了内存与高速缓存中的数据一致性。

[0084] 在本发明所提供的几个实施例中，应该理解到，所揭露的装置和方法，可以通过其它的方式实现。例如，以上所描述的装置实施例仅仅是示意性的，例如，所述单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多个单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另一点，所显示或讨论的相互之间的耦合或直接耦合或通信连接可以是通过一些接口，装置或单元的间接耦合或通信连接，可以是电性，机械或其它的形式。

[0085] 所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本实施例方案的目的。

[0086] 另外，在本发明各个实施例中的各功能单元可以集成在一个处理单元中，也可以是各个单元单独物理存在，也可以两个或两个以上单元集成在一个单元中。上述集成的单元既可以采用硬件的形式实现，也可以采用硬件加软件功能单元的形式实现。

[0087] 上述以软件功能单元的形式实现的集成的单元，可以存储在一个计算机可读取存储介质中。上述软件功能单元存储在一个存储介质中，包括若干指令用以使得一台计算机设备(可以是个人计算机，服务器，或者网络设备等)或处理器(processor)执行本发明各个实施例所述方法的部分步骤。而前述的存储介质包括：U盘、移动硬盘、只读存储器(Read-Only Memory，ROM)、随机存取存储器(Random Access Memory，RAM)、磁碟或者光盘等各种可以存储程序代码的介质。

[0088] 本领域技术人员可以清楚地了解到，为描述的方便和简洁，仅以上述各功能模块的划分进行举例说明，实际应用中，可以根据需要而将上述功能分配由不同的功能模块完成，即将装置的内部结构划分成不同的功能模块，以完成以上描述的全部或者部分功能。上述描述的装置的具体工作过程，可以参考前述方法实施例中的对应过程，在此不再赘述。

[0089] 最后应说明的是：以上各实施例仅用以说明本发明的技术方案，而非对其限制；尽管参照前述各实施例对本发明进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本发明各实施例技术方案的范围。