半导体装置

摘要

半导体装置(1)具备设于半导体层叠构造(11)的第一电极(E1)、设于衬底(21)的第二电极(E2)、以及将第一电极(E1)和第二电极(E2)接合的接合金属层(30)，在接合金属层(30)的内部存在间隙(33)。

权利要求

1.一种半导体装置，其特征在于，具备：

第一电极，设于半导体层叠构造；

第二电极，设于衬底；以及接合金属层，将上述第一电极和上述第二电极进行接合；

在上述接合金属层的内部存在间隙；

上述第一电极具有p侧电极和n侧电极；

在平面视图中，对于上述间隙所占的面积的比例而言，距上述p侧电极和上述n侧电极相对置的p－n电极对置部较近的区域小于距上述p－n电极对置部较远的区域。

2.如权利要求1所述的半导体装置，其特征在于，距上述p－n电极对置部较近的区域是距上述p－n电极对置部的距离为100μm以下的区域。

3.如权利要求1或2所述的半导体装置，其特征在于，在将上述接合金属层进行平面观察时，上述间隙是线状，并且沿着上述第一电极的外周边。

4.如权利要求3所述的半导体装置，其特征在于，上述间隙平行于上述第一电极的外周边。

5.如权利要求1或2所述的半导体装置，其特征在于，上述间隙以一定间隔存在多个列。

6.如权利要求1或2所述的半导体装置，其特征在于，上述间隙由多个空隙构成。

7.如权利要求3所述的半导体装置，其特征在于，上述外周边在至少一部分具有曲线部；

上述间隙沿着上述曲线部。

8.如权利要求1或2所述的半导体装置，其特征在于，在将上述接合金属层进行平面观察时，上述间隙的至少一部分是放射状。

9.如权利要求1或2所述的半导体装置，其特征在于，上述间隙的高度是上述接合金属层的高度的10％以上。

10.如权利要求1或2所述的半导体装置，其特征在于，在上述间隙的至少一部分中填充有树脂。

说明书

半导体装置

技术领域

[0001] 本发明涉及半导体装置。

背景技术

[0002] LED(Light Emitting Diode)等半导体发光元件作为各种各样的设备的光源而被利用。例如，LED被用于DRL(Daytime Running Lights，日间行车灯)以及HL(Head Lamp，车
头灯)等车载用照明装置的车载光源。特别是，采用光功率为1W以上的大功率LED的车载光
源的市场扩大，卤素(Halogen)灯或HID灯的LED化急速扩大。

[0003] 关于车载光源，省空间及设计性提高的要求正在提高，因此LED的小型化、大电流化、集成化正在进展。随之，对于确保LED所要求的可靠性而言，关键在于如何将LED的发热
进行散热。

[0004] 为了实现LED芯片等半导体芯片的小型化、大电流化、集成化，作为将半导体芯片和安装衬底进行接合的技术，已知通过面朝下(face down)方式将半导体芯片与安装衬底
进行接合的倒装芯片键合(flip chip bonding)(倒装芯片接合)。该方式将半导体芯片倒
装(翻转)而将安装衬底的电极与半导体芯片的电极用金属凸点直接接合，与通过使半导体
芯片的电极形成面朝向上面而进行引线连接的面朝上(face up)方式将半导体芯片与安装
衬底进行接合的情况相比，不论引线径及引线的引绕如何，都适合于大电流化、高集成化，
作为高输出用途的安装方法而在车载光源中采用。

[0005] 这种以往的半导体装置在专利文献1中公开。在专利文献1中，公开了以提高散热性为目的、在将半导体元件和安装衬底进行接合时将半导体元件与安装衬底之间的多个金
属凸点较密地配置的技术。

[0006] 现有技术文献

[0007] 专利文献

[0008] 专利文献1：日本特开2011－9429号公报

[0009] 但是，在专利文献1所公开的半导体装置中，经由离散地配置的金属凸点将半导体元件向安装衬底安装时的安装载荷局部集中地作用于半导体元件及安装衬底的各自的电
极与金属凸点的接触面，所以会对半导体元件及安装衬底的各自的电极带来损伤。因此，存
在发生电极不良等安装损伤、有损长期可靠性的课题。

发明内容

[0010] 本发明的目的在于，提供降低安装损伤而长期可靠性优良的半导体装置。

[0011] 本发明的半导体装置的一个形态，具备设于半导体层叠构造的第一电极、设于衬底的第二电极、以及将上述第一电极与上述第二电极相接合的接合金属层，在上述接合金
属层的内部存在间隙。

[0012] 根据本发明，能够降低安装损伤，因此能够实现长期可靠性优良的半导体装置。

附图说明

[0013] 图1A是图2B的IA－IA线的实施方式1的半导体装置的剖面图。

[0014] 图1B是图2B的IB－IB线的实施方式1的半导体装置的剖面图。

[0015] 图2A是用图1B所示的虚线T切断时的T剖面中的实施方式1的半导体装置的剖面图。

[0016] 图2B是用图1B所示的虚线M切断时的M剖面中的实施方式1的半导体装置的剖面图。

[0017] 图2C是用图1B所示的虚线B切断时的B剖面中的实施方式1的半导体装置的剖面图。

[0018] 图3A是表示在实施方式1的半导体装置的制造方法的第一工序中准备衬底的工序的图。

[0019] 图3B是表示在实施方式1的半导体装置的制造方法的第一工序中形成半导体层叠构造的工序的图。

[0020] 图4A是表示在实施方式1的半导体装置的制造方法的第二工序中将半导体层叠构造进行蚀刻的工序的图。

[0021] 图4B是表示在实施方式1的半导体装置的制造方法的第二工序中形成绝缘膜的工序的图。

[0022] 图4C是表示在实施方式1的半导体装置的制造方法的第二工序中形成第一n侧电极的欧姆接触层以及阻挡电极的工序的图。

[0023] 图4D是表示在实施方式1的半导体装置的制造方法的第二工序中形成第一p侧电极的反射电极的工序的图。

[0024] 图4E是表示在实施方式1的半导体装置的制造方法的第二工序中形成第一p侧电极的阻挡电极的工序的图。

[0025] 图4F是表示在实施方式1的半导体装置的制造方法的第二工序中形成种子膜的工序的图。

[0026] 图4G是表示在实施方式1的半导体装置的制造方法的第二工序中形成抗蚀剂的工序的图。

[0027] 图4H是表示在实施方式1的半导体装置的制造方法的第二工序中形成第一p侧电极以及第一n侧电极的覆盖电极的工序的图。

[0028] 图4I是表示在实施方式1的半导体装置的制造方法的第二工序中将抗蚀剂除去的工序的图。

[0029] 图5A是表示在实施方式1的半导体装置的制造方法的第三工序中形成具有开口部的抗蚀剂的工序的图。

[0030] 图5B是表示在实施方式1的半导体装置的制造方法的第三工序中形成镀金膜的工序的图。

[0031] 图5C是表示在实施方式1的半导体装置的制造方法的第三工序中将抗蚀剂除去的工序的图。

[0032] 图5D是表示在实施方式1的半导体装置的制造方法的第三工序中将种子膜的一部分除去而将电极进行pn分离的工序的图。

[0033] 图5E是表示在实施方式1的半导体装置的制造方法的第三工序中进行热处理的工序的图。

[0034] 图6A是表示在实施方式1的半导体装置的制造方法的第四工序中在安装衬底之上配置半导体元件的工序的图。

[0035] 图6B是表示在实施方式1的半导体装置的制造方法的第四工序中在安装衬底之上安装半导体元件并进行超声波接合的工序的图。

[0036] 图7A是图5D的区域VIIA的放大图。

[0037] 图7B是图5E的区域VIIB的放大图。

[0038] 图7C是表示从图7B的状态起晶粒进一步粗大化后的状态的图。

[0039] 图8是用于说明晶粒径的测定方法的图。

[0040] 图9是表示镀金膜的平均晶粒径与单层镀金膜的硬度的关系的图。

[0041] 图10是在实施方式1中将半导体元件向安装衬底安装时的接合处理的时序图。

[0042] 图11A是示意性地表示进行半导体元件与安装衬底的接合处理之前的金属凸点与安装衬底的第二电极的状态的剖面图。

[0043] 图11B是示意性地表示半导体元件与安装衬底的接合处理的处理开始时的金属凸点与安装衬底的第二电极的状态的剖面图。

[0044] 图11C是示意性地表示图10中的步骤1和步骤2的切换时(从处理开始起约100ms后)的金属凸点与安装衬底的第二电极的接合状态的剖面图。

[0045] 图11D是示意性地表示图10中的步骤2的中途过程(从处理开始起约300ms后，从超声波振动开始起200ms后)的金属凸点与安装衬底的第二电极的接合状态的剖面图。

[0046] 图11E是示意性地表示图10中的步骤2的结束时点(从处理开始起约400ms后，从超声波振动开始起300ms后)的金属凸点与安装衬底的第二电极的接合状态的剖面图。

[0047] 图12是表示专利文献1中公开的以往的半导体装置的制造方法的剖面图。

[0048] 图13是表示实施方式1的半导体装置的安装前后的结构的图。

[0049] 图14A是表示实施方式1的变形例1的半导体装置中的接合金属层的间隙的图案的图。

[0050] 图14B是表示实施方式1的变形例2的半导体装置中的接合金属层的间隙的图案的图。

[0051] 图14C是表示实施方式1的变形例3的半导体装置中的接合金属层的间隙的图案的图。

[0052] 图14D是表示实施方式1的变形例4的半导体装置中的接合金属层的间隙的图案的图。

[0053] 图14E是表示实施方式1的变形例5的半导体装置中的接合金属层的间隙的图案的图。

[0054] 图14F是表示实施方式1的变形例6的半导体装置中的接合金属层的间隙的图案的图。

[0055] 图14G是表示实施方式1的变形例7的半导体装置中的接合金属层的间隙的图案的图。

[0056] 图14H是表示实施方式1的变形例8的半导体装置中的接合金属层的间隙的图案的图。

[0057] 图14I是表示实施方式1的变形例9的半导体装置中的接合金属层的间隙的图案的图。

[0058] 图14J是表示实施方式1的变形例10的半导体装置中的接合金属层的间隙的图案的图。

[0059] 图14K是表示实施方式1的变形例11的半导体装置中的接合金属层的间隙的图案的图。

[0060] 图14L是表示实施方式1的变形例12的半导体装置中的接合金属层的间隙的图案的图。

[0061] 图14M是表示实施方式1的变形例13的半导体装置中的接合金属层的间隙的图案的图。

[0062] 图14N是表示实施方式1的变形例14的半导体装置中的接合金属层的间隙的图案的图。

[0063] 图14O是表示实施方式1的变形例15的半导体装置中的接合金属层的间隙的图案的图。

[0064] 图15是表示实施方式2的半导体装置的安装前后的结构的剖面图。

[0065] 图16是图15的(b)的M剖面的放大图。

[0066] 图17是表示实施方式2的变形例1的半导体装置中的接合金属层的间隙的图案的图。

[0067] 图18是表示实施方式2的变形例2的半导体装置中的接合金属层的间隙的图案的图。

[0068] 图19是表示实施方式2的变形例3的半导体装置的安装前后的结构的剖面图。

[0069] 图20是表示实施方式3的半导体装置的安装前后的结构的剖面图。

[0070] 图21是表示实施方式3的变形例1的半导体装置的安装后的结构的剖面图。

[0071] 图22是表示实施方式3的变形例2的半导体装置的安装后的结构的剖面图。

[0072] 图23是表示实施方式3的变形例3的半导体装置的安装后的结构的剖面图。

具体实施方式

[0073] (实施方式)

[0074] 以下，参照附图说明本发明的实施方式。另外，以下说明的实施方式均表示本发明的一具体例。因而，以下的实施方式所示的数值、形状、材料、构成要素、构成要素的配置位
置及连接形态、工序及工序的顺序等作为一例而并不意欲限定本发明。

[0075] 此外，各图是示意图，并不一定严格地进行图示。因而，在各图中比例尺等不一定一致。另外，在各图中，对实质相同的结构附加同一标记，重复的说明省略或简化。

[0076] (实施方式1)

[0077] [半导体装置]

[0078] 首先，关于实施方式1的半导体装置1的结构，利用图1A～图1B以及图2A～图2C进行说明。图1A及图1B是实施方式1的半导体装置1的剖面图。图2A是用图1B所示的虚线T切断
时的T剖面中的该半导体装置1的剖面图。图2B是沿着图1B所示的虚线M切断时的M剖面中的
该半导体装置1的剖面图。图2C是沿着图1B所示的虚线B切断时的B剖面中的该半导体装置1
的剖面图。另外，图1A是图2B的IA－IA线的剖面图，图1B是图2B的IB－IB线的剖面图。此外，
在图2A～图2C中，虚线T、虚线M及虚线B分别示出与接合金属层30的厚度方向(高度方向)垂
直的平面。虚线M是经过间隙33的平面，位于虚线T与虚线B之间。

[0079] 如图1A及图1B所示，实施方式1的半导体装置1具备半导体元件10、安装衬底20、以及将半导体元件10和安装衬底20接合的接合金属层30。

[0080] 半导体元件10配置于安装衬底20。具体而言，半导体元件10经由接合金属层30而与安装衬底20接合，从而被安装于安装衬底20。在本实施方式中，半导体元件10是发光二极
管(LED)芯片。因而，半导体装置1是具备LED芯片的半导体发光装置。

[0081] 半导体元件10具有半导体层叠构造11和设于半导体层叠构造11的第一电极E1。具体而言，作为第一电极E1，半导体元件10具有形成于半导体层叠构造11的第一p侧电极12以
及第一n侧电极13。第一p侧电极12以及第一n侧电极13具有包含由与接合金属层30相接的
金构成的表面层的至少2层。

[0082] 另外，在本说明书中，第一p侧电极12以及第一n侧电极13在不需要特别区别说明的情况下有时统一记作第一电极E1。即，第一电极E1是第一p侧电极12以及第一n侧电极13
的至少一方。

[0083] 半导体层叠构造11具有衬底11a、n型半导体层11b(第一导电型半导体层)、有源层11c和p型半导体层11d(第二导电型半导体层)。n型半导体层11b、有源层11c以及p型半导体
层11d是与衬底11a相接的半导体层叠体，从衬底11a侧依次层叠。具体而言，n型半导体层
11b、有源层11c以及p型半导体层11d在衬底11a之上朝向从衬底11a离开的方向依次层叠。

[0084] 第一p侧电极12以及第一n侧电极13形成于半导体层叠构造11。第一p侧电极12形成于p型半导体层11d之上。此外，第一n侧电极13形成于n型半导体层11b之上。具体而言，第
一n侧电极13形成于通过将p型半导体层11d及有源层11c的一部分除去而局部地使n型半导
体层11b露出的露出区域。

[0085] 在本实施方式中，在半导体层叠构造11之上，作为绝缘膜而形成有氧化膜14。第一p侧电极12形成于从氧化膜14的开口部露出的p型半导体层11d之上，第一n侧电极13形成于
从氧化膜14的开口部露出的n型半导体层11b之上。

[0086] 第一p侧电极12具有从半导体层叠构造11侧依次层叠的反射电极12a、阻挡电极(barrier electrode)12b、种子层12c以及覆盖电极12d。具体而言，反射电极12a、阻挡电极
12b、种子层12c以及覆盖电极12d在半导体层叠构造11之上依次层叠。在第一p侧电极12中，
反射电极12a是对来自半导体层叠构造11的有源层11c的光进行反射的金属膜，与半导体层
叠构造11的p型半导体层11d(第二导电型半导体层)相接而配置。

[0087] 此外，第一n侧电极13具有从半导体层叠构造11侧依次层叠的欧姆接触层13a、阻挡电极13b、种子层13c以及覆盖电极13d。

[0088] 此外，在第一p侧电极12及第一n侧电极13中，覆盖电极12d及13d是与接合金属层30相接的由金构成的表面层。具体而言，覆盖电极12d及13d是以种子层12c及13c为基底层
而形成的镀金膜。

[0089] 安装衬底20具有衬底21和设于衬底21的第二电极E2。具体而言，作为第二电极E2，安装衬底20具有在衬底21的一面形成的第二p侧电极22以及第二n侧电极23。第二p侧电极
22以及第二n侧电极23是用于向半导体元件10施加电流的引出电极。

[0090] 第二p侧电极22与半导体元件10的第一p侧电极12经由接合金属层30相接合。n侧也同样，第二n侧电极23与半导体元件10的第一n侧电极13经由接合金属层30相接合。

[0091] 另外，在本说明书中，第二p侧电极22及第二n侧电极23在不需要特别区别说明的情况下有时统一记作第二电极E2。即，第二电极E2是第二p侧电极22及第二n侧电极23的至
少一方。

[0092] 接合金属层30将半导体元件10与安装衬底20接合。即，接合金属层30将半导体元件10与安装衬底20相连。具体而言，接合金属层30将设于半导体层叠构造11的第一电极E1
与设于衬底21的第二电极E2连接。

[0093] 在本实施方式中，接合金属层30具有第一接合金属层31和第二接合金属层32。第一接合金属层31位于半导体元件10的第一p侧电极12与安装衬底20的第二p侧电极22之间，
将第一p侧电极12与第二p侧电极22接合。此外，第二接合金属层32位于半导体元件10的第
一n侧电极13与安装衬底20的第二n侧电极23之间，将第一n侧电极13与第二n侧电极23接
合。

[0094] 第一接合金属层31与第二接合金属层32由相同材料构成。在本实施方式中，第一接合金属层31及第二接合金属层32均由镀金膜构成。

[0095] 如图1A～图1B以及图2A～图2C所示，在接合金属层30的内部存在间隙33。间隙33以周围被接合金属层30包围的方式存在。具体而言，间隙33以不与第一电极E1及第二电极
E2相接地埋入到接合金属层30之中的方式存在于接合金属层30内。在本实施方式中，间隙
33存在于第一接合金属层31，与第一p侧电极12及第一n侧电极13均不相接，存在于第一接
合金属层31的厚度方向的中央部附近。此外，在本实施方式中，间隙33是中空的空洞。因而，
间隙33是空气层，在间隙33中存在空气。

[0096] 如图2B所示，间隙33在将接合金属层30平面视时为线状，沿着第一电极E1的外周边。具体而言，间隙33平行于第一电极E1的外周边。在本实施方式中，间隙33形成为格子状。

[0097] 此外，如图1A所示，间隙33的高度H可以为接合金属层30的高度的10％以上。另外，间隙33的高度H的上限不特别限定，例如是90％。

[0098] 详细后述，接合金属层30通过在将半导体元件10向安装衬底20安装时半导体元件10与安装衬底20之间设置的多个金属凸点相互连接而构成。此时，在接合金属层30的内部
形成间隙33。即，间隙33在经由多个金属凸点将半导体元件10向安装衬底20安装时形成。以
下，包含形成间隙33的过程而详细说明半导体装置1的制造方法。

[0099] [半导体装置的制造方法]

[0100] 实施方式1的半导体装置1的制造方法包括形成半导体元件10的半导体层叠构造11的第一工序(图3A～图3B)、后续的形成半导体元件10的第一电极的第二工序(图4A～图
4I)、后续的将金属凸点30Y形成于半导体元件10的第三工序(图5A～图5E)、以及后续的通
过倒装芯片键合将半导体元件10向安装衬底20安装的第四工序(图6A～图6B)。

[0101] [第一工序(半导体层叠构造的形成工序)]

[0102] 首先，通过图3A～图3B所示的流程，形成半导体元件10的半导体层叠构造11。图3A～图3B是表示用于形成半导体元件10的半导体层叠构造11的流程的图。

[0103] 具体而言，如图3A所示，首先，准备衬底11a。在本实施方式中，对于衬底11a，使用由GaN构成的晶片(GaN衬底)作为由半导体构成的透光性衬底。

[0104] 接着，如图3B所示，在衬底11a之上，通过有机金属气相外延生长法(MOVPE法)，将n型半导体层11b、有源层11c和p型半导体层11d依次层叠，从而能够形成半导体层叠构造11。

[0105] 在本实施方式中，n型半导体层11b是n型氮化物半导体层(例如GaN层)，有源层11c是氮化物半导体发光层，p型半导体层11d是p型氮化物半导体层。构成有源层11c的氮化物
半导体发光层至少包含Ga和N，通过根据需要而含有适量的In，从而能够得到所希望的发光
波长。在本实施方式中，有源层11c是InGaN层，以使发光峰值波长为450nm的方式设定了In
成分比。

[0106] [第二工序(第一电极的形成工序)]

[0107] 接着，通过图4A～图4I所示的流程，形成半导体元件10的第一电极E1(第一p侧电极12、第一n侧电极13)。图4A～图4I是表示用于形成半导体元件10的第一电极E1的流程的
图。

[0108] 具体而言，首先，如图4A所示，对于通过上述第一工序形成的半导体层叠构造11，通过干法蚀刻将p型半导体层11d、有源层11c和n型半导体层11b的一部分除去，从而使n型
半导体层11b的一部分从p型半导体层11d及有源层11c露出。由此，能够在n型半导体层11b
的一部分形成露出区域。

[0109] 接着，如图4B所示，在包括n型半导体层11b的露出区域的半导体层叠构造11的上表面整体形成氧化膜14作为绝缘膜。

[0110] 然后，虽未图示，但在氧化膜14之上涂布抗蚀剂，通过光刻在与n型半导体层11b的露出区域内对应的位置在抗蚀剂中形成开口部，通过基于氢氟酸的蚀刻，将抗蚀剂的开口
部内的氧化膜14除去。

[0111] 接着，利用EB蒸镀法，将用于形成第一电极E1的第一n侧电极13的n侧电极形成材料成膜，通过抗蚀剂剥离(lift off)法，将抗试剂和多余的n侧电极形成材料除去，从而在
除去了氧化膜14后的区域如图4C所示那样形成第一n侧电极13的一部分。

[0112] 在本实施方式中，作为n侧电极形成材料，从与n型半导体层11b较近侧朝向远离的方向，将成为欧姆接触层13a的Al层(膜厚0.3μm)和成为阻挡电极13b的Ti层(膜厚0.1μm)依
次成膜。由此，作为第一n侧电极13的一部分，能够形成由Al层形成的欧姆接触层13a和由Ti
层形成的阻挡电极13b的层叠构造层。

[0113] 另外，在n型半导体层11b上直接层叠的第一n侧电极13的Al层作为对n型半导体层11b的欧姆接触层发挥功能。欧姆接触层的材料例如能够设为Ti、V、Al、或者包含它们中的
某一种金属的合金等。此外，用于阻挡电极13b的Ti层作为不使下层的Al层和通过之后工序
形成的上层的Au层发生反应的阻挡体(barrier)发挥功能。

[0114] 然后，虽未图示，以将第一n侧电极13及氧化膜14覆盖的方式涂布抗蚀剂，通过光刻在p型半导体层11d的抗蚀剂中形成开口部，通过基于氢氟酸的蚀刻将抗蚀剂的开口部内
的氧化膜14除去。

[0115] 接着，利用EB蒸镀法，将用于形成第一电极E1的第一p侧电极12的p侧电极形成材料成膜，通过抗蚀剂剥离法将抗蚀剂和多余的p侧电极形成材料除去，从而在p型半导体层
11d上的将氧化膜14除去了的区域，如图4D所示那样形成作为第一p侧电极12的一部分的反
射电极12a。

[0116] 本实施方式中，作为由Ag层构成的反射电极12a(p侧电极形成材料)，将膜厚0.2μm的Ag层成膜。此时，反射电极12a以从氧化膜14分离的方式形成。换言之，形成为，p型半导体
层11d从反射电极12a与氧化膜14之间露出。

[0117] 另外，对于反射电极12a，为了反射有源层11c的光，可以使用反射率高的由包含Ag、Al、Rh的金属材料构成的金属膜。此外，反射电极12a的成膜方法不限于EB蒸镀法，也可
以是溅射法。

[0118] 接着，如图4E所示，以将反射电极12a的上表面及侧面覆盖的方式形成阻挡电极12b。本实施方式中，利用溅射法，作为阻挡电极12b，形成膜厚0.8μm的Ti层。作为阻挡电极
12b的材料，为了保护反射电极12a，可以使用Ti、Ni、Pt、TiW等。此时，阻挡电极12b形成为，
将在氧化膜14与反射电极12a之间露出的p型半导体层11d、以及n型半导体层11b上的氧化
膜14的端部覆盖。

[0119] 接着，如图4F所示，在形成有第一p侧电极12的阻挡电极12b以及第一n侧电极13的阻挡电极13b的晶片整面，通过EB蒸镀法形成种子膜12S。种子膜12S是成为第一p侧电极12
的种子层12c以及第一n侧电极13的种子层13c的金属膜，被用作镀金的基底电极。本实施方
式中，种子膜12S是从与阻挡电极12b及13b较近侧朝向离开方向层叠有Ti层及Au层的层叠
构造层。

[0120] 接着，如图4G所示，在与第一p侧电极12对应的阻挡电极12b和与第一n侧电极13对应的阻挡电极13b的边界区域的种子膜12S上，形成抗蚀剂15。

[0121] 接着，如图4H所示，在晶片上的没有形成抗蚀剂15的区域(抗蚀剂非形成区域)，以种子膜12S作为基底电极，通过电镀使金属析出，从而形成作为镀金膜的覆盖电极12d及
13d。覆盖电极12d形成在阻挡电极12b上的种子膜12S上，覆盖电极13d形成在阻挡电极13b
上的种子膜12S上。作为形成镀膜而作为覆盖电极12d及13d时的条件的一例，利用电镀液温
度为50℃的非氰类镀金液，将析出速度设定为0.5μm/min，作为覆盖电极12d及13d而形成厚
度为1.0μm的镀金膜。

[0122] 这里，对于覆盖电极12d及13d，为了提高耐腐蚀性，使用Au或含Au的材料。此外，在将半导体元件10从覆盖电极12d(覆盖电极13d)侧进行平面观察的情况下，覆盖电极12d以
将阻挡电极12b内包的方式形成，此外，覆盖电极13d以将阻挡电极13b内包的方式形成。另
外，在覆盖电极12d与覆盖电极13d之间的半导体层叠构造11侧配置有氧化膜14。

[0123] 接着，如图4I所示，将抗蚀剂15除去。例如，通过有机溶剂等将种子膜12S上的抗蚀剂15除去。

[0124] [第三工序(金属凸点的形成工序)]

[0125] 接着，通过图5A～图5E所示的流程，在半导体元件10形成金属凸点30Y。图5A～图5E是表示用于在半导体元件10形成金属凸点30Y的流程的图。

[0126] 以下说明的金属凸点30Y包括与第一p侧电极12对应的p侧的第一凸点以及与第一n侧电极13对应的n侧的第二凸点。第一凸点形成在第一p侧电极12之上，第二凸点形成在第
一n侧电极13之上。本实施方式中，金属凸点30Y是通过镀金法形成的镀金凸点。此外，金属
凸点30Y由多个金属层构成，成为将晶粒径不同的镀金膜至少层叠了2层的层叠构造。以下，
详细说明金属凸点30Y的形成方法。

[0127] 在上述第二工序之后，首先，以将覆盖电极12d及13d的整面覆盖的方式涂布光刻用的抗蚀剂，以140℃通过20分钟左右的热处理使抗蚀剂硬化。之后，如图5A所示，在第一电
极E1中的形成金属凸点30Y的规定的区域的抗蚀剂16中形成开口部16a。具体而言，在第一p
侧电极12的覆盖电极12d上以及第一n侧电极13的覆盖电极13d上的各自的形成金属凸点
30Y的规定的区域的抗蚀剂16中，通过光刻形成多个开口部16a。

[0128] 另外，本实施方式中，作为概念图，设为将金属凸点30Y合计配置了9个的结构，但实际上有形成9个以上金属凸点30Y的情况。作为一例，在作为本实施方式的800μm见方×
100μm厚的半导体元件10中，如果是上表面形状为一边25μm的矩形状的四棱柱的金属凸点
30Y，则可以形成有1000个左右的金属凸点30Y。另外，金属凸点30Y的大小、形状、数量没有
特别限定，对应于半导体元件10的大小、第一电极E1及第二电极E2的面积、形状等分别具体
地设定。例如，金属凸点30Y的个数可以小于9个，也可以是几十个至几百个。

[0129] 接着，如图5B所示，通过金的电镀法在抗蚀剂16的开口部16a中使金析出，从而形成成为金属凸点30Y的镀金膜30X。具体而言，将镀金膜30X分别同时形成于在抗蚀剂16的开
口部16a中露出的第一p侧电极12的覆盖电极12d之上和第一n侧电极13的覆盖电极13d之
上。作为形成镀金膜30X时的条件的一例，使用电镀液温度为50℃的非氰类镀金液，将析出
速度设定为0.5μm/min，形成高度(厚度)为8μm的镀金膜30X。刚刚形成后的镀金膜30X的晶
体构造整体上是细小的晶粒的集合体。

[0130] 接着，如图5C所示，将抗蚀剂16除去。例如，通过有机溶剂等将抗蚀剂16除去。由此，在第一p侧电极12的覆盖电极12d上以及第一n侧电极13的覆盖电极13d上的各自的规定
的区域，形成四棱柱形状的多个镀金膜30X。

[0131] 该情况下，相邻的镀金膜30X的间隔是相邻的金属凸点30Y的间隔，被设定为将半导体元件10向安装衬底20安装时相邻的金属凸点30Y彼此接触的程度的大小的间隔。例如，
在形成上表面形状为一边25μm的矩形状且高度为8μm的四棱柱形状的多个镀金膜30X的情
况下，相邻的镀金膜30X的间隔是例如6μm。

[0132] 接着，如图5D所示，将第一p侧电极12的阻挡电极12b与第一n侧电极13的阻挡电极13b之间的氧化膜14上的种子膜12S局部地除去。本实施方式中，种子膜12S是Au层和Ti层的
层叠构造，因此，首先，将作为种子膜12S的上层的Au层通过碘液除去，然后，将作为种子膜
12S的下层的Ti层通过稀氢氟酸除去，使氧化膜14露出。由此，在氧化膜14上，将种子膜12S
分离为p侧的种子层12c和n侧的种子层13c，能够进行第一电极E1的pn分离。具体而言，能够
形成被分离为作为反射电极12a、阻挡电极12b、种子层12c和覆盖电极12d的层叠构造的第
一p侧电极12、以及作为欧姆接触层13a、阻挡电极13b、种子层13c和覆盖电极13d的层叠构
造的第一n侧电极13的第一电极E1。

[0133] 接着，如图5E所示，将形成了镀金膜30X的晶片在大气环境中以150℃进行1小时的热处理。通过该热处理，镀金膜30X内的下侧区域和覆盖电极12d及13d的晶粒径变化。由此，
能够以同一成分得到由晶粒径不同的第一层30a及第二层30b这2层构成的金属凸点30Y。在
金属凸点30Y中，距半导体层叠构造11较近侧的第一层30a相比于距半导体层叠构造11较远
侧的第二层30b而言晶粒径大。此外，构成金属凸点30Y的第一层30a的晶体的晶粒径与构成
覆盖电极12d及13d的晶体的晶粒径相同。

[0134] 由此，能够得到形成了多个金属凸点30Y的具有第一电极E1的半导体元件10。具体而言，能够得到具有形成有多个金属凸点30Y的第一p侧电极12和形成有金属凸点30Y的第
一n侧电极13的半导体元件10。

[0135] 另外，本实施方式中，多个金属凸点30Y配置为矩阵状。此外，多个金属凸点30Y成为通过将半导体元件10向安装衬底20安装的工序从而相邻的金属凸点30Y彼此接触的程度
的大小的间隔。

[0136] 这里，关于图5E中的基于热处理的晶粒径的变化，利用图7A～图7C详细说明。图7A是图5D中的区域VIIA的放大图。图7B是图5E中的区域VIIB的放大图。图7C是表示从图7B的
状态进一步将晶粒粗大化的状态的图。图7A～图7C示出了与第一电极E1的第一p侧电极12
上的一个镀金膜30X或金属凸点30Y及位于其下方的第一p侧电极12的覆盖电极12d的一部
分对应的区域。

[0137] 图7A示出了刚刚形成镀金膜30X后的镀金膜30X的剖面。如图7A所示，刚刚形成后的镀金膜30X整体由较细的晶粒的集合体构成。

[0138] 若对形成了镀金膜30X的晶片通过加热板开始热处理，则如图7B所示，从第一p侧电极12(覆盖电极12d)侧沿箭头的方向向镀金膜30X高效地热传递。传递至镀金膜30X的热
成为构成镀金膜30X的金的再结晶化的驱动能，第一p侧电极12侧的晶粒较大地生长。若进
一步继续热处理，则从第一p侧电极12侧朝向镀金膜30X的前端而晶粒粗大化，最终如图7C
所示，在镀金膜30X整体中粗大化的晶粒扩展。热处理的温度越高，或者热处理的时间越长，
则该晶粒的粗大化越进展。

[0139] 本实施方式中的形成金属凸点30Y时的热处理条件(150℃、1小时的热处理)不是图7C所示那样的将直到镀金膜30X的前端为止通过再结晶而粗大化的条件，而是图7B所示
那样的将晶粒的粗大化在镀金膜30X的中途停止的条件。即，对于镀金膜30X，通过在大气环
境中以150℃实施1小时的热处理，从而若用晶粒径区分则形成大致2层构造的金属凸点
30Y。具体而言，形成具有距第一p侧电极12较近侧的晶粒粗大化的第一层30a以及第一p侧
电极12的对面侧的晶粒相对较小的第二层30b的金属凸点30Y。

[0140] 另外，不仅是在第一电极E1的第一p侧电极12之上形成的镀金膜30X，关于在第一电极E1的第一n侧电极13之上形成的镀金膜30X，也与在第一p侧电极12之上形成的镀金膜
30X同样地晶粒变化。即，通过150℃的1小时的热处理，在第一n侧电极13之上形成的镀金膜
30X变化为晶粒径不同的2层，如图7B所示，形成具有距第一n侧电极13较近侧的晶粒粗大化
的第一层30a以及第一n侧电极13的对面侧的晶粒相对较小的第二层30b的金属凸点30Y。

[0141] 这样，金属凸点30Y由金属的晶粒径不同的第一层30a和第二层30b构成。具体而言，在金属凸点30Y中，构成第一层30a的晶体的平均晶粒径大于构成第二层30b的晶体的平
均晶粒径。

[0142] 这里，对金属的晶粒径与硬度的关系进行说明。通常，金属的晶粒径与硬度具有负相关。即，随着晶粒径变小而硬度变高。相反，随着晶粒径变大而硬度变低。这是因为金属的
硬度由作用有载荷时的金属的塑性变形量决定，此外是因为，塑性变形量受到位错的移动、
增殖及移动的障碍物、滑移面的长度及金属晶体的方向的影响。

[0143] 金属晶体的滑移面决定于晶格的某特定方向，若作用有应力则在该方向上发生滑移，金属塑性变形。即，晶粒径大的金属晶体的滑移线的长度长，若作用有应力则应力集中
在晶体边界，在其附近容易塑性变形。即，较软。

[0144] 相反，晶粒径小的金属晶体的单体晶粒的滑移面的长度小，在作用有某应力的情况下，与应力的方向不一致的滑移面变多。由此，这些晶体成为阻力而不易发生滑移，金属
不易塑性变形。即，晶粒径小的金属晶体较硬。

[0145] 关于这样的晶粒径与硬度的关系，对于镀金膜也是同样的。即，关于由镀金膜30X构成的金属凸点30Y，晶粒径和硬度也具有负相关。即，构成镀金膜30X的晶体的平均晶粒径
越大则硬度越低。

[0146] 并且，根据本实施方式中的金属凸点30Y，通过将镀金膜30X热处理，第一层30a由于伴随加热的再结晶而晶粒径粗大化。即，在金属凸点30Y中，晶体的平均晶粒径相对较大
的第一层30a比晶体的平均晶粒径相对较小的第二层30b软。

[0147] 此外，以下表示在本实施方式中采用的镀金30X及金属凸点30Y的晶粒径的测定方法。本实施方式中，在利用聚焦离子束(FIB)形成了镀金30X或金属凸点30Y的剖面后，对通
过扫描型显微镜的Scannig Ion Microscopy像(SIM像，扫描离子显微镜图像)进行了观察
的观察区域应用截距法(intercept method)而测定了晶粒径。

[0148] 此时，如图8所示，在一边为L的正方形之中具有平均晶粒径d的晶体在每一边存在2 2
n个的情况下，正方形的面积为L ，1个晶粒的面积为π(d/2) 。并且，对于晶粒而言观察区域
2 2 2
相对较大的情况下，晶粒由于在正方形中有n个所以晶粒全部所占的面积为n×π(d/2) ，
2 2 2
由于正方形的面积＝晶粒全部所占的面积，从而L＝n×π(d/2) 。若将其用d表示，则由d＝
1/2
2L/n/(π) 的关系式表示。利用该关系式，在观察区域L×L划直线(图8的单点划线)，将与
该直线相交的晶界的数量设为晶体的数量n，求出了镀金30X及金属凸点30Y的水平方向及
高度方向的平均晶粒径d。

[0149] 该情况下，水平方向是平行于覆盖电极12d及13d的上表面的方向，高度方向是垂直于覆盖电极12d及13d的上表面的方向。另外，图8中，单点划线的直线与6个晶界相交，所
以n＝6。

[0150] 本实施方式中，具有晶粒径不同的第一层30a及第二层30b的金属凸点30Y的剖面是图7B所示的剖面。在该情况下，通过上述方法测定了金属凸点30Y的晶粒径，关于水平方
向的平均晶粒径，第一层30a是8μm，第二层30b是1μm。此外，关于高度方向的平均晶粒径，第
一层30a是3μm，第二层30b是2μm。

[0151] 这里，关于镀金膜的平均晶粒径与单层镀金膜的硬度的关系进行了实验，关于该实验结果，利用图9来说明。图9是表示镀金膜的平均晶粒径与单层镀金膜的硬度的关系的
图。

[0152] 该实验中，利用电镀液温度为50℃的非氰类镀金液，将析出速度设定为0.5μm/min，制作了厚度为10μm的单层镀金膜。对该单层镀金膜通过变更热处理条件而控制平均晶
粒径，研究了热处理后的镀金膜的平均晶粒径与热处理前的单层镀金膜的硬度的关系。关
于热处理后的镀金膜的平均晶粒径，利用上述的晶粒径的测定方法进行了测定。该情况下，
测定了水平方向的平均晶粒径。此外，关于热处理前的单层镀金膜的硬度，进行了维氏硬度
的硬度测定。另外，在以后的说明中，只要无特别声明，平均晶粒径就是指水平方向的平均
晶粒径。

[0153] 如图9所示，可知镀金膜的平均晶粒径与单层镀金膜的硬度具有负相关。即，随着构成镀金膜的晶体的平均晶粒径变小而硬度变高。相反，随着构成镀金膜的晶体的平均晶
粒径变大而硬度变低。这样，镀金膜的硬度随着镀金膜的平均晶粒径变大而降低，随着镀金
膜的平均晶粒径变小而变高。

[0154] 例如，如图9所示，在构成镀金膜的晶体的平均晶粒径是8μm的情况下，镀金膜的硬度为约0.8GPa。即，在以上述的热处理条件形成的金属凸点30Y中，平均晶粒径为8μm的第一
层30a的硬度为约0.8GPa。

[0155] 此外，在构成镀金膜的晶体的平均晶粒径为1μm的情况下，镀金膜的硬度为约1.9GPa。即，在以上述的热处理条件形成的金属凸点30Y中，平均晶粒径为1μm的第二层30b
的硬度为约1.9GPa。

[0156] 这样，将平均晶粒径进行比较，晶粒径大的膜成为较软的层，晶粒径小的膜成为较硬的层。即，平均晶粒径为8μm的镀金膜(第一层30a)是比平均晶粒径为1μm的镀金膜(第二
层30b)软的膜。

[0157] [第四工序(将半导体元件向安装衬底安装的工序)]

[0158] 接着，通过图6A～图6B所示的流程，经由金属凸点30Y将半导体元件10向安装衬底20通过倒装芯片键合而安装。图6A～图6B是表示经由金属凸点30Y将半导体元件10向安装
衬底20安装的流程的图。

[0159] 首先，准备用于安装半导体元件10的安装衬底20。具体而言，作为安装衬底20，准备了作为第二电极E2而形成了第二p侧电极22及第二n侧电极23的衬底21。本实施方式中，
衬底21是由AlN的烧结体构成的陶瓷衬底。此外，第二p侧电极22及第二n侧电极23是镀金
膜，利用非氰类镀金液形成。另外，虽未图示，但在第二p侧电极22及第二n侧电极23的各自
与衬底21之间，可以形成有被第二p侧电极22和第二n侧电极23分离了的种子层。

[0160] 并且，如图6A所示，准备预先形成了金属凸点30Y的半导体元件10，使金属凸点30Y侧朝向安装衬底20而使半导体元件10真空吸附于安装机的保持用金属管40。另外，本实施
方式中，利用了800μm见方×100μm厚的半导体元件10。

[0161] 接着，如图6B所示，一边使半导体元件10的金属凸点30Y与安装衬底20的第二电极E2(第二p侧电极22、第二n侧电极23)接触一边加热到200℃左右，一边通过保持用金属管40
对于安装衬底20在垂直方向(图中的箭头X的朝向：第一方向)上施加30N的载荷，一边对于
安装衬底20在水平方向(图中的箭头Y的朝向：第二方向)上施加200ms超声波振动，从而使
金属凸点30Y与安装衬底20的第二电极E2(第二p侧电极22、第二n侧电极23)超声波接合。

[0162] 这里，关于通过超声波接合将金属凸点30Y与安装衬底20的第二电极接合时在金属凸点30Y中发生的变化，利用图10及图11A～图11E详细说明。

[0163] 图10是在实施方式1中将半导体元件10向安装衬底20安装时的接合处理的时序图。图10中，横轴表示时间，纵轴表示载荷。另外，在横轴中，0ms之前的负的时间表示处理开
始前，0ms表示处理开始时。

[0164] 如图10所示，在从开始半导体元件10与安装衬底20的接合处理起100ms的期间(步骤1)中，使载荷逐渐增加。该步骤1中，不施加超声波，仅施加载荷。此外，在100ms～400ms之
间(步骤2)，使载荷保持固定并施加超声波。通过进行这样的时序图所示的接合处理，经由
金属凸点30Y将半导体元件10与安装衬底20超声波接合。

[0165] 该情况下，分别在图11A～图11E中表示开始半导体元件10与安装衬底20的接合处理前的时点以及从开始接合处理起0ms、100ms、300ms、400ms的各时点的半导体元件10与安
装衬底20的接合部分，具体而言是相邻的2个金属凸点30Y与安装衬底20的第二电极的接合
部分的剖面。另外，图11A～图11E中，仅图示了安装衬底20中的第二电极E2的第二p侧电极
22上的接合部，关于第二电极E2的第二n侧电极23上的接合部也是同样的。

[0166] 图11A示出了进行半导体元件10与安装衬底20的接合处理前的金属凸点30Y与安装衬底20的第二电极E2的状态。如图11A所示，构成各金属凸点30Y的第一层30a和第二层
30b的金(Au)的晶粒在各层内维持大致相同的粒径。另外，各金属凸点30Y为彼此相同的四
棱柱形状。

[0167] 图11B示出了半导体元件10与安装衬底20的接合处理的处理开始时(0ms)的金属凸点30Y与安装衬底20的第二电极E2的状态。具体而言，图11B示出了使形成于半导体元件
10的金属凸点30Y的前端面与安装衬底20的第二电极E2接触时的状态。如图11B所示，在处
理开始时(0ms)，与图11A同样，各金属凸点30Y在第一层30a及第二层30b中分别维持大致相
同的粒径。

[0168] 并且，在使形成于半导体元件10的多个金属凸点30Y与安装衬底20的第二电极E2接触后，进行图10的步骤1的处理。具体而言，步骤1中，对于夹着多个金属凸点30Y的半导体
元件10及安装衬底20，从垂直于安装衬底20的主面的方向施加载荷(安装载荷)。

[0169] 如图10所示，步骤1中，使载荷逐渐增大。由此，随着施加载荷，与第二层30b相比相对软的第一层30a整体被压溃而横向扩展。此时，与第一层30a相比相对硬的第二层30b不被
压溃，大致维持处理开始前的形状。结果，如图11C所示，各金属凸点30Y成为第一层30a横向
扩展了的大致酒杯形状。另外，安装衬底20的第二电极(第二p侧电极22、第二n侧电极23)的
表面形状也维持处理开始前的形状。

[0170] 此外，如图11C所示，各金属凸点30Y的第一层30a整体被压溃而横向扩展，从而相邻的金属凸点30Y彼此接触。具体而言，相邻的金属凸点30Y的第一层30a彼此接触。另外，相
邻的金属凸点30Y的第二层30b彼此没有接触。

[0171] 图11C示出了图10中的步骤1和步骤2切换时(从处理开始起约100ms后)的金属凸点30Y与安装衬底20的第二电极E2的接合状态。另外，本实施方式中，在步骤1中，在100ms的
期间使载荷从载荷0N到载荷30N以一次函数的形式增加，但不限于此。

[0172] 并且，在相邻的金属凸点30Y彼此接触后，如图10所示，从步骤1向步骤2切换。步骤2中，如图11D所示，对夹着金属凸点30Y的半导体元件10及安装衬底20，在垂直于安装衬底
20的主面的方向(图中的箭头X的方向)上施加固定的载荷，并且对于安装衬底20的主面在
水平方向(图中的箭头Y的方向)上施加超声波。本实施方式中，对夹着多个金属凸点30Y的
半导体元件10及安装衬底20，在持续施加了与步骤1中的最终载荷相同的载荷的状态下施
加超声波振动。

[0173] 另外，图11D示出了图10中的步骤2的中途过程(从处理开始起约300ms后，从超声波振动开始起200ms后)的金属凸点30Y与安装衬底20的第二电极E2的接合状态。

[0174] 通过这样一边施加载荷一边施加超声波，相对于安装衬底20在水平方向上金属凸点30Y振动，金属凸点30Y的第二层30b与安装衬底20的第二电极E2相接的界面通过摩擦而
被加热，金属凸点30Y与安装衬底20的第二电极E2固相接合而一体化。具体而言，通过施加
载荷的超声波振动，金属凸点30Y擦碰到第二电极E2，由此，金属凸点30Y与第二电极E2的界
面部分再结晶化。此时，有如下情况，即，第二电极E2的表面层的Au晶粒和金属凸点30Y的第
二层30b的Au晶粒的一部分不维持原来的形状而一体化，金属凸点30Y的第二层30b与第二
电极E2的边界变得不再是明确的边界。

[0175] 并且，之后，通过继续载荷的施加和超声波的施加，各金属凸点30Y与第二电极E2的界面部分的再结晶化了的部分变软。因此，若通过载荷将半导体元件10压下，则各金属凸
点30Y的第二层30b中的与第二电极E2的界面部分被压溃而横向扩展。结果，如图11E所示，
各金属凸点30Y成为第一层30a整体横向扩展并且第二层30b的与第二电极E2的接合部分横
向扩展的大致沙漏形状。即，各金属凸点30Y成为中央部分的整周凹陷的中间细的形状。

[0176] 此外，如图11E所示，金属凸点30Y的第二层30b与第二电极E2的界面部分的再结晶化了的部分被压溃而横向扩展，从而相邻的金属凸点30Y彼此不仅在第一层30a接触而且在
第二层30b的一部分中也接触。具体而言，相邻的金属凸点30Y不仅是第一层30a整体彼此接
触，而且第二层30b中的与第二电极E2的接合部分彼此也接触。

[0177] 图11E示出了图10中的步骤2的结束时点(从处理开始起约400ms后，从超声波振动开始起300ms后)的金属凸点30Y与安装衬底20的第二电极E2的接合状态。

[0178] 这样，通过持续进行载荷的施加与超声波的施加，在金属凸点30Y的第二层30b与安装衬底20的第二电极E2的接合界面处，来自第二层30b的Au晶粒和来自第二电极E2的Au
晶粒一体化。并且，如图11E所示，在金属凸点30Y的第二层30b的一部分，第二层30b与第二
电极E2的Au晶粒彼此一体化，作为Au晶粒粗大化了的层而形成第三层30c。

[0179] 结果，形成第一层30a及第三层30c比第二层30b宽度(径)大的金属凸点30Y，并且相邻的金属凸点30Y的第一层30a彼此及第三层30c彼此被连接。由此，在半导体元件10与安
装衬底20之间形成的多个金属凸点30Y成为中央部分不被连结而仅上下部分被连结、具有
中空的间隙33的接合金属层30。

[0180] 基于以上，如图6B所示，能够制作半导体元件10的第一电极E1与安装衬底20的第二电极E2被接合金属层30接合的半导体装置1。这样，半导体装置1中的接合金属层30是多
个金属凸点30Y被压溃而成为一体的金属层。具体而言，如图11E所示，接合金属层30通过金
属凸点30Y的第一层30a彼此及第三层30c彼此连结而形成。此外，接合金属层30的内部的间
隙33是金属凸点30Y的第二层30b不连结从而形成的中空区域。

[0181] [作用效果等]

[0182] 接着，关于本实施方式的半导体装置1的作用效果，与以往的半导体装置100相比较而进行说明。图12是表示专利文献1所公开的以往的半导体装置100的制造方法的剖面
图。图13是表示实施方式1的半导体装置1的安装前后的结构的图。图13中，(a)示出了将半
导体元件10向安装衬底20安装前的剖面图，(b)示出了将半导体元件10向安装衬底20安装
后的剖面图。

[0183] 如图12所示，以往的半导体装置100通过将具有半导体层叠构造11及第一电极E1的半导体元件10、和具有衬底21及第二电极E2的安装衬底20经由多个金属凸点300Y接合而
制作。具体而言，将形成有多个金属凸点300Y的半导体元件10向安装衬底20安装。

[0184] 此时，当由于安装时的载荷(安装载荷)而金属凸点300Y被压溃时，安装载荷局部集中作用于半导体元件10的第一电极E1与金属凸点300Y的接触面S1，并且安装载荷局部集
中作用于安装衬底20的第二电极E2与金属凸点300Y的接触面S2。结果，有可能由于金属凸
点300Y从而半导体元件10的第一电极E1及安装衬底20的第二电极E2分别受损，发生第一电
极E1及第二电极E2的电极不良。

[0185] 相对于此，本实施方式的半导体装置1中，如图13所示，在将形成有多个金属凸点30Y的半导体元件10向安装衬底20安装时，使内部存在间隙33而形成了接合金属层30。

[0186] 具体而言，如上述的图11A～图11E所示，当施加载荷而将半导体元件10向安装衬底20安装时，使相邻的金属凸点30Y的上下部分彼此相互接触并且残留中空的间隙33而将
多个金属凸点30Y压溃。由此，能够使分别作用于半导体元件10的第一电极E1的整面以及安
装衬底20的第二电极E2的整面的安装时的载荷均等地分散。结果，能够使安装时金属凸点
30Y对第一电极E1及第二电极E2带来的局部应力较小，从而能够降低金属凸点30Y对第一电
极E1及第二电极E2带来的损伤。

[0187] 这样，根据本实施方式的半导体装置1，能够降低第一电极E1及第二电极E2的电极不良所引起的安装损伤，从而能够实现长期可靠性良好的半导体装置1。

[0188] 此外，本实施方式的半导体装置1中，接合金属层30的内部的间隙33是线状，沿着半导体元件10的第一电极E1的外周边。

[0189] 这样，如果接合金属层30的间隙33沿着半导体元件10的第一电极E1的外周边，则可以认为成为接合金属层30的多个金属凸点30Y在安装前整齐地以矩阵状排列。并且，如果
金属凸点30Y整齐地以矩阵状排列，则与金属凸点30Y随机排列的情况相比，能够使作用于
第一电极E1及第二电极E2的各自的整面的安装时的载荷均等地分散。由此，能够减小金属
凸点30Y对第一电极E1及第二电极E2带来的局部应力，从而能够降低金属凸点30Y对第一电
极E1及第二电极E2造成的损伤。

[0190] 另外，本说明书中，间隙33沿着第一电极E1的外周边是指间隙33大致沿着第一电极E1的外周边即可，例如，即使在第一电极E1的外周边的一部分存在微小凹陷等而外周边
不完全为直线状，直线状的间隙33也可以说沿着第一电极E1的外周边。即，只要宏观上间隙
33沿着第一电极E1的外周边，就包含在间隙33沿着第一电极E1的外周边的概念中。

[0191] 此外，本实施方式的半导体装置1中，接合金属层30的内部的间隙33平行于第一电极E1的外周边。

[0192] 这样，如果接合金属层30的间隙33平行于第一电极E1的外周边，则认为在安装前相同宽度的金属凸点30Y整齐地以矩阵状排列。并且，如果相同宽度的金属凸点30Y整齐地
以矩阵状排列，则与不同宽度的金属凸点30Y排列的情况相比，能够使作用于第一电极E1及
第二电极E2的各自的整面的安装时的载荷均等地分散。由此，能够减小金属凸点30Y对第一
电极E1及第二电极E2带来的局部应力，所以能够降低金属凸点30Y对第一电极E1及第二电
极E2带来的损伤。

[0193] 此外，本实施方式的半导体装置1中，接合金属层30的内部的间隙33的高度H是接合金属层30的高度的10％以上。

[0194] 这样，通过使间隙33的高度为接合金属层30的高度的10％以上，能够在某种程度上维持间隙33的大小。由此，能够使安装时的载荷有效地分散，从而能够有效减小金属凸点
30Y对第一电极E1及第二电极E2带来的局部应力。

[0195] 这里，关于接合金属层30的间隙33的其他形状，利用图14A～图14O进行说明。图14A～图14O是表示图13的M剖面中的剖面的一部分的剖面图。

[0196] 如图2B所示，在上述实施方式1中，接合金属层30的内部的间隙33由连续的空隙构成，但不限于此。

[0197] 例如，如图14A所示，接合金属层30的内部的间隙33A也可以由点(dot)状的多个空隙33a构成。具体而言，间隙33A可以包含由沿第一方向(例如行方向)以线状排列的多个空
隙33a构成的第一方向空隙L1。图14A中，第一方向空隙L1由以直线状排列的多个空隙33a构
成。该情况下，如图14B所示，构成间隙33B的多个空隙33a可以是互不相同的形状。例如，多
个空隙33a可以不连续，多个空隙33a的各自可以局部为线状、点状。

[0198] 另外，在图14A及图14B中，第一方向空隙L1中的间隙33A及33B是线状，沿着第一电极E1的外周边。具体而言，间隙33A及33B是虚线状，与第一电极E1的一个外周边平行。

[0199] 此外，如图14C所示，接合金属层30的内部的间隙33C可以具有由连续的1条空隙构成的第一方向空隙L1。另外，图14C中，间隙33C也是线状，沿着第一电极E1的外周边。具体而
言，第一方向空隙L1中的间隙33C是直线状，与第一电极E1的一个外周边平行。此外，间隙
33C的端部可以从第一电极E1的外周边露出。

[0200] 此外，上述实施方式1中，接合金属层30的内部的间隙33由正交的两条直线状的空隙构成，但不限于此。例如，如图14D所示，接合金属层30的内部的间隙33D可以由正交的两
条以上的直线状的空隙构成。具体而言，间隙33D可以包括由沿第一方向形成的线状的空隙
构成的第一方向空隙L1、和由沿不同于第一方向的第二方向(例如列方向)形成的线状的空
隙构成的第二方向空隙L2。图14D中，第一方向空隙L1是沿第一方向形成的直线状的空隙，
第二方向空隙L2是沿正交于第一方向的第二方向形成的直线状的空隙。

[0201] 此外，图14D中，间隙33D也是线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33D是直线状，与第一电极E1的一个外周边平行。此外，第二方向空隙L2中
的间隙33D是直线状，与第一电极E1的另一个外周边平行。

[0202] 进而，图14D中，间隙33D以一定间隔存在多个列。具体而言，第一方向空隙L1中的间隙33D以一定间隔存在多个列。此外，第二方向空隙L2中的间隙33D也以一定间隔存在多
个列。

[0203] 另外，图14D中，第一方向空隙L1的第一方向和第二方向空隙L2的第二方向正交，但不限于此。第一方向和第二方向交叉即可。该情况下，构成第一方向空隙L1的多条直线状
的空隙以及构成第二方向空隙L2的多条直线状的空隙不需要分别全部在相同方向上一致
(即平行)，也可以在多个直线状的空隙的一部分中存在沿不同方向延伸的空隙。

[0204] 此外，图14D中，间隙33D由沿着第一方向及第二方向的各自形成的多条空隙构成，但不限于此。例如，也可以如图14E所示，间隙33E由仅沿第一方向及第二方向的一方形成的
多条空隙构成。

[0205] 此外，与图14C同样地，间隙33D的端部可以从第一电极E1的外周边露出。可以是全部的间隙33D的端部从第一电极E1的外周边露出，也可以是一部分间隙33D的端部从第一电
极E1的外周边露出。

[0206] 图14E中，间隙33E仅通过由在第一方向上延伸的直线状的空隙构成的第一方向空隙L1构成。该情况下，可以如图14E所示，在间隙33E的一部分中包含宽度与直线部不同的多
个空隙33a。即，在直线状的空隙的一部分中可以存在宽度不同的部分。

[0207] 另外，图14E中，间隙33E也是线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33E是直线状，与第一电极E1的一个外周边平行。进而，在图14E中，间隙33E
也以一定间隔存在多个列。具体而言，第一方向空隙L1中的间隙33E以一定间隔存在多个
列。此外，与图14D同样，间隙33D的端部可以从第一电极E1的外周边露出。可以是全部的间
隙33D的端部从第一电极E1的外周边露出，也可以是一部分间隙33D的端部从第一电极E1的
外周边露出。

[0208] 此外，图14D及图14E中，间隙33D及33E由直线状的空隙的组合构成，但不限于此。例如，也可以如图14F所示，间隙33F由以点状排列的多个空隙33a构成。具体而言，间隙33F
可以包含由沿第一方向以线状排列的多个空隙33a构成的第一方向空隙L1、和由沿正交于
第一方向的第二方向以线状排列的多个空隙33a构成的第二方向空隙L2。图14F中，第一方
向空隙L1及第二方向空隙L2分别由以直线状排列的多个空隙33a构成。

[0209] 另外，图14F中，间隙33F也为线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33F是直线状，与第一电极E1的一个外周边平行。此外，第二方向空隙L2中
的间隙33F是直线状，与第一电极E1的另一个外周边平行。进而，图14F中，间隙33F也以一定
间隔存在多个列。具体而言，第一方向空隙L1中的间隙33F以一定间隔存在多个列。此外，第
二方向空隙L2中的间隙33F也以一定间隔存在多个列。

[0210] 此外，在图14F所示的间隙33F中，多个列的第一方向空隙L1和多个列的第二方向空隙L2都以一定间隔存在，但不限于此，也可以如图14G所示的间隙33G那样，仅多个列的第
一方向空隙L1及多个列的第二方向空隙L2的某一方以一定间隔存在。另外，在图14G所示的
间隙33G中，仅多个列的第一方向空隙L1以一定间隔存在。

[0211] 此外，如图14F所示，构成间隙33F的多个空隙33a均为点状，但不限于此，也可以如图14H所示，构成间隙33H的多个空隙33a是互不相同的形状。例如，多个空隙33a可以不连
续，多个空隙33a分别可以局部地为线状、点状。

[0212] 此外，如图2B所示，上述实施方式1中的接合金属层30分别通过将四棱柱形状的多个金属凸点30Y压溃并一体化而构成，但不限于此。

[0213] 例如，如图14I～图14M所示，接合金属层30分别可以通过将圆柱形状的多个金属凸点30Y压溃并一体化而构成。具体而言，图14I～图14K中的接合金属层30分别通过将圆柱
形状且以格子状排列的多个金属凸点30Y压溃而构成。作为一例，圆柱形状的金属凸点30Y
由俯视形状为直径25μm的圆形、高度为8μm的镀金膜构成。

[0214] 该情况下，如图14I所示，间隙33I可以包括由正交的两条直线构成的格子状的空隙。另外，图14I中，间隙33I也为线状，沿着第一电极E1的外周边。具体而言，第一方向空隙
L1中的间隙33I是直线状，与第一电极E1的一个外周边平行。此外，第二方向空隙L2中的间
隙33I是直线状，与第一电极E1的另一个外周边平行。

[0215] 此外，如图14J所示，间隙33J可以由多条空隙构成。另外，图14J中，间隙33J也为线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33I为直线状，与第一电
极E1的一个外周边平行。此外，第二方向空隙L2中的间隙33J是多个点状的空隙，与第一电
极E1的另一个外周边平行。

[0216] 此外，如图14K所示，间隙33K可以由以矩阵状排列的多个点状的空隙33a构成。另外，图14K中，间隙33K也是线状，沿着第一电极E1的外周边。具体而言，图14K中，第一方向空
隙L1及第二方向空隙L2由以虚线状排列的多个空隙33a构成。此外，第一方向空隙L1中的间
隙33K与第一电极E1的一个外周边平行，第二方向空隙L2中的间隙33K与第一电极E1的另一
个外周边平行。

[0217] 此外，也可以如图14L及图14M所示，接合金属层30通过将分别以圆柱形状呈交错状排列的多个金属凸点30Y压溃并一体化而构成。

[0218] 该情况下，如图14L所示，间隙33L可以由交错格子状的空隙构成。另外，图14L中，间隙33L也是线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33L是直
线状，与第一电极E1的一个外周边平行。此外，第二方向空隙L2中的间隙33L是虚线状，与第
一电极E1的另一个外周边平行。

[0219] 此外，也可以如图14M所示，间隙33M由以矩阵状排列的多个点状的空隙33a构成。另外，图14M中，间隙33M也是线状，沿着第一电极E1的外周边。具体而言，图14M中，第一方向
空隙L1及第二方向空隙L2由以虚线状排列的多个空隙33a构成。此外，第一方向空隙L1中的
间隙33M与第一电极E1的一个外周边平行，第二方向空隙L2中的间隙33M与第一电极E1的另
一个外周边平行。

[0220] 此外，图14I～图14M中，接合金属层30通过将分别为圆柱形状的多个金属凸点30Y压溃而构成，但不限于此。

[0221] 例如，如图14N及图14O所示，接合金属层30可以通过将分别为六棱柱形状的多个金属凸点30Y压溃并一体化而构成。具体而言，图14N及图14O中的接合金属层30通过将分别
为六棱柱形状且以交错状排列的多个金属凸点30Y压溃并一体化而构成。

[0222] 该情况下，可以如图14N所示，间隙33N由交错格子状的空隙构成。另外，图14N中，间隙33N也为线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1中的间隙33N是虚
线状，与第一电极E1的一个外周边平行。

[0223] 此外，也可以如图14O所示，间隙33O由多个点状的空隙33a构成。另外，图14O中，间隙33O也为线状，沿着第一电极E1的外周边。具体而言，第一方向空隙L1由以虚线状排列的
多个空隙33a构成。此外，第一方向空隙L1中的间隙33O与第一电极E1的一个外周边平行。

[0224] 另外，在图14I～图14O中，间隙33I～间隙33O也以一定间隔存在多个列。具体而言，第一方向空隙L1及第二方向空隙L2的至少一方中的间隙33I～间隙33O以一定间隔存在
多个列。

[0225] 这样，如图14D～图14O所示，如果间隙33D～间隙33O相对于第一电极E1的外周边平行并且以一定间隔存在多个列，则认为相同形状的金属凸点30Y整齐地以重复图案排列。
并且，如果相同形状的金属凸点30Y整齐地以重复图案排列，则与不同形状的金属凸点30Y
排列的情况相比，能够使作用于第一电极E1及第二电极E2各自的整面的安装时的载荷均等
地分散。由此，能够减小金属凸点30Y作用于第一电极E1及第二电极E2的局部应力，从而能
够降低金属凸点30Y对第一电极E1及第二电极E2带来的损伤。

[0226] 以上，根据本实施方式的半导体装置1，在应用对于厚度及接合面积而言设计自由度高的镀覆凸点技术等情况下，当通过倒装芯片键合将半导体元件10向安装衬底20安装
时，能够减轻对半导体元件10的第一电极E1及安装衬底20的第二电极E2带来的损伤。由此，
能够降低将半导体元件10向安装衬底20安装时第一电极E1及第二电极E2损伤、剥离这样的
电极不良等安装损伤。因而，能够得到长期可靠性良好的半导体装置1。

[0227] 另外，这样长期可靠性优良的半导体装置1作为小型化、大电流化、集成化的车载用途的光源是优选的。

[0228] (实施方式2)

[0229] 接着，关于实施方式2的半导体装置2，利用图15进行说明。图15是表示实施方式2的半导体装置2的安装前后的结构的剖面图。图15中，(a)表示将半导体元件10向安装衬底
20安装前的剖面图，(b)表示将半导体元件10向安装衬底20安装后的剖面图。此外，在图15
的(a)及(b)中，左图是右图的X－X线的剖面图。

[0230] 如图2B所示，在上述实施方式1的半导体装置1中，半导体元件10的第一电极E1的外周边仅由直线构成，而如图15所示，在本实施方式的半导体装置2中，半导体元件10的第
一电极E1的外周边在至少一部分具有曲线部。

[0231] 具体而言，本实施方式的半导体装置2中，在第一p侧电极12的4个角部的外周边设有圆弧状的曲线部，此外，在岛状的4个第一n侧电极13的第一p侧电极12侧的外周边设有圆
弧状的曲线部。

[0232] 这样，第一电极E1的外周边曲线性地弯曲，从而与第一电极E1直角地弯曲的情况相比，能够使电场集中较小。由此，能够抑制电流的集中。

[0233] 此外，本实施方式的半导体装置2中，与上述实施方式1的半导体装置1同样地，在将形成有多个金属凸点30Y的半导体元件10向安装衬底20安装时，通过将多个金属凸点30Y
压溃而使其一体化，形成在内部存在间隙33的接合金属层30。

[0234] 由此，能够使作用于半导体元件10的第一电极E1及安装衬底20的第二电极E2的安装时的载荷均等地分散，从而能够减小安装时金属凸点30Y对第一电极E1及第二电极E2带
来的局部应力。结果，能够降低金属凸点30Y对第一电极E1及第二电极E2带来的损伤。因而，
根据本实施方式的半导体装置2，也能够降低由第一电极E1及第二电极E2的电极不良带来
的安装损伤，能够实现长期可靠性良好的半导体装置2。

[0235] 此外，通过本实施方式中的间隙33的图案，能够使散热性提高。关于这一点，以下用图16说明。图16是图15的(b)的M剖面的放大图。

[0236] 如图16所示，根据本实施方式的半导体装置2，在平面视图中，关于间隙33所占的面积的比例，距第一p侧电极12和第一n侧电极13相对置的p－n电极对置部PN较近的区域比
距p－n电极对置部PN较远的区域小。距p－n电极对置部PN较近的区域在本实施方式中是距
p－n电极对置部PN的距离D为50μm以上100μm以下的区域。

[0237] 在p－n电极对置部PN，发热量最大，以p－n电极对置部PN为基准距p－n电极对置部PN的距离D为50μm以上100μm以下的区域成为发热集中区域。

[0238] 这里，使距p－n电极对置部PN较近的区域的间隙33的面积比例较小是指成为发热集中区域的距p－n电极对置部PN较近的区域中存在的金属凸点30Y的尺寸较大，热传导变
大。

[0239] 因而，距p－n电极对置部PN较近的区域相比于距p－n电极对置部PN较远的区域而言，间隙33所占的面积的比例变小，从而能够得到散热性良好的半导体装置2。

[0240] 另外，本实施方式中，接合金属层30的内部的间隙33由直线状的空隙的组合构成，但不限于此。例如，如图17所示，间隙33也可以由以点状排列的多个空隙33a构成。图17所示
的间隙33相比于形成图16所示的间隙33时通过更大地破坏金属凸点30Y而形成。即，安装前
即使相邻的金属凸点30Y的间隙为线状，在有意地较大地破坏了金属凸点30Y的情况下或最
终过于破坏的情况下，间隙33有不是形成为线状而是形成为点状的情况。

[0241] 此外，本实施方式中，第一电极E1的第一n侧电极13以岛状形成了4个，但不限于此。例如，可以如图18所示，第一n侧电极13以将第一p侧电极12整体包围的方式遍及半导体
元件10的电极形成面的整周而设置。另外，这样的图案的第一n侧电极13可以适用于其他实
施方式。

[0242] (实施方式2的变形例)

[0243] 接着，利用图19说明实施方式2的变形例的半导体装置2A。图19是实施方式2的变形例的半导体装置2A的安装前后的剖面图。图19中，(a)表示将半导体元件10向安装衬底20
安装前的剖面图，(b)表示将半导体元件10向安装衬底20安装后的剖面图。此外，图19的(a)
及(b)中，左图是右图的X－X线的剖面图。

[0244] 如图19所示，根据本变形例的半导体装置2A，与图15所示的半导体装置2同样地，半导体元件10的第一电极E1的外周边在至少一部分具有曲线部。

[0245] 并且，根据本变形例的半导体装置2A，在接合金属层30的平面视图中，接合金属层30的内部的间隙33为线状，沿着第一电极E1的外周边。具体而言，间隙33为圆弧状的曲线
状，沿着在第一p侧电极12的角部的外周边设置的曲线部。

[0246] 这样，可以认为，如果接合金属层30的间隙33沿着半导体元件10的第一电极E1的外周边，则成为接合金属层30的多个金属凸点30Y在安装前整齐地排列。如果金属凸点30Y
整齐地排列，则与金属凸点30Y随机排列的情况相比，能够使作用于第一电极E1及第二电极
E2的各自的整面的安装时的载荷均等地分散。由此，能够减小金属凸点30Y对第一电极E1及
第二电极E2带来的局部应力，所以能够降低金属凸点30Y对第一电极E1及第二电极E2带来
的损伤。因而，能够实现长期可靠性良好的半导体装置2A。

[0247] (实施方式3)

[0248] 接着，利用图20说明实施方式3的半导体装置3。图20是表示实施方式3的半导体装置3的安装前后的结构的剖面图。图20中，(a)表示将半导体元件10向安装衬底20安装前的
剖面图，(b)表示将半导体元件10向安装衬底20安装的后的剖面图。此外，在图20的(a)及
(b)中，左图是右图的X－X线的剖面图。

[0249] 本实施方式的半导体装置3，与上述实施方式2的半导体装置2相比，接合金属层30的内部的间隙33的平面形状不同。具体而言，根据本实施方式的半导体装置3，在接合金属
层30的平面视图中，间隙33的至少一部分成为放射状。

[0250] 具体而言，如图20的M剖面所示，间隙33由从第一电极E1的第一p侧电极12的一边的中央部朝向相反侧的一边以放射状延伸的多个直线状的空隙构成。

[0251] 以上，根据本实施方式的半导体装置3，与上述实施方式2的半导体装置2同样地，在将形成有多个金属凸点30Y的半导体元件10向安装衬底20安装时，以将多个金属凸点30Y
破坏而在内部存在间隙33的方式形成接合金属层30。由此，能够降低第一电极E1及第二电
极E2的电极不良所引起的安装损伤，从而能够实现长期可靠性良好的半导体装置3。

[0252] 此外，根据本实施方式的半导体装置3，间隙33的至少一部分为放射状。由此，在将半导体装置3整体用树脂密封时，能够容易地使树脂填充于间隙33。即，可以如图21所示的
半导体装置3A那样，在间隙33的至少一部分填充有树脂34。

[0253] 具体而言，间隙33由放射状的空隙构成，从而在将半导体元件10向安装衬底20安装后在半导体装置3的周围滴落液状的树脂34而在半导体元件10与安装衬底20之间填充树
脂34时，滴落的树脂34以放射状的多条空隙的一端所集中的一点为中心而向间隙33的内部
以放射状浸透。由此，能够使树脂34的浸透距离最短从而能够降低树脂34向间隙33的漏填
充，如图21所示的半导体装置3A那样，能够使树脂34容易地填充到构成间隙33的全部空隙
中。另外，在滴落液状的树脂34后，例如以150℃进行1小时加热，从而能够使树脂34热硬化。

[0254] 向间隙33填充的树脂34是比空气热传导率高的树脂即可。例如，作为树脂34，能够使用硅酮树脂。此外，在树脂34中，可以分散有热传导性高的微粒、具有光反射性的微粒。例
如，作为热传导性高并具有光反射性的微粒，能够采用氧化钛(TiO2)等的微粒。

[0255] 这样，通过向间隙33填充树脂34，能够提高半导体装置3的散热性。由此，能够进一步实现长期可靠性良好的半导体装置3。

[0256] 另外，在图20及图21中，间隙33由从第一p侧电极12的一边的中央部以放射状延伸的多个直线状的空隙构成，但不限于此。

[0257] 例如，可以如图22所示那样，间隙33由从第一p侧电极12的中心部向全方位以放射状延伸的多个直线状的空隙构成。此外，关于图22所示的间隙33的图案，与图15所示的半导
体装置2同样地，距p－n电极对置部PN较近的区域相比于距p－n电极对置部PN较远的区域
而言间隙33所占的面积的比例变小。由此，能够提高散热性，从而能够进一步实现长期可靠
性良好的半导体装置3。

[0258] 此外，也可以如图23所示，间隙33具有从以放射状延伸的多条空隙的一部分以枝状分支的空隙，以放射状延伸的多条空隙的一部分或全部可以构成为曲线状。

[0259] (变形例)

[0260] 以上，关于本发明的半导体装置，基于实施方式1～3进行了说明，但本发明不限于上述各实施方式。

[0261] 例如，在上述各实施方式中，在半导体元件10的第一电极E1中，第一p侧电极12相比于第一n侧电极13而言电极面积较大，但不限于此。即，可以是，第一n侧电极13相比于第
一p侧电极12而言电极面积较大。但是，在半导体元件10是LED芯片的情况下，p侧容易比n侧
高温，所以可以使第一p侧电极12的电极面积大于第一n侧电极13的电极面积。

[0262] 此外，在上述的各实施方式中，在接合金属层30的内部形成的间隙33仅存在于第一接合金属层31及第二接合金属层32中的第一接合金属层31，但不限于此。例如，间隙33也
可以存在于第一接合金属层31及第二接合金属层32双方，也可以仅存在于第一接合金属层
31及第二接合金属层32中的第二接合金属层32。该情况下，关于用于形成间隙33的多个金
属凸点30Y，不限于如上述的各实施方式那样仅p侧由多个金属凸点30Y构成的情况，也可以
n侧及p侧双方由多个金属凸点30Y构成，也可以仅n侧由多个金属凸点30Y构成。

[0263] 此外，在上述的各实施方式中，间隙33及33A～33O的形状、个数没有特别限定。此外，关于间隙33及33A～33O的上下位置也没有特别限定。例如，在间隙在平面视图中由以点
状排列的多个空隙构成的情况下，各部位的空隙可以在接合金属层30的厚度方向上层叠多
个而存在。

[0264] 此外，在上述的各实施方式中，作为半导体元件10，例示了LED芯片，但不限于此，也可以是激光元件等其他固体发光元件。此外，半导体元件10不限于发光元件。例如可以是
GaN、SiC等的化合物场效应晶体管等功率半导体元件。

[0265] 另外，对上述的各实施方式实施本领域技术人员想到的各种变形而得到的形态、在不脱离本发明的主旨的范围内将各实施方式中的构成要素及功能任意组合而实现的形
态也包含于本发明。

[0266] 本发明的半导体装置对于长期可靠性良好、车载用途等的各种设备是有用的。

[0267] 附图标记说明

[0268] 1，2，2A，3，3A 半导体装置

[0269] 10 半导体元件

[0270] 11 半导体层叠构造

[0271] 11a 衬底

[0272] 11b n型半导体层

[0273] 11c 有源层

[0274] 11d p型半导体层

[0275] 12 第一p侧电极

[0276] 12a 反射电极

[0277] 12b，13b 阻挡电极

[0278] 12c，13c 种子层

[0279] 12d，13d 覆盖电极

[0280] 12S 种子膜

[0281] 13 第一n侧电极

[0282] 13a 欧姆接触层

[0283] 14 氧化膜

[0284] 15，16 抗蚀剂

[0285] 16a 开口部

[0286] 20 安装衬底

[0287] 21 衬底

[0288] 22 第二p侧电极

[0289] 23 第二n侧电极

[0290] 30 接合金属层

[0291] 30a 第一层

[0292] 30b 第二层

[0293] 30c 第三层

[0294] 30X 镀金膜

[0295] 30Y 金属凸点

[0296] 31 第一接合金属层

[0297] 32 第二接合金属层

[0298] 33，33A～33O 间隙

[0299] 33a 空隙

[0300] 34 树脂

[0301] 40 保持用金属管

[0302] E1 第一电极

[0303] E2 第二电极