一种开关箱布置

摘要

本申请提供一种开关箱布置。所述开关箱布置为一种类似网格的布置，其中存在一些空闲网格位置。空闲网格位置中不设有为可配置逻辑块分配的开关箱，即所述空闲网格位置中不设有开关箱。其中，设置有开关箱的网格位置数量远远小于设置有可配置逻辑块的网格位置数量。开关箱之间以与坐标轴平行的方向连接，并且每个所述开关箱连接到至少一个对角布置的所述开关箱。本申请能够在保持良好的可路由性的同时，大大降低连接结构所需的成本。

权利要求

1.一种开关箱布置，其特征在于，所述开关箱布置为一种网格形状的布置，每个坐标方向均存在空闲网格位置，且所述空闲网格位置中不设有为可配置逻辑块分配的开关箱。

2.根据权利要求1所述的开关箱布置，其特征在于，所述开关箱布置还包括设置有所述开关箱的占用网格位置，所述可配置逻辑块设置于所述空闲网格位置和/或所述占用网格位置中；设置有所述开关箱的网格位置数量小于设置有所述可配置逻辑块的网格位置数量。

3.根据权利要求2所述的开关箱布置，其特征在于，设置有所述开关箱的网格位置数量是设置有所述可配置逻辑块的网格位置数量的一半。

4.根据权利要求1所述的开关箱布置，其特征在于，所述开关箱布置是棋盘式布置。

5.根据权利要求1所述的开关箱布置，其特征在于，所述开关箱之间沿与坐标轴平行的方向彼此连接，并且所述开关箱中的至少一个连接到对角布置的一个所述开关箱。

6.根据权利要求4所述的开关箱布置，其特征在于，所述开关箱布置包括至少两种不同类型或尺寸的开关箱。

7.根据权利要求6所述的开关箱布置，其特征在于，在所述棋盘式开关箱布置中，所述不同类型或尺寸的开关箱交替设置。

8.根据权利要求1所述的开关箱布置，其特征在于，所述可配置逻辑块的输出端连接到所述开关箱，以在每个坐标方向上使用输出信号。

9.根据权利要求1所述的开关箱布置，其特征在于，所述开关箱布置还包括设置有所述开关箱的占用网格位置；所述可配置逻辑块设置于每一所述空闲网格位置和所述占用网格位置中。

10.根据权利要求1所述的开关箱布置，其特征在于，所述开关箱的使用数量为所述可配置逻辑块的使用数量的30-70％。

说明书

一种开关箱布置

技术领域

[0001] 本申请涉及电路元件领域，特别是一种开关箱布置。

背景技术

[0002] 开关箱特别应用于具有可编程逻辑的集成电路中(如现场可编程门阵列(Field Programmable Gate Array，FPGA))。这些开关箱用于在逻辑块之间建立可配置的信号路径。开关箱的高效结构尤为重要，芯片面积应尽可能小，从而实现短而快的信号路径。

[0003] 参考图1，图1为相关技术中的岛式FPGA的示意图。

[0004] 在相关技术中，FPGA的典型架构是所谓的“岛式”拓扑结构。其包括三个不同的电路部分：可配置逻辑块(Configurable Logic Block，CLB)、连接盒(Connection box，CB)、以及开关箱(Switch box，SB)。

[0005] 它的特点在于，每个CLB也有开关箱。对于每个开关箱通常对应两个CB。

[0006] 例如，图1显示的是相关技术中的CLB、CB和SB的结构示意图。如图1所示，每个CLB分配有两个CB和一个SB。每一SB、CB和CLB均位于拓扑结构的结点上(即图1中的各个网格的网点上)。为简化起见，信号束仅用一条线示出。

[0007] 采用该种结构，导致电路的连接元件的成本大大超过了实际逻辑的成本。

发明内容

[0008] 本发明能够解决的技术问题是在保持良好的可路由性的同时，大大降低连接结构所需的成本。

[0009] 本发明提供一种开关箱布置，所述开关箱布置为一种网格形状的布置，每个坐标方向均存在空闲网格位置，且所述空闲网格位置中不设有为可配置逻辑块分配的开关箱。

[0010] 一些实施例中，所述开关箱布置还包括设置有所述开关箱的占用网格位置，所述可配置逻辑块设置于所述空闲网格位置和/或所述占用网格位置中；设置有所述开关箱的网格位置数量小于设置有所述可配置逻辑块的网格位置数量。

[0011] 一些实施例中，设置有所述开关箱的网格位置数量是设置有所述可配置逻辑块的网格位置数量的一半。

[0012] 一些实施例中，所述开关箱布置是棋盘式布置。

[0013] 一些实施例中，所述开关箱之间沿与坐标轴平行的方向彼此连接，并且所述开关箱中的至少一个连接到对角布置的一个所述开关箱。

[0014] 一些实施例中，所述开关箱布置包括至少两种不同类型或尺寸的开关箱。

[0015] 一些实施例中，在所述棋盘式开关箱布置中，所述不同类型或尺寸的开关箱交替设置。

[0016] 一些实施例中，所述可配置逻辑块的输出端连接到所述开关箱，以在每个坐标方向上使用输出信号。

[0017] 一些实施例中，所述开关箱布置还包括设置有所述开关箱的占用网格位置；所述可配置逻辑块设置于每一所述空闲网格位置和所述占用网格位置中。

[0018] 一些实施例中，所述开关箱的使用数量为所述可配置逻辑块的使用数量的30-70％。

附图说明

[0019] 图1为相关技术中的岛式FPGA的示意图。

[0020] 图2为本申请实施例中改变方向的X方向/Y方向连接的示意图。

[0021] 图3为本申请实施例中一种开关箱的双棋盘结构示意图。

具体实施方式

[0022] 应当注意的是，图中仅以实施例的方式公开了本发明。本发明不限于这些实施例。

[0023] 本发明能够解决的技术问题是在保持良好的可路由性的同时，大大降低连接结构所需的成本。

[0024] 在一些实施例中，开关箱布置为一种网格形状的布置，其包括占用网格位置以及空闲网格位置。其中，每一占用网格位置设置有开关箱。

[0025] 在本发明的一个实施例中，每个坐标方向上的存在上述的空闲网格位置，且所述空闲网格位置中不设有为可配置逻辑块分配的开关箱，即所述空闲网格位置中不设有开关箱。优选为每隔一段距离就存在所述的空闲网格位置。

[0026] CLB可以设置在任意网格位置，即CLB可以设置于空闲网格位置和/或占用网格位置中。在一些实施例中，每一个网格位置都设有一个CLB。换言之，每一空闲网格位置和占用网格位置均设有一个CLB。

[0027] 因此，具有SB的网格坐标数也远小于CLB的数量，从而降低成本，且可路由性不会受到负面影响。在一些实施例中，SB的使用数量为CLB的使用数量的30-70％。

[0028] 在一些实施例中，设置有SB的网格坐标的数量是设置有CLB的网格坐标的数量的一半。在一些实施例中，SB的布置以类似棋盘的方式排列，从而优化CLB的路由和可访问性。其中，每个坐标方向上，设有SB的网格位置和不设有SB的空闲网格位置交替设置。

[0029] 如图2所示，图2为本申请实施例中的改变方向的X方向/Y方向连接的示意图。图2中示出的是类似棋盘的开关箱设置。同时，还显示了X和Y方向之间的方向改变的连接。很明显，虽然不是每个方向的改变点对应的网格位置内都有SB，但是在任何方向上，任何坐标可以连接到任何其他坐标。在一些实施例中，SB间或CB间以与坐标轴平行的方向彼此连接，并且每个SB或CB可连接到至少一个对角布置的SB。

[0030] 虽然SB不会设置在每个X方向和Y方向的坐标交点上，但是在任何方向上可以实现从任何坐标到任何其他坐标的方向改变。例如，在没有设置SB的X方向和Y方向的坐标交点(即空闲网格位置)处，两个相邻的SB可以沿对角线连接以改变方向，如图2所示。

[0031] 进一步如图2所示，在一些实施例中，具体地，沿X方向或者Y方向顺次排列的相邻的两个SB或者CB可以沿平行于对应的坐标轴X方向或者Y方向的方向彼此连接/路由，如位于(x-2，y)和(x，y)的网格内的相邻两个SB沿平行于X方向的方向彼此连接，而(x，y)和(x，y+2)的网格内的相邻两个SB沿平行于Y方向的方向彼此连接。而当需要改变方向时，例如，从(x，y)网格内的SB路由至(x+1，y+1)网格内的SB时，则可沿两个网格的对角线方向连接以改变方向。

[0032] 在一些实施例中，棋盘式开关箱布置包括至少两种不同类型或尺寸的SB。相较于使用单一尺寸SB的技术方案，本实施例能够缩小芯片面积，从而进一步减少开关成本。

[0033] 在一些实施例中，不同类型或尺寸的SB交替设置。图3为一种SB的双棋盘结构示意图。图3中显示的是一种类似棋盘排列的SB，其中SB的大小不同。尺寸小的SB和尺寸大的SB交替设置，从而形成另一种棋盘结构。

[0034] 在一些实施例中，可配置逻辑块的输出端连接到SB，从而可在任何坐标方向上使用输出信号。