一种参考时钟信号注入锁相环电路及消除失调方法转让专利
申请号 : CN201911310040.5
文献号 : CN112994687B
文献日 : 2021-12-17
发明人 : 史明甫 , 冯珅 , 吴顺方 , 许俊 , 蔡新午
申请人 : 澜至科技(上海)有限公司
摘要 :
权利要求 :
1.一种参考时钟信号注入锁相环电路,其特征在于:包括第一脉冲生成器、第二脉冲生成器、状态机、脉冲选择放大电路、压控延迟线、零失配鉴相器和滤波器,用于组成一个失调消除环路、一个锁相环路、一个压控振荡环路和一个注入锁相环路;
所述失调消除环路包括所述第一脉冲生成器、所述状态机、所述零失配鉴相器和所述脉冲选择放大电路;
所述压控振荡环路包括所述第二脉冲生成器、所述脉冲选择放大电路和所述压控延迟线;
所述锁相环路包括所述第一脉冲生成器、所述第二脉冲生成器、所述零失配鉴相器、所述滤波器、所述压控延迟线和所述脉冲选择放大电路;
所述注入锁相环路包括所述脉冲选择放大电路、所述第一脉冲生成器、所述第二脉冲生成器、所述状态机、所述零失配鉴相器、所述滤波器和所述压控延迟线;
所述状态机断开所述锁相环路和所述压控振荡环路,启用所述失调消除环路以采用所述第一脉冲生成器生成的第一脉冲信号来校正所述零失配鉴相器;
所述状态机启用所述锁相环路和所述压控振荡环路,用校正后的所述零失配鉴相器来锁定所述第二脉冲生成器生成的第二脉冲信号;
所述状态机将所述锁相环路切换到所述注入锁相环路,启用所述注入锁相环路,用于注入所述第一脉冲生成器生成的第一脉冲信号。
2.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述失调消除环路采用所述第一脉冲生成器生成的第一脉冲信号来校正所述零失配鉴相器时,所述脉冲选择放大电路用于在所述状态机的控制下,将参考时钟信号分为两路输入所述零失配鉴相器。
3.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:用校正后的所述零失配鉴相器来锁定所述第二脉冲生成器生成的第二脉冲信号时,所述脉冲选择放大电路用于在所述状态机的控制下,将所述压控延迟线输出的压控信号输入至所述压控延迟线和所述零失配鉴相器,将参考时钟信号输入所述零失配鉴相器;所述滤波器用于根据所述零失配鉴相器的输出值调节所述压控延迟线输出的压控信号频率;所述状态机用于当所述零失配鉴相器输出的相差均值为零时进行锁频。
4.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:注入所述第一脉冲生成器的信号时,所述脉冲选择放大电路用于当所述状态机检测到参考时钟信号时,选取所述参考时钟信号输入所述压控延迟线,所述压控延迟线输出的压控信号和所述参考时钟信号输入所述零失配鉴相器。
5.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述脉冲选择放大电路包括第一脉冲选择放大电路和第二脉冲选择放大电路;
参考时钟信号和所述压控延迟线输出的压控信号均输入至所述第一脉冲选择放大电路和所述第二脉冲选择放大电路,所述第一脉冲选择放大电路用于输出所述压控信号或所述参考时钟信号至所述压控延迟线和所述零失配鉴相器;所述第二脉冲选择放大电路用于输出所述压控信号或所述参考时钟信号至所述零失配鉴相器;
所述状态机用于通过发送选择信号至所述第一脉冲选择放大电路和所述第二脉冲选择放大电路来实现所述参考时钟信号和所述压控信号的输出选择。
6.根据权利要求5所述的参考时钟信号注入锁相环电路,其特征在于:所述压控振荡环路包括环形连接的所述第二脉冲生成器、所述第二脉冲选择放大电路和所述压控延迟线。
7.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述第二脉冲生成器用于将所述压控延迟线输出的压控信号转换为窄脉冲信号,所述脉冲选择放大电路用于在状态机的控制下将选取所述窄脉冲信号,并脉宽放大转换为宽脉冲信号。
8.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述第一脉冲生成器用于将参考时钟信号转换为窄脉冲信号,所述脉冲选择放大电路用于用于在状态机的控制下将选取所述窄脉冲信号,并脉宽放大转换为宽脉冲信号。
9.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述零失配鉴相器包括第一数字时间转换器、第二数字时间转换器和相位检测器/时间数字转换器;所述第一数字时间转换器和所述第二数字时间转换器均与所述相位检测器/时间数字转换器相连。
10.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述状态机有锁频功能,通过所述参考时钟信号来计算所述压控延迟线输出的压控信号的频率误差,并输出所述频率误差至所述滤波器。
11.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:切换到所述注入锁相环路时,所述状态机还用于调节所述零失配鉴相器的失调‑符号控制端使得所述零失配鉴相器输出的鉴相结果信号反相。
12.根据权利要求1所述的参考时钟信号注入锁相环电路,其特征在于:所述滤波器根据所述零失配鉴相器的鉴相结果信号的均值和频率误差的均值通过所述滤波器施加的电压调节所述压控延迟线输出的压控信号的相位和频率,直至所述鉴相结果信号的均值为零并且所述频率误差的均值也为0时,所述压控信号的频率和相位被锁定,即所述锁相环路和所述压控振荡环路被锁定。
13.一种参考时钟信号注入锁相环的消除失调方法,其特征在于:应用于参考时钟信号注入锁相环电路,所述参考时钟信号注入锁相环电路包括第一脉冲生成器、第二脉冲生成器、状态机、脉冲选择放大电路、压控延迟线、零失配鉴相器和滤波器,用于组成一个失调消除环路、一个锁相环路、一个压控振荡环路和一个注入锁相环路;所述失调消除环路包括所述第一脉冲生成器、所述状态机和所述零失配鉴相器;所述压控振荡环路包括所述第二脉冲生成器、所述脉冲选择放大电路和所述压控延迟线;所述锁相环路包括所述第一脉冲生成器、所述第二脉冲生成器、所述零失配鉴相器、所述滤波器、所述压控延迟线所述脉冲选择放大电路;所述注入锁相环路包括所述脉冲选择放大电路、所述第一脉冲生成器、所述第二脉冲生成器、所述状态机、所述零失配鉴相器、所述滤波器和所述压控延迟线;
所述参考时钟信号注入锁相环的消除失调方法包括以下步骤:通过状态机断开所述锁相环路和所述压控振荡环路,启用所述失调消除环路以采用所述第一脉冲生成器生成的第一脉冲信号来校正所述零失配鉴相器;
通过状态机启用所述锁相环路和所述压控振荡环路,用校正后的所述零失配鉴相器来锁定所述第二脉冲生成器生成的第二脉冲信号;
通过状态机将所述锁相环路切换到所述注入锁相环路,启用所述注入锁相环路,用于注入所述第一脉冲生成器生成的第一脉冲信号。
14.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述失调消除环路采用所述第一脉冲生成器生成的第一脉冲信号来校正所述零失配鉴相器时,所述脉冲选择放大电路在所述状态机的控制下,将参考时钟信号分为两路输入所述零失配鉴相器。
15.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:用校正后的所述零失配鉴相器来锁定所述第二脉冲生成器生成的第二脉冲信号时,所述脉冲选择放大电路在所述状态机的控制下,将所述压控延迟线输出的压控信号输入至所述压控延迟线和所述零失配鉴相器,将参考时钟信号输入所述零失配鉴相器;所述滤波器根据所述零失配鉴相器的输出值调节所述压控延迟线输出的压控信号频率;所述状态机当所述零失配鉴相器输出的相差均值为零时进行锁频。
16.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:注入所述第一脉冲生成器的信号时,当所述状态机检测到参考时钟信号时,所述脉冲选择放大电路选取所述参考时钟信号输入所述压控延迟线,所述压控延迟线输出的压控信号和所述参考时钟信号输入所述零失配鉴相器。
17.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述脉冲选择放大电路包括第一脉冲选择放大电路和第二脉冲选择放大电路;
参考时钟信号和所述压控延迟线输出的压控信号均输入至所述第一脉冲选择放大电路和所述第二脉冲选择放大电路,所述第一脉冲选择放大电路输出所述压控信号或所述参考时钟信号至所述压控延迟线和所述零失配鉴相器;所述第二脉冲选择放大电路输出所述压控信号或所述参考时钟信号至所述零失配鉴相器;
所述状态机通过发送选择信号至所述第一脉冲选择放大电路和所述第二脉冲选择放大电路来实现所述参考时钟信号和所述压控信号的输出选择。
18.根据权利要求17所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述压控振荡环路包括环形连接的所述第二脉冲生成器、所述第二脉冲选择放大电路和所述压控延迟线。
19.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述第二脉冲生成器用于将所述压控延迟线输出的压控信号转换为窄脉冲信号,所述脉冲选择放大电路用于在状态机的控制下将选取所述窄脉冲信号,并脉宽放大转换为宽脉冲信号。
20.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述第一脉冲生成器用于将参考时钟信号转换为窄脉冲信号,所述脉冲选择放大电路用于用于在状态机的控制下将选取所述窄脉冲信号,并脉宽放大转换为宽脉冲信号。
21.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述零失配鉴相器包括第一数字时间转换器、第二数字时间转换器和相位检测器/时间数字转换器;所述第一数字时间转换器和所述第二数字时间转换器均与所述相位检测器/时间数字转换器相连。
22.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述状态机有锁频功能,通过所述参考时钟信号来计算所述压控延迟线输出的压控信号的频率误差,并输出所述频率误差至所述滤波器。
23.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:切换到所述注入锁相环路时,所述状态机调节所述零失配鉴相器的失调‑符号控制端使得所述零失配鉴相器输出的鉴相结果信号反相。
24.根据权利要求13所述的参考时钟信号注入锁相环的消除失调方法,其特征在于:所述滤波器根据所述零失配鉴相器的鉴相结果信号的均值和频率误差的均值通过所述滤波器施加的电压调节所述压控延迟线输出的压控信号的相位和频率,直至所述鉴相结果信号的均值为零并且所述频率误差的均值也为0时,所述压控信号的频率和相位被锁定,即所述锁相环路和所述压控振荡环路被锁定。
说明书 :
一种参考时钟信号注入锁相环电路及消除失调方法
技术领域
背景技术
Oscillator,VCO)和锁频环(Frequency Lock Loop,FLL)。其中,由于参考注入锁相环是在
不断开环形振荡器的情况下,直接注入参考时钟信号,参考脉冲PUL_REFP与注入参考脉冲
之前的压控振荡器的输出信号之间存在相位差tos,会导致参考脉冲PUL_REFP注入后的压
控信号VCO_NEW的时钟杂散非常大。
振荡器VCO信号的两个瞬态周期。
参考时钟的时钟杂散为‑52dBc;当相位差tos为10pS,压控振荡器VCO信号的平均频率为
2.5GHz时,则其频谱上对应的参考时钟的时钟杂散为‑31.8dBc。可以看出,当相位差tos
(即,相位失调)越大时,参考时钟时钟杂散越高。这大大限制了参考时钟注入锁相环的应用
场合。
发明内容
并预先将鉴相器的失调清零,解决了参考时钟信号注入环路的相位失配问题。
配鉴相器和滤波器,用于组成一个失调消除环路、一个锁相环路、一个压控振荡环路和一个
注入锁相环路;所述失调消除环路包括所述所述第一脉冲生成器、所述状态机、所述零失配
鉴相器和所述脉冲选择放大电路;所述压控振荡环路包括所述第二脉冲生成器、所述脉冲
选择放大电路和所述压控延迟线;所述锁相环路包括所述第一脉冲生成器、所述第二脉冲
生成器、所述零失配鉴相器、所述滤波器、所述压控延迟线所述脉冲选择放大电路;所述注
入锁相环路包括所述脉冲选择放大电路、所述第一脉冲生成器、所述第二脉冲生成器、所述
状态机、所述零失配鉴相器、所述滤波器和所述压控延迟线;所述状态机断开所述锁相环路
和所述压控振荡环路,启用所述失调消除环路以采用所述第一脉冲生成器生成的第一脉冲
信号来校正所述零失配鉴相器;所述状态机启用所述锁相环路和所述压控振荡环路,用校
正后的所述零失配鉴相器来锁定所述第二脉冲生成器生成的第二脉冲信号;所述状态机将
所述锁相环路切换到所述注入锁相环路,启用所述注入锁相环路,用于注入所述第一脉冲
生成器生成的第一脉冲信号。
将参考时钟信号分为两路输入所述零失配鉴相器。
延迟线输出的压控信号输入至所述压控延迟线和所述零失配鉴相器,将参考时钟信号输入
所述零失配鉴相器;所述滤波器用于根据所述零失配鉴相器的输出值调节所述压控延迟线
输出的压控信号频率;所述状态机用于当所述零失配鉴相器输出的相差均值为零时进行锁
频。
线,所述压控延迟线输出的压控信号和所述参考时钟信号输入所述零失配鉴相器。
或所述参考时钟信号至所述压控延迟线和所述零失配鉴相器;所述第二脉冲选择放大电路
用于输出所述压控信号或所述参考时钟信号至所述零失配鉴相器;
号,并脉宽放大转换为宽脉冲信号。
大转换为宽脉冲信号。
转换器均与所述相位检测器/时间数字转换器相连。
位和频率,直至所述所述鉴相结果信号的均值为零并且所述频率误差的均值也为0时,所述
压控信号的频率和相位被锁定,即所述锁相环路和所述压控振荡环路被锁定。
器、状态机、脉冲选择放大电路、压控延迟线、零失配鉴相器和滤波器,用于组成一个失调消
除环路、一个锁相环路、一个压控振荡环路和一个注入锁相环路;所述失调消除环路包括所
述所述第一脉冲生成器、所述状态机、所述零失配鉴相器和所述脉冲选择放大电路;所述压
控振荡环路包括所述第二脉冲生成器、所述脉冲选择放大电路和所述压控延迟线;所述锁
相环路包括所述第一脉冲生成器、所述第二脉冲生成器、所述零失配鉴相器、所述滤波器、
所述压控延迟线所述脉冲选择放大电路;所述注入锁相环路包括所述脉冲选择放大电路、
所述第一脉冲生成器、所述第二脉冲生成器、所述状态机、所述零失配鉴相器、所述滤波器
和所述压控延迟线;
考时钟信号分为两路输入所述零失配鉴相器。
线输出的压控信号输入至所述压控延迟线和所述零失配鉴相器,将参考时钟信号输入所述
零失配鉴相器;所述滤波器根据所述零失配鉴相器的输出值调节所述压控延迟线输出的压
控信号频率;所述状态机当所述零失配鉴相器输出的相差均值为零时进行锁频。
述压控延迟线输出的压控信号和所述参考时钟信号输入所述零失配鉴相器。
述参考时钟信号至所述压控延迟线和所述零失配鉴相器;所述第二脉冲选择放大电路输出
所述压控信号或所述参考时钟信号至所述零失配鉴相器;
号,并脉宽放大转换为宽脉冲信号。
大转换为宽脉冲信号。
转换器均与所述相位检测器/时间数字转换器相连。
位和频率,直至所述所述鉴相结果信号的均值为零并且所述频率误差的均值也为0时,所述
压控信号的频率和相位被锁定,即所述锁相环路和所述压控振荡环路被锁定。
附图说明
具体实施方式
不具技术上的实质意义,任何结构的修饰、比例关系的改变或大小的调整,在不影响本发明
所能产生的功效及所能达成的目的下,均应仍落在本发明所揭示的技术内容得能涵盖的范
围内。同时,本说明书中所引用的如“上”、“下”、“左”、“右”、“中间”及“一”等的用语,亦仅为
便于叙述的明了,而非用以限定本发明可实施的范围,其相对关系的改变或调整,在无实质
变更技术内容下,当亦视为本发明可实施的范畴。
效成鉴相器的失调,并预先将鉴相器的失调清零,使得参考时钟信号注入相位误差,也即环
路锁定后鉴相误差)为零,从而消除锁相环输出的时钟杂散,解决了参考时钟信号注入引发
的相位失配的问题。
Width Select and Amplitude Circuit,PWSAC)4、压控延迟线(Voltage Controlled
Delay Lines,VCDL)5、零失配鉴相器(Zero Offset Phase Detector,ZOPD)6和滤波器
(Filter)7。所述脉冲选择放大电路4连接至所述第一脉冲生成器1和所述第二脉冲生成器2
的输出端均连接至的输入端,所述状态机3与所述脉冲选择放大电路4、所述零失配鉴相器
6、所述滤波器7均相连,所述脉冲选择放大电路4的输出与所述压控延迟线5和所述零失配
鉴相器6分别相连,所述零失配鉴相器6再与所述状态机3和所述滤波器7分别相连,所述滤
波器7与所述状态机3与所述压控延迟线5分别相连,所述压控延迟线5再与所述第二脉冲生
成器2相连。
生成器2用于接收压控延迟线输出信号VCO_VP并生成第二窄脉冲信号PUL_VCOP。所述脉冲
选择放大电路4用于在状态机的控制下选取窄脉冲信号并将其脉宽放大转换成宽脉冲信
号,其包括第一脉冲选择放大电路41和第二脉冲选择放大电路42,所述第一脉冲选择放大
电路41和第二脉冲选择放大电路42分别用于选择所述第一脉冲生成器1和第二脉冲生成器
2输出的第一窄脉冲信号PUL_REFP和第二窄脉冲信号PUL_VCOP中的一个作为输入并将其分
别转换成第一宽脉冲信号DIRT_PUL和第二宽脉冲信号VCO_NEW输出。所述零失配鉴相器6对
所述第一脉冲选择放大电路41和第二脉冲选择放大电路42输出的第一宽脉冲信号DIRT_
PUL和第二宽脉冲信号VCO_NEW进行鉴相并输出鉴相结果信号PD_OUT。所述压控延迟线5连
接至所述第一脉冲选择放大电路42的输出端,用于接收所述第二宽脉冲信号VCO_NEW并由
所述滤波器7控制其延迟时间(即,控制VCO_VP的频率)。所述状态机3连接至所述脉冲选择
放大电路4的控制端,以控制所述脉冲选择放大电路4的信号选取。例如,当状态机的输出的
S1和S2为高电平时选通所述脉冲选择放大电路4相应的D1端口;当S1和S2为低电平时选通
所述脉冲选择放大电路4相应的D0端口。
作原理如下:
所述零失配鉴相器6。具体地,所述状态机3将锁相环切换到所述注入锁相环路和所述压控
振荡环路,并设置选择信号S1和S2的值,以控制所述第一脉冲选择放大电路41和第二脉冲
选择放大电路42均选择第一窄脉冲信号PUL_REFP作为输入并将其脉宽放大输出至鉴相器
零失配鉴相器6的第一和第二输入端。所述状态机3根据零失配鉴相器6的鉴相结果信号对
所述零失配鉴相器6进行调节,以对零失配鉴相器6的失调进行校正。具体地,所述状态机3
通过增大或减小输入至所述零失配鉴相器6的失调‑符号控制端tos_tune的值来调节所述
零失配鉴相器6的控制位直至其输出的鉴相结果信号PD_OUT均值为零,从而实现了所述零
失配鉴相器6的零相位失调。其中,所述失调‑符号控制端tos_tune具有双重功能:第一个功
能是状态机通过其校正鉴相器内部的失调;第二个功能是状态机通过其根据流程改变鉴相
器输出信号PD_OUT的极性。
言,所述状态机3设置选择信号S1和S2的值,以控制所述第一脉冲选择放大电路41和第二脉
冲选择放大电路42分别选择第一窄脉冲信号PUL_REFP和第二窄脉冲信号PUL_VCOP作为输
入并转换成相应的第一宽脉冲信号DIRT_PUL和第二宽脉冲信号VCO_NEW输出至鉴相器零失
配鉴相器6的第一和第二输入端。所述零失配鉴相器6将鉴相结果信号PD_OUT输入至所述滤
波器7的相位误差控制端phase_err,作为所述滤波器7的相位误差phase_err。同时所述数
字状态机3有锁频功能,即用所述参考时钟信号REF_CLK来计算所述压控延迟线输出信号
VCO_VP的频率误差,输出频率误差freq_err至所述滤波器7的频率误差控制端freq_err。所
述滤波器7根据所述鉴相结果信号PD_OUT的均值和频率误差freq_err的均值通过滤波器施
加的电压Vtune调节所述压控延迟线5输出的所述压控延迟线输出信号VCO_VP的相位和频
率,直至相差PD_OUT均值为零并且所述频率误差freq_err均值也为0时,所述压控延迟线输
出信号VCO_VP的频率和相位被锁定,即所述锁相环路和所述压控振荡环路被锁定。
测到锁相环路相位被锁定时(即,鉴相结果信PD_OUT的均值和频率误差freq_err的均值都
等于0)时,所述状态机3将所述锁相环路切换成注入锁相环路。所述状态机3设置选择信号
S1和S2的值,以控制所述第一脉冲选择放大电路41和第二脉冲选择放大电路42分别选择第
二窄脉冲信号PUL_VCOP和第一窄脉冲信号PUL_REFP作为输入并转换成相应的第一宽脉冲
信号DIRT_PUL和第二宽脉冲信号VCO_NEW输出至鉴相器零失配鉴相器6的第一和第二输入
端,从而实现所述注入锁相环路的参考时钟信号的相位周期性注入。这相当于将以上所述
的锁频锁相操作中所述第一窄脉冲信号PUL_REFP和所述第二窄脉冲信号PUL_VCOP进行了
交换,使得第二脉冲选择放大电路42输出的当前第二宽脉冲信号VCO_NEW的沿降变成了以
上锁频锁相操作中的第一宽脉冲信号DIRT_PUL信号,使得第一脉冲选择放大电路41输出的
当前第一宽脉冲信号DIRT_PUL的沿降变成了锁频锁相操作中的第二宽脉冲信号VCO_NEW。
而在锁频锁相操作中所述锁相环路和所述压控振荡环路被锁定时,第一宽脉冲信号DIRT_
PUL与第二宽脉冲信号VCO_NEW上升沿是对齐的,那么在所述参考时钟信号注入时,所述参
考时钟信号REF_CLK和所述压控延迟线输出信号VCO_VP对应的所述当前第二宽脉冲信号
VCO_NEW与当前第一宽脉冲信号DIRT_PUL的上升沿也是对齐的,从而有效消除了时钟杂散。
(相应地,相位也交换)。因此,在切换成注入锁相环路时,状态机应调节其失调符号控制端
tos_tune的值,使得所述零失配鉴相器6输出的鉴相结果信号PD_OUT反相,以维持锁相环路
稳定的负反馈。
换所述第一脉冲信号PUL_REFP和所述第二脉冲信号PUL_VCOP。交换之后,VCO_NEW信号的沿
降变成所述DIRT_PUL信号。所述DIRT_PUL信号与所述VCO_NEW信号进入所述零失调鉴相器
6。由于环路锁定时所述DIRT_PUL信号与所述VCO_NEW信号的上升沿对齐,故不存在相位差
tos的影响,从而消除了锁相环输出的时钟杂散。
机需要根据实际情况在锁频锁相操作和参考时钟信号的注入操作之间来回切换。而且每次
切换时,鉴相器输出信号PD_OUT的极性也要相应的改变,以维持锁相环路的负反馈特性。
和所述第二数字时间转换器62均与所述相位检测器/时间数字转换器63相连。其中,所述第
一数字时间转换器1和所述第二数字时间转换器2的输入端分别作为所述零失配鉴相器6的
两个输入端,所述相位检测器/时间数字转换器63作为所述零失配鉴相器6的输出端。所述
状态机3连接至所述第一数字时间转换器1和所述第二数字时间转换器2的控制端,通过调
节第一数字时间转换器61和/或第二数字时间转换器62来校正所述零失配鉴相器的相位失
配。
压控延迟线、零失配鉴相器和滤波器。所述脉冲选择放大电路连接至所述第一脉冲生成器
和所述第二脉冲生成器的输出端均连接至的输入端,所述状态机与所述脉冲选择放大电
路、所述零失配鉴相器、所述滤波器均相连,所述脉冲选择放大电路的输出与所述压控延迟
线和所述零失配鉴相器分别相连,所述零失配鉴相器再与所述状态机和所述滤波器分别相
连,所述滤波器与所述状态机与所述压控延迟线分别相连,所述压控延迟线再与所述第二
脉冲生成器相连。
冲信号PUL_REFP经由所述脉冲选择放大电路输入所述压控延迟线,并分为两路输入所述零
失配鉴相器。根据所述鉴相结果信号PD_OUT,所述状态机调节通过控制线tos_tune调节所
述零失调鉴相器,直到所述鉴相结果信号PD_OUT的平均值为零,从而实现消除失调。
入所述第二脉冲生成器以生成第二窄脉冲信号PUL_VCOP。所述第二窄脉冲信号PUL_VCOP经
由所述第二窄脉冲选择放大电路变更为第二宽脉冲信号DIRT_PUL输入所述压控延迟线和
所述零失配鉴相器的一端;所述第一窄脉冲信号PUL_REFP经由所述第一脉冲选择放大电路
变更为第一宽脉冲信号VCO_NEW输入所述零失配鉴相器的另一端。所述滤波器根据所述零
失配鉴相器输出的相差PD_OUT调节所述压控延迟线输出的压控延迟线输出信号VCO_VP的
均值,进而反过来调节所述零失配鉴相器输出的相差PD_OUT,直至所述相差PD_OUT均值为
零,则实现了锁频。此时,所述参考时钟信号REF_CLK和所述压控延迟线输出信号VCO_VP的
频率相同。
压控延迟线输出信号VCO_VP输入所述第二脉冲生成器以生成第二窄脉冲信号PUL_VCOP。所
述第一窄脉冲信号PUL_REFP经由所述第二脉冲选择放大电路变更为第第一宽脉冲信号
VCO_NEW输入所述压控延迟线和所述零失配鉴相器的一端;所述第二脉冲信号PUL_VCOP经
由所述第一脉冲选择放大电路变更为第二宽脉冲信号DIRT_PUL输入所述零失配鉴相器的
另一端,从而实现所述注入锁相环路的参考时钟信号的注入。
到注入锁相环路;步骤S3切换为步骤S2的条件是:当锁定后的相位误差大于所述预设特定
值时,注入锁相环路将切回到锁相环路,重新锁定第二窄脉冲信号。
零,解决了参考时钟信号注入环路的相位失配问题参考时钟信号;消除了锁相环输出的时
钟杂散;可应用于一般时钟生成器、倍频器、锁相环、CDR等电子电路或系统中。所以,本发明
有效克服了现有技术中的种种缺点而具高度产业利用价值。
此,举凡所属技术领域中具有通常知识者在未脱离本发明所揭示的精神与技术思想下所完
成的一切等效修饰或改变,仍应由本发明的权利要求所涵盖。