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1. 发明公开

CN105144128A 存储器访问控制有权转让
公开(公告)号：CN105144128A
公开(公告)日：2015-12-09
申请号：CN201480021912.5
申请日：2014-04-08
申请人： ARM有限公司
发明人：迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/16
CPC分类号： G06F15/167 , G06F12/0207 , G06F12/0623 , G06F13/1615
摘要：用于控制对包括彼此并列布置的多个存储器单元的存储器的访问的存储器访问电路。该存储器访问电路包括：两个访问单元，各自被配置为响应于接收到的存储器访问请求选择多个存储器单元中的一个存储器单元，并且控制和追踪对所选择的存储器单元的后续访问，多个存储器单元包括至少三个存储器单元；仲裁电路，被配置为从系统接收存储器访问请求并且选择存储器访问请求并将存储器访问请求转发到两个访问单元中的一个访问单元，仲裁电路被配置为将对于访问一个存储器单元的多个存储器访问请求转发到两个访问单元中的第一访问单元，并且将对于访问另一存储器单元的多个存储器访问请求引导到两个访问单元中的第二访问单元，并且随后将对于访问又一存储器单元的多个存储器访问请求引导到第一访问单元或第二访问单元中的一个访问单元。两个访问单元包括：存储电路，该存储电路在将请求传送到相应存储器单元之前将请求存储在队列中；以及追踪电路，该追踪电路追踪被发送到相应存储器单元的请求并且确定何时从队列传送后续请求。控制电路被配置为设置两个访问单元中的每个访问单元的状态，状态是以下各项中的一项：活动、准备、和休眠，处于活动状态的访问单元能操作来向相应存储器单元传送访问请求和激活请求两者，激活请求为相应存储器单元中的访问做准备并且访问请求访问数据，处于准备状态的访问单元能够操作来传送激活请求而不能够操作来传送访问请求，处于休眠状态的访问单元既不能操作来传送访问请求也不能操作来传送激活请求，控制电路被配置为周期性地切换两个访问单元的状态并且在同一时刻将访问单元中的不多于一个访问单元设置为活动状态。

2. 发明授权

CN109716314B 用于控制数据传输的装置、存储器控制器、存储器模块和方法有权
公开(公告)号：CN109716314B
公开(公告)日：2023-07-07
申请号：CN201780057097.1
申请日：2017-07-31
申请人： ARM有限公司
发明人：安德烈亚斯·翰森 , 温迪·阿诺特·埃萨瑟 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/42
摘要：提供了用于控制存储器中的数据传输的装置、存储器控制器、存储器模块和方法。该装置包括存储器控制器和多个存储器模块。存储器控制器被布置为通过将第一直接传输命令发送到第一存储器模块并且将第二直接传输命令发送第二存储器模块来协调直接数据传输。第一控制器模块响应于接收到第一直接传输命令来以旁路存储器控制器的方式直接发送数据以供由第二存储器模块接收。第二存储器模块响应于第二直接传输命令来直接从第一存储器模块接收数据，而不是要求经由存储器被路由的数据，并然后根据第二直接传输命令来存储该数据。这提供了用于在耦合到同一存储器控制器的多个存储器模块之间传输数据的高效机制。

3. 发明公开

CN110928811A 用于处理突发读取事务的装置和方法有权
公开(公告)号：CN110928811A
公开(公告)日：2020-03-27
申请号：CN201910866042.6
申请日：2019-09-12
申请人： ARM有限公司
发明人：詹姆师德·加拉 , 图沙尔·P·兰格 , 安尼萨·科纳 , 安德鲁·布鲁克菲尔德·斯温 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/16
摘要：提供了用于处理突发读取事务的装置和方法。该装置具有主设备和经由连接介质耦合到主设备的从设备。主设备包括用于发起使得主设备向从设备发出指定读取地址的地址传送的突发读取事务。从设备被布置为通过使得基于读取地址获得突发读取事务所需的多个数据项、并通过在连接介质上执行多次数据传送以便将多个数据项传送到主设备，来处理突发读取事务。从设备具有传送标识符生成电路，用于为每次数据传送生成传送标识符以指出哪个数据项正通过该数据传送进行传送。主设备具有用于缓冲接收的数据项的缓冲电路，其用于采用为每次数据传送提供的传送标识符来使数据项以确定顺序被提供给处理电路，而不管数据项经由多次数据传送被传送到主设备的顺序如何。

4. 发明公开

CN116150047A 用于操作高速缓存存储设备以高速缓存与存储器地址相关联的数据的技术审中-公开
公开(公告)号：CN116150047A
公开(公告)日：2023-05-23
申请号：CN202211433321.1
申请日：2022-11-16
申请人： Arm有限公司
发明人：格雷姆·莱斯利·因格拉姆 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F12/0871 , G06F12/0895
摘要：本技术提供了一种用于高速缓存数据的装置和方法。该装置具有：用于高速缓存与存储器地址相关联的数据的高速缓存存储设备；用于接收访问请求的第一接口，其中每个访问请求是访问该访问请求指示的存储器地址处的数据的请求；以及用于耦合到用于控制对存储器的访问的存储器控制器的第二接口。此外，高速缓存控制电路用于根据基于功耗的分配策略来控制将数据分配到该高速缓存存储设备中，该分配策略寻求选择哪个数据被高速缓存在该高速缓存存储设备中，目的是节省与经由该第二接口对该存储器的访问相关联的功率。为该高速缓存控制电路考虑的给定访问请求提供关联高速缓存提示信息，该提示信息为该给定访问请求指示的存储器地址处的给定数据提供一个或多个使用指示，并且该高速缓存控制电路被布置为在应用该基于功耗的分配策略以确定是否在该高速缓存存储设备中高速缓存该给定数据时参考该关联高速缓存提示信息。

5. 发明公开

CN109716314A 用于控制数据传输的装置、存储器控制器、存储器模块和方法有权
公开(公告)号：CN109716314A
公开(公告)日：2019-05-03
申请号：CN201780057097.1
申请日：2017-07-31
申请人： ARM有限公司
发明人：安德烈亚斯·翰森 , 温迪·阿诺特·埃萨瑟 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/42
CPC分类号： G06F12/0623 , G06F12/084 , G06F12/0888 , G06F13/1663 , G06F13/4234 , G06F2212/6046 , Y02D10/14 , Y02D10/151
摘要：提供了用于控制存储器中的数据传输的装置、存储器控制器、存储器模块和方法。该装置包括存储器控制器和多个存储器模块。存储器控制器被布置为通过将第一直接传输命令发送到第一存储器模块并且将第二直接传输命令发送第二存储器模块来协调直接数据传输。第一控制器模块响应于接收到第一直接传输命令来以旁路存储器控制器的方式直接发送数据以供由第二存储器模块接收。第二存储器模块响应于第二直接传输命令来直接从第一存储器模块接收数据，而不是要求经由存储器被路由的数据，并然后根据第二直接传输命令来存储该数据。这提供了用于在耦合到同一存储器控制器的多个存储器模块之间传输数据的高效机制。

6. 发明公开

CN103839595A 用于校正从存储器装置访问的数据中的错误的设备及方法有权转让
公开(公告)号：CN103839595A
公开(公告)日：2014-06-04
申请号：CN201310581828.6
申请日：2013-11-19
申请人： ARM有限公司
发明人：迈克尔·安德鲁·坎贝尔 , 蒂莫西·尼古拉斯·海
IPC分类号： G11C29/42
CPC分类号： G06F11/10 , G06F11/1048
摘要：本发明提供了一种用于校正在从存储器装置访问的数据中的错误的设备及方法。执行读操作以从存储器装置输出多个读取符号。随后根据多个读取符号确定伴随式信息，之后纠错电路使用伴随式信息执行纠错过程以定位含有错误的读取符号并校正在这些定位读取符号中的错误。若含有错误的读取符号是随机分布的，则可以此方式定位且校正多达PMAX个读取符号。错误追踪电路被配置在检测到达到错误阈值条件时，将至少一个存储器区域设置为擦除存储器区域。纠错电路将擦除存储器区域的每个读取符号视为含有错误的定位读取符号，从而使得：当执行纠错过程时，并非所有的待定位读取符号都是随机分布的且因此可定位及校正多于PMAX个含有错误的读取符号。

7. 发明授权

CN110928811B 用于处理突发读取事务的装置和方法有权
公开(公告)号：CN110928811B
公开(公告)日：2023-12-22
申请号：CN201910866042.6
申请日：2019-09-12
申请人： ARM有限公司
发明人：詹姆师德·加拉 , 图沙尔·P·兰格 , 安尼萨·科纳 , 安德鲁·布鲁克菲尔德·斯温 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/16
摘要：提供了用于处理突发读取事务的装置和方法。该装置具有主设备和经由连接介质耦合到主设备的从设备。主设备包括用于发起使得主设备向从设备发出指定读取地址的地址传送的突发读取事务。从设备被布置为通过使得基于读取地址获得突发读取事务所需的多个数据项、并通过在连接介质上执行多次数据传送以便将多个数据项传送到主设备，来处理突发读取事务。从设备具有传送标识符生成电路，用于为每次数据传送生成传送标识符以指出哪个数据项正通过该数据传送进行传送。主设备具有用于缓冲接收的数据项的缓冲电路，其用于采用为每次数据传送提供的传送标识符来使数据项以确定顺序被提供给处理电路，而不管数据项经由多次数据传送被传送到主设备的顺序如何。

8. 发明授权

CN107544923B 用于控制对存储器设备的访问的装置以及相关方法有权
公开(公告)号：CN107544923B
公开(公告)日：2023-09-01
申请号：CN201710475609.8
申请日：2017-06-21
申请人： ARM 有限公司
发明人：费格斯·麦克加里 , 迈克尔·安德鲁·坎贝尔
IPC分类号： G06F13/16
摘要：本公开涉及用于控制对存储器设备的访问的装置以及相关方法。描述了用于在被用于控制对存储器设备的访问的装置内执行维护操作的技术。该装置具有用于存储将要向存储器设备发出的访问请求的存储设备和用于在存储设备内提供的存储元件上执行维护操作的维护电路。存储器访问执行电路被用于向物理层接口发出从存储设备中选择的访问请求，以用于从物理层接口到存储器设备的向前传播。控制电路响应于训练事件而发起对物理层接口的训练操作。此外，控制电路还响应于训练事件而在训练操作正在被执行时触发由维护电路执行维护操作。

9. 发明公开

CN115777101A 使用高速缓存的部分散列值的存储器保护审中-实审
公开(公告)号：CN115777101A
公开(公告)日：2023-03-10
申请号：CN202180047677.9
申请日：2021-07-07
申请人： ARM有限公司
发明人：罗伯托·阿凡兹 , 安德烈亚斯·拉斯·桑德伯格 , 迈克尔·安德鲁·坎贝尔 , 马蒂亚斯·洛塔尔·伯特歇尔 , 普拉卡什·S·拉姆拉希亚尼
IPC分类号： G06F21/79
摘要：本发明公开了用于保护存储在存储器的受保护区域中的数据的完整性的装置和方法。在数据块中检索存储器的该受保护区域中的数据，并且将认证码与连续地包括第一数据块和第二数据块的存储器区组相关联。该认证码的计算包括基于根据该第一数据块确定的第一散列值和根据该第二数据块确定的第二散列值的加密计算。提供散列值高速缓存以存储根据从该存储器的该受保护区域中检索的数据块确定的散列值。当从存储器中检索该第一数据块和其相关联的认证码时，执行对该散列值高速缓存中的该第二散列值的查找，并且为该数据块所属的该存储器区组计算验证认证码。该第一数据块的完整性取决于与检索到的认证码匹配的验证认证码。

10. 发明公开

CN103620570A 存储器控制器和这种存储器控制器的操作方法有权转让
公开(公告)号：CN103620570A
公开(公告)日：2014-03-05
申请号：CN201280031025.7
申请日：2012-05-29
申请人： ARM有限公司
发明人：迈克尔·安德鲁·坎贝尔 , 克里斯托弗·埃德温·瑞格利 , 布雷特·斯坦利·菲勒
IPC分类号： G06F13/16
CPC分类号： G06F13/1631
摘要：本发明提供一种存储器控制器，用于控制对具有非均匀访问定时特性类型的存储器设备的访问。该存储器控制器具有用于接收从至少一个事务源发出的事务的接口，每个事务指定该事务要访问的存储器地址并包括与该事务相关联的优先级指示。缓冲器用于将通过接口接收的还没有被发送给存储器设备的那些事务临时存储为挂起事务，缓冲器保持对于存储的挂起事务的多个有序列表，包括至少一个基于优先级的有序列表和至少一个访问定时有序列表。每个基于优先级的有序列表具有多个条目，每个条目与挂起事务之一相关联，且每个条目基于相关联的挂起事务的优先级指示在其基于优先级的有序列表中被排序。每个访问定时有序列表具有多个条目，每个条目与挂起事务之一相关联，且与每个访问定时有序列表相关联的挂起事务形成一事务组，一旦该组中的某一事务的存储器地址被访问，该组各事务的存储器地址就能够被存储器设备有效地访问。仲裁电路执行仲裁操作，在仲裁操作过程中多个有序列表被参考以便从挂起事务中选择要发送给存储器设备的获胜事务。该获胜事务的任何条目随后被从多个有序列表中移除。如果当仲裁操作被执行时，先前选中的获胜事务在特定的访问定时列表中具有条目且该访问定时有序列表仍然非空，则在不存在预定的异常状况时，仲裁操作被布置来将挂起事务中的在该访问定时有序列表中具有条目的挂起事务选作获胜事务。这种方法允许在对事务进行重新排序以改善存储器访问时间同时确保考虑到各种事务的优先级之间达到平衡。

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