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1. 发明申请

US20110191529A1 SEMICONDUCTOR STORAGE DEVICE AND METHOD OF CONTROLLING SEMICONDUCTOR STORAGE DEVICE 有权
标题翻译：半导体存储器件及控制半导体存储器件的方法
公开(公告)号：US20110191529A1
公开(公告)日：2011-08-04
申请号：US13016780
申请日：2011-01-28
申请人： Motohiro MATSUYAMA , Tohru FUKUDA , Hiroyuki Moro
发明人： Motohiro MATSUYAMA , Tohru FUKUDA , Hiroyuki Moro
IPC分类号： G06F12/02
CPC分类号： G06F12/02
摘要： According to one embodiment, a semiconductor storage device includes a queuing buffer, a read module, a separating module, a write command issuing module, and a write module. The write command issuing module is configured to add a write address indicated by write pointer information to the management data obtained by the separating module in order to issue a write command, and to automatically queue the write command into the queuing buffer. The write module is configured to supply the write command issued by the write command issuing module to the nonvolatile memory in order to write data into the nonvolatile memory.
摘要翻译：根据一个实施例，半导体存储装置包括排队缓冲器，读取模块，分离模块，写入命令发布模块和写入模块。写命令发布模块被配置为将由写指针信息指示的写地址添加到由分离模块获得的管理数据，以便发出写命令，并将写入命令自动排队到排队缓冲器中。写入模块被配置为将写命令发布模块发出的写命令提供给非易失性存储器，以便将数据写入到非易失性存储器中。

2. 发明申请

US20120166711A1 DATA STORAGE APPARATUS AND APPARATUS AND METHOD FOR CONTROLLING NONVOLATILE MEMORIES 有权
标题翻译：数据存储装置和控制非易失性存储器的装置和方法
公开(公告)号：US20120166711A1
公开(公告)日：2012-06-28
申请号：US13311403
申请日：2011-12-05
申请人： Motohiro MATSUYAMA , Kyosuke TAKAHASHI
发明人： Motohiro MATSUYAMA , Kyosuke TAKAHASHI
IPC分类号： G06F12/02
CPC分类号： G06F11/10
摘要： According to one embodiment, a data storage apparatus comprises a channel controller, an encoding module, and a data controller. The channel controller is configured to control data input to, and output from, nonvolatile memories for channels. The encoding module is configured to generate encoded data for which an inter-channel error correction process, using data stored in each of the nonvolatile memories. The data controller is configured to manage the encoded data in units of logic blocks when the channel controller writes the encoded data in parallel to the channels, and to allocate parity data contained in the encoded data to one plane in each logic block.
摘要翻译：根据一个实施例，数据存储装置包括信道控制器，编码模块和数据控制器。通道控制器被配置为控制对于通道的非易失性存储器的输入和从其输出的数据。编码模块被配置为使用存储在每个非易失性存储器中的数据来生成用于信道间纠错处理的编码数据。数据控制器被配置为当信道控制器将编码数据并行地写入信道时，以逻辑块为单位管理编码数据，并将包含在编码数据中的奇偶校验数据分配给每个逻辑块中的一个平面。

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