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    • 4. 发明专利
    • 制御装置
    • JP2021131785A
    • 2021-09-09
    • JP2020027625
    • 2020-02-20
    • 株式会社日立製作所
    • 島村 光太郎池田 尚弘
    • G05B9/02G06F11/18G05B9/03
    • 【課題】複数の処理装置で同一の処理を実行する制御装置において、複数の処理装置が入力を取り込むタイミングのずれに起因する過剰な誤動作検出を防止した制御装置を提供する。 【解決手段】取得タイミングの異なるデータをデータラッチ可能な記憶部と、複数の処理装置100、110の各々について、当該処理装置からの制御対象機器150に対する入力要求に応答して制御対象機器から送信された入力データを当該処理装置に入力するか否かを制御する入力制御回路140と、を備え、記憶部にデータラッチすることにより、取得タイミング差に起因する情報差異を無くして入力データとし、判定基準には、出力データそれぞれの同一性判定、又は多数決を採用し、同一性判定では、出力データの相互間に非同一の組み合わせがあれば誤動作と判定し、多数決では、出力データが3系統以上の場合に適用されて、多数決の結果に基づいて誤動作か否かを判定する。 【選択図】図1