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相位差调节电路

阅读：1035发布：2020-07-01

IPRDB可以提供相位差调节电路专利检索，专利查询，专利分析的服务。并且本发明公开了一种相位差调节电路，包括FPGA芯片、数字信号产生单元、第一D/A转换单元、第二D/A转换单元、第一可调延时单元、第二可调延时单元、相位差检测单元、第一放大整形单元和第二放大整形单元，上述FPGA芯片与数字信号产生单元相连，上述数字信号产生单元与上述第一D/A转换单元、第二D/A转换单元相连，第一可调延时单元与第一D/A转换单元相连，第二可调延时单元与第二D/A转换单元相连，相位差检测单元与第一可调延时单元相连、第二可调延时单元相连，第一放大整形单元与第一可调延时单元相连，第二放大整形单元与第二可调延时单元相连。本发明的有益效果为：其能够有效调节两路信号的相位差。，下面是相位差调节电路专利的具体信息内容。

权利要求

1.一种相位差调节电路，其特征在于，包括FPGA芯片、数字信号产生单元、第一D/A转换单元、第二D/A转换单元、第一可调延时单元、第二可调延时单元、相位差检测单元、第一放大整形单元和第二放大整形单元，上述FPGA芯片与数字信号产生单元相连，上述数字信号产生单元与上述第一D/A转换单元相连，第一D/A转换单元将数字信号产生单元产生的第一信号转化为第二信号，上述数字信号产生单元与上述第二D/A转换单元相连，第二D/A转换单元将数字信号产生单元产生的的第一信号转化为第三信号，第一可调延时单元与第一D/A转换单元相连，第一可调延时单元将第二信号转化为第四信号，第二可调延时单元与第二D/A转换单元相连，第二可调延时单元将第三信号转化为第五信号，相位差检测单元与第一可调延时单元相连，相位差检测单元与第二可调延时单元相连，相位差检测单元用于检测第四信号与第五信号的相位差，第一放大整形单元与第一可调延时单元相连，第一放大整形单元将第四信号转化为第六信号，第二放大整形单元与第二可调延时单元相连，第二放大整形单元将第五信号转化为第七信号，相位差检测单元将相位差信息反馈给第一可调延时单元，第一可调延时单元根据相位差信息调整输出的第四信号，相位差检测单元将相位差信息反馈给第二可调延时单元，第二可调延时单元根据相位差信息调整输出的第五信号。

说明书全文

相位差调节电路

技术领域

[0001] 本发明涉及电子电路技术领域，具体涉及一种相位差调节电路。

背景技术

[0002] 现有的相位差调节电路存在调节不精准的问题。

发明内容

[0003] 本发明的目的在于提供一种相位差调节电路，其能够有效调节两路信号的相位差。

[0004] 为实现上述目的，本发明提供如下技术方案：一种相位差调节电路，包括FPGA芯片、数字信号产生单元、第一D/A转换单元、第二D/A转换单元、第一可调延时单元、第二可调延时单元、相位差检测单元、第一放大整形单元和第二放大整形单元，上述FPGA芯片与数字信号产生单元相连，上述数字信号产生单元与上述第一D/A转换单元相连，第一D/A转换单元将数字信号产生单元产生的第一信号转化为第二信号，上述数字信号产生单元与上述第二D/A转换单元相连，第二D/A转换单元将数字信号产生单元产生的的第一信号转化为第三信号，第一可调延时单元与第一D/A转换单元相连，第一可调延时单元将第二信号转化为第四信号，第二可调延时单元与第二D/A转换单元相连，第二可调延时单元将第三信号转化为第五信号，相位差检测单元与第一可调延时单元相连，相位差检测单元与第二可调延时单元相连，相位差检测单元用于检测第四信号与第五信号的相位差，第一放大整形单元与第一可调延时单元相连，第一放大整形单元将第四信号转化为第六信号，第二放大整形单元与第二可调延时单元相连，第二放大整形单元将第五信号转化为第七信号，相位差检测单元将相位差信息反馈给第一可调延时单元，第一可调延时单元根据相位差信息调整输出的第四信号，相位差检测单元将相位差信息反馈给第二可调延时单元，第二可调延时单元根据相位差信息调整输出的第五信号。

[0005] 本发明的工作原理为：相位差检测单元用于检测第四信号与第五信号的相位差，第一可调延时单元根据相位差检测单元的检测结果调整其延时输出，第二可调延时单元根据相位差检测单元的检测结果调整其延时输出，使得第四信号与第五信号的相位差实现精确调节。

[0006] 本发明的有益效果为：其能够有效调节两路信号的相位差。

附图说明

[0007] 图1是本发明的示意图。

具体实施方式

[0008] 下面结合附图和实施例，对本发明的具体实施方式作进一步描述。以下实施例仅用于更加清楚地说明本发明的技术方案，而不能以此来限制本发明的保护范围。

[0009] 本发明具体实施的技术方案是：如图1所示，一种相位差调节电路，包括FPGA芯片1、数字信号产生单元2、第一D/A转换单元31、第二D/A转换单元32、第一可调延时单元41、第二可调延时单元42、相位差检测单元
5、第一放大整形单元61和第二放大整形单元62，上述FPGA芯片1与数字信号产生单元2相连，上述数字信号产生单元2与上述第一D/A转换单元31相连，第一D/A转换单元31将数字信号产生单元2产生的第一信号转化为第二信号，上述数字信号产生单元2与上述第二D/A转换单元32相连，第二D/A转换单元32将数字信号产生单元2产生的的第一信号转化为第三信号，第一可调延时单元41与第一D/A转换单元31相连，第一可调延时单元41将第二信号转化为第四信号，第二可调延时单元42与第二D/A转换单元32相连，第二可调延时单元42将第三信号转化为第五信号，相位差检测单元5与第一可调延时单元41相连，相位差检测单元5与第二可调延时单元42相连，相位差检测单元5用于检测第四信号与第五信号的相位差，第一放大整形单元61与第一可调延时单元41相连，第一放大整形单元61将第四信号转化为第六信号，第二放大整形单元62与第二可调延时单元42相连，第二放大整形单元62将第五信号转化为第七信号，相位差检测单元5将相位差信息反馈给第一可调延时单元41，第一可调延时单元41根据相位差信息调整输出的第四信号，相位差检测单元5将相位差信息反馈给第二可调延时单元42，第二可调延时单元42根据相位差信息调整输出的第五信号。

[0010] 本发明的工作原理为：相位差检测单元5用于检测第四信号与第五信号的相位差，第一可调延时单元41根据相位差检测单元5的检测结果调整其延时输出，第二可调延时单元42根据相位差检测单元5的检测结果调整其延时输出，使得第四信号与第五信号的相位差实现精确调节。

[0011] 本发明的有益效果为：其能够有效调节两路信号的相位差。

[0012]以上所述仅是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明技术原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

标题	发布/更新时间	阅读量
相位差膜-专利编号CN110799870A	2020-05-11	550
相位差膜-专利编号CN110268293A	2020-05-11	95
相位对齐-专利编号CN109508066A	2020-05-11	860
相位塞-专利编号CN101467466A	2020-05-13	694
相位差膜-专利编号CN100432716C	2020-05-13	699
相位差膜-专利编号CN101529284B	2020-05-13	271
相位差膜-专利编号CN109416426A	2020-05-12	514
相位差膜-专利编号CN105319634B	2020-05-11	128
相位差膜-专利编号CN105319634A	2020-05-12	633
相位差膜-专利编号CN101389987B	2020-05-12	837

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