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1. 发明申请

US20100030954A1 INFORMATION PROCESSING SYSTEM AND SEMICONDUCTOR STORAGE DEVICE 有权
标题翻译：信息处理系统和半导体存储设备
公开(公告)号：US20100030954A1
公开(公告)日：2010-02-04
申请号：US12510633
申请日：2009-07-28
申请人： Seiji MIURA , Yoshinori HARAGUCHI , Kazuhiko ABE , Shoji KANEKO , Akira YABU
发明人： Seiji MIURA , Yoshinori HARAGUCHI , Kazuhiko ABE , Shoji KANEKO , Akira YABU
IPC分类号： G06F12/00 , G06F1/12
CPC分类号： G06F13/4217
摘要： A random access memory includes a data signal line, a data-synchronization signal line for a data synchronization signal which provides a synchronization signal when data is transmitted to the data signal line, and a setting module. The setting module determines whether the data signal line is set to be a data signal line for common input/output use, a data signal line for output-only use, or a data signal line for input-only use, and further determines whether the data-synchronization signal line is set to be a data-synchronization signal line for common input/output use, a data-synchronization signal line for output-only use, or a data-synchronization signal line for input-only use.
摘要翻译：随机存取存储器包括数据信号线，用于当数据被发送到数据信号线时提供同步信号的数据同步信号的数据同步信号线以及设置模块。设置模块确定数据信号线是否被设置为用于公共输入/输出使用的数据信号线，仅用于输出的数据信号线或仅用于输入的数据信号线，并且还确定是否数据同步信号线被设置为用于公共输入/输出使用的数据同步信号线，仅用于输出的数据同步信号线或仅用于输入的数据同步信号线。

2. 发明申请

US20070271409A1 MEMORY MODULE, MEMORY SYSTEM, AND DATA PROCESSING SYSTEM 审中-公开
标题翻译：存储器模块，存储器系统和数据处理系统
公开(公告)号：US20070271409A1
公开(公告)日：2007-11-22
申请号：US11748936
申请日：2007-05-15
申请人： Seiji Miura , Akira Yabu , Yoshinori Haraguchi
发明人： Seiji Miura , Akira Yabu , Yoshinori Haraguchi
IPC分类号： G06F12/06
CPC分类号： G06F12/0623 , Y02D10/13
摘要： A user-friendly data processing system apparatus which ensures the expandability of memory capacity and high speed processing with low cost is provided. The data processing system is composed of a data processing unit, a volatile memory and a nonvolatile memory. The data processing unit, the volatile memory and the nonvolatile memory are connected in series and by reducing the number of connection signals fast processing is realized while maintaining the memory capacity expandability. Upon transferring a data of the nonvolatile memory to the volatile memory, an error correction is executed, therefore, the reliability is improved. The data processing system composed of the plurality of memory chips is formed as a data processing system module in which the each chips are stacked and arranged, and wiring is formed by ball grid array (BGA) and bonding between the chips.
摘要翻译：提供一种用户友好的数据处理系统装置，其确保存储容量的可扩展性和低成本的高速处理。数据处理系统由数据处理单元，易失性存储器和非易失性存储器组成。数据处理单元，易失性存储器和非易失性存储器被串联连接，并且通过减少在保持存储器容量扩展性的同时实现快速处理的连接信号的数量。在将非易失性存储器的数据传送到易失性存储器时，执行错误校正，因此提高了可靠性。由多个存储器芯片组成的数据处理系统形成为数据处理系统模块，其中每个芯片被堆叠和布置，并且布线由球栅阵列（BGA）形成并且芯片之间的结合。

3. 发明授权

US09030895B2 Memory device with pin register to set input/output direction and bitwidth of data signals 有权
标题翻译：具有引脚寄存器的存储器件，用于设置数据信号的输入/输出方向和位宽
公开(公告)号：US09030895B2
公开(公告)日：2015-05-12
申请号：US12510633
申请日：2009-07-28
申请人： Seiji Miura , Yoshinori Haraguchi , Kazuhiko Abe , Shoji Kaneko , Akira Yabu
发明人： Seiji Miura , Yoshinori Haraguchi , Kazuhiko Abe , Shoji Kaneko , Akira Yabu
IPC分类号： G11C7/00 , G06F13/42
CPC分类号： G06F13/4217
摘要： A random access memory includes a data signal line, a data-synchronization signal line for a data synchronization signal which provides a synchronization signal when data is transmitted to the data signal line, and a setting module. The setting module determines whether the data signal line is set to be a data signal line for common input/output use, a data signal line for output-only use, or a data signal line for input-only use, and further determines whether the data-synchronization signal line is set to be a data-synchronization signal line for common input/output use, a data-synchronization signal line for output-only use, or a data-synchronization signal line for input-only use.
摘要翻译：随机存取存储器包括数据信号线，用于当数据被发送到数据信号线时提供同步信号的数据同步信号的数据同步信号线以及设置模块。设置模块确定数据信号线是否被设置为用于公共输入/输出使用的数据信号线，仅用于输出的数据信号线或仅用于输入的数据信号线，并且还确定是否数据同步信号线被设置为用于公共输入/输出使用的数据同步信号线，仅用于输出的数据同步信号线或仅用于输入的数据同步信号线。

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