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    • 1. 发明授权
      US08850562B2 Authorization logic in memory constrained security device 有权
    • Authorization logic in memory constrained security device
    • 内存限制安全设备中的授权逻辑
    • US08850562B2
    • 2014-09-30
    • US12821197
    • 2010-06-23
    • David R. Wooten
    • David R. Wooten
    • G06F12/14 , G06F21/00
    • G06F12/14 , G06F21/00 , G06F21/31 , G06F21/45 , G06F21/72
    • Architecture that utilizes logical combinations (e.g., of Boolean logic) of authorizations as a logical authorization expression that is computed through a proofing process to a single proof value which equates to authorizing access to an intended entity. The authorizations are accumulated and processed incrementally according to an evaluation order defined in the authorization expression. The logical combinations can include Boolean operations that evaluate to a proof value associated with a sum of products expression (e.g., combinations of AND, OR, etc.). The incremental evaluations output corresponding hash values as statistically unique identifiers used in a secure hash algorithm that when evaluated in order allow execution of a specific command to access the entity. The architecture, employed in a trust module, uses minimal internal trust module state, and can be employed as part of a device system that handles trust processing to obtain authorization to access the intended entity.
    • 使用授权的逻辑组合（例如，布尔逻辑）作为逻辑授权表达式的架构，其通过校验过程被计算为单个证明值，这相当于授权对预期实体的访问。 根据授权表达式中定义的评估顺序对授权进行累加和处理。 逻辑组合可以包括评估与产品表达式（例如AND，OR等的组合）相关联的证明值的布尔运算。 增量评估输出相应的散列值作为在安全散列算法中使用的统计唯一标识符，当按照特定命令进行评估时，可以执行访问实体。 在信任模块中使用的架构使用最小的内部信任模块状态，并且可以用作处理信任处理以获得访问预期实体的授权的设备系统的一部分。
    • 基本信息 添加关注 加入工作空间 PDF全文 PDF下载 全文下载 相似专利 双屏查看 权利要求书 说明书全文 Espacenet 法律信息 同族专利 专利引用
    • 4. 发明授权
      US06529984B1 Dual phase arbitration on a bus 有权
    • Dual phase arbitration on a bus
    • 在总线上进行双相仲裁
    • US06529984B1
    • 2003-03-04
    • US09537347
    • 2000-03-29
    • Michael D. Johas Teener , David R. Wooten
    • Michael D. Johas Teener , David R. Wooten
    • G06F1314
    • G06F13/14 , G06F13/368
    • A multiphase IEEE 1394 network of nodes requires all nodes to broadcast their current understanding of the phase of the bus (e.g., odd or even). Even if a node is not requesting ownership of the bus, it must send a message that indicates which phase that node believes to be the current phase of the network. If a node that does not need ownership of the bus believes the bus currently is in the odd phase, then that node will transmit a “None_odd” message indicating the node's understanding that the bus is in the odd phase. Similarly, if a node that does not need the bus believes the bus currently is in the even phase, then that node will transmit a “None_even” message indicating the node's understanding that the bus is in the even phase. Preferably, the current bus owner will not switch the phase of the bus until all nodes have a correct understanding of the current phase of the bus.
    • 多节点IEEE 1394节点网络要求所有节点广播他们目前对总线相位的理解（例如奇数或偶数）。 即使节点没有请求总线的所有权，它也必须发送一条消息，指示该节点认为是网络当前阶段的哪个阶段。 如果不需要总线所有权的节点相信总线当前处于奇数阶段，那么该节点将发送一个“None_odd”消息，指示节点了解总线处于奇数阶段。 类似地，如果不需要总线的节点相信总线当前处于偶数阶段，则该节点将发送一个“无限制”消息，指示节点了解总线处于偶数阶段。 优选地，当前总线所有者将不会切换总线的相位，直到所有节点正确理解总线的当前阶段为止。
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    • 8. 发明授权
      US5590292A Scalable tree structured high speed input/output subsystem architecture 失效
    • Scalable tree structured high speed input/output subsystem architecture
    • 可扩展树结构高速输入/输出子系统架构
    • US5590292A
    • 1996-12-31
    • US7333
    • 1993-01-21
    • David R. Wooten , Craig A. Miller , Kevin B. Leigh , Robert B. Costley , Christopher E. Simonich
    • David R. Wooten , Craig A. Miller , Kevin B. Leigh , Robert B. Costley , Christopher E. Simonich
    • G06F13/40 , G06F13/36 , G06F15/17
    • G06F13/4022
    • A point to point connection architecture for a computer I/O subsystem, resulting in a scalable tree structure. A Master I/O Concentrator (MIOC) is connected to the host bus and handles conversion between a bus oriented structure and the tree structure of the I/O subsystem. Ports away from the host bus are downstream ports and conform to a simple byte wide message protocol. Various IOCs and devices can be attached to one of the downstream ports on the MIOC. The MIOC directs transmissions to the appropriate channel based on a geographical addressing scheme. The IOC connections act as further points of branching. Ultimately IOD or I/O devices are reached, having an upstream port for connection to the IOC and a downstream port and internal logic appropriate for the particular peripheral device. Various registers are present in the IOCs and the IODs to allow determination of the topology and particular devices present. Messages and commands are transferred in the I/O subsystem in defined packets. Various read, write and exchange commands are used, with a read response being utilized to allow split transaction read operations. Certain status and control commands are also present. Interrupts are handled by having the interrupt levels correspond to memory addresses of the programmable interrupt controller, thus allowing simple selection of interrupts to be generated by the devices and no need for separate wiring.
    • 用于计算机I / O子系统的点对点连接架构，从而产生可扩展的树结构。 主I / O集中器（MIOC）连接到主机总线，处理面向总线的结构与I / O子系统的树结构之间的转换。 远离主机总线的端口是下游端口，符合简单的字节宽消息协议。 各种IOC和设备可以连接到MIOC的下游端口之一。 MIOC根据地理寻址方案将传输指向适当的信道。 IOC连接充当分支的进一步点。 最终达到IOD或I / O设备，具有用于连接到IOC的上行端口和下游端口以及适用于特定外围设备的内部逻辑。 各种寄存器存在于IOC和IOD中，以允许确定拓扑和存在的特定设备。 消息和命令在I / O子系统中以定义的数据包传输。 使用各种读取，写入和交换命令，其中使用读取响应来允许分离事务读取操作。 还存在某些状态和控制命令。 中断通过使中断电平对应于可编程中断控制器的存储器地址来处理，从而允许简单地选择要由器件产生的中断，而不需要单独的布线。
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