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像素阵列结构

阅读：960发布：2021-02-22

IPRDB可以提供像素阵列结构专利检索，专利查询，专利分析的服务。并且本发明公开了一种像素阵列结构，包含多个扫描线与多个像素区块。各像素区块包含多个数据线、多个像素单元、无线接收单元与位置选择单元。多个像素单元以阵列形式排列，且各像素单元耦接至多个扫描线之一与多个数据线之一。无线接收单元以无线方式接收数据信号。位置选择单元根据位置选择信号将数据信号传送至多个数据线之一。，下面是像素阵列结构专利的具体信息内容。

权利要求

1.一种像素阵列结构，其特征在于，包含：

多个扫描线；及

多个像素区块，各该像素区块包含：

多个数据线；

多个像素单元，以阵列形式排列，各像素单元耦接至该多个扫描线之一与该多个数据线之一；

一无线接收单元，以无线方式接收一数据信号；及一位置选择单元，耦接在该无线接收单元与该多个数据线之间，且根据一位置选择信号将该数据信号传送至该多个数据线之一。

2.根据权利要求1所述的像素阵列结构，其特征在于，该无线接收单元包含：一第一天线，接收该数据信号；及

一重置单元，耦接在该第一天线和该位置选择单元之间，并根据一时脉信号重置该数据信号。

3.根据权利要求2所述的像素阵列结构，其特征在于，该无线接收单元更包含：一第二天线，耦接该重置单元，且以无线感应方式产生该时脉信号。

4.根据权利要求3所述的像素阵列结构，其特征在于，更包括一遮光图案层，其中各该第二天线的布局走线与该遮光图案层的正投影重叠。

5.根据权利要求4所述的像素阵列结构，其特征在于，各该第一天线的布局走线与该遮光图案层的正投影重叠。

6.根据权利要求2所述的像素阵列结构，其特征在于，该无线接收单元更包含：一整流单元，耦接在该第一天线和该位置选择单元之间，并对该数据信号进行整流，且将整流后的该数据信号输出至该位置选择单元。

7.根据权利要求2所述的像素阵列结构，其特征在于，更包含：至少一第二天线，各该第二天线耦接在该多个像素区块的该多个重置单元中的多个者，且以无线感应方式产生该时脉信号并提供该时脉信号给耦接的该多个重置单元。

8.根据权利要求1所述的像素阵列结构，其特征在于，该无线接收单元包含：一第一天线，接收一截断信号；

一第一晶体管，该第一晶体管的第一端耦接至一电源电压，受控于一时脉信号；

一第二晶体管，该第二晶体管的第一端耦接至该第一晶体管的第二端，该第二晶体管的第二端耦接至一地电压，且该第二晶体管的控制端耦接至该第一天线；及一第三晶体管，该第三晶体管的第一端耦接至该位置选择单元，该第三晶体管的第二端耦接至一斜坡电压，且该第三晶体管的控制端耦接至该第二晶体管的该第一端，其中该第三晶体管根据该截断信号与该斜坡电压产生该数据信号，且该数据信号经由该第三晶体管的该第一端输出至该位置选择单元。

9.根据权利要求8所述的像素阵列结构，其特征在于，该无线接收单元更包含：一第二天线，耦接在该第一晶体管的该控制端，且以无线感应方式产生该时脉信号。

10.根据权利要求8所述的像素阵列结构，其特征在于，更包含：至少一第二天线，各该第二天线耦接在该多个像素区块的该多个重置单元中的多个者，且以无线感应方式产生该时脉信号并提供该时脉信号给耦接的该多个重置单元。

11.根据权利要求1所述的像素阵列结构，其特征在于，该多个像素区块的该多个无线接收单元利用彼此不同的接收频带接收该多个数据信号。

12.根据权利要求1所述的像素阵列结构，其特征在于，该多个像素区块中相邻多个者的该多个无线接收单元利用彼此不同的接收频带接收该多个数据信号。

13.一种像素阵列结构，其特征在于，包含：多个扫描线；

多个数据线；

多个像素单元，以阵列形式排列，各像素单元耦接至该多个扫描线之一与该多个数据线之一；及多个第一接收单元，该多个第一接收单元分别耦接该多个数据线，该多个第一接收单元分别利用不同的接收频带以无线方式接收多个数据信号。

14.根据权利要求13所述的像素阵列结构，其特征在于，更包含：多个第二接收单元，该多个第二接收单元分别耦接多个扫描线，该多个第二接收单元利用不同的接收频带以无线方式接收多个扫描信号。

15.根据权利要求13所述的像素阵列结构，其特征在于，各该第一接收单元包含：一第一充电电路，依据一第一感应信号产生一第一充电信号；及一第一放电电路，依据一第二感应信号产生一第一放电信号，其中该数据信号相应于该第一充电信号与该第一放电信号。

说明书全文

像素阵列结构

技术领域

[0001] 本发明是关于一种像素阵列结构，特别是一种具有无线接收功能的像素阵列结构。

背景技术

[0002] 近年来，为了摆脱边框的视觉限制，发展出了一种可直接将栅极驱动电路制作于显示面板上的整合技术，以使得显示面板的两侧可不再被栅极驱动晶片所占用，而达到窄框化(slim border)的目的。此种整合技术，一般称之为GOA(gate driver on array)技术。

[0003] 现有，采用GOA技术制作于显示面板上的栅极驱动电路其驱动能力较传统栅极驱动晶片弱，且在大尺寸的显示面板的负载条件下显得更加严重，而使得显示面板存有可靠性问题。为改善驱动能力问题，后有业者将显示面板分成多个显示区，并以区块驱动方式来驱动各显示区进行显示。

[0004] 然而，采用区块驱动的显示面板在高解析度的条件下，例如16K解析度，会有充放电时间不足的问题，使得显示面板需使用更多条数据线，进而导致显示面板的开口率下降。此外，过多的数据线设置亦有摆放空间不足的问题。

发明内容

[0005] 在一实施例中，一种像素阵列结构包含多个扫描线与多个像素区块。各像素区块包含多个数据线、多个像素单元、无线接收单元以及位置选择单元。多个像素单元可以阵列形式排列，且各像素单元耦接至多个扫描线之一与多个数据线之一。无线接收单元可以无线方式接收数据信号。位置选择单元耦接在无线接收单元与多个数据线。位置选择单元可根据位置选择信号将数据信号传送至多个数据线之一。

[0006] 在一实施例中，一种像素阵列结构包含多个扫描线、多个数据线、多个像素单元以及多个第一接收单元。多个像素单元以阵列形式排列，且各像素单元耦接至多个扫描线之一与多个数据线之一。多个第一接收单元分别耦接多个数据线，且多个第一接收单元分别利用不同的接收频带以无线方式接收多个数据信号。

[0007] 综上所述，本发明实施例的像素阵列结构，其应用于显示面板。于此，本发明实施例的像素阵列结构能藉由各无线接收单元以无线方式接收对应的像素区块中各像素单元所需的各数据信号，可使得各个像素区块所需的数据信号不会受到过多的阻抗影响。此外，本发明实施例的像素阵列装置因不需额外设置数据线，而可在后续制成显示面板后仍不影响其开口率，且可改善数据线摆放空间不足的问题。在一些实施例中，本发明实施例的像素阵列装置能将显示面板的显示画面划分成多个显示区域且此些显示区域能同时进行更新，以增加画面的一致性。在一些实施例中，本发明实施例的像素阵列装置可不在显示面板上设置任何驱动集成电路(即数据驱动电路及/或栅极驱动电路)或减少其设置数量，进而实现窄边框设计。本发明实施例的像素阵列装置于应用于大尺寸(大于或等于65吋)显示面板时，还能避免驱动能力不足造成信号转态时间变慢的问题，进而提升显示面板的可靠性。

附图说明

[0008] 图1为像素阵列结构的第一实施例的概要示意图。

[0009] 图2为图1中像素区块的一实施例的概要示意图。

[0010] 图3为驱动像素区块方法的一实施例的流程示意图。

[0011] 图4为图2中无线接收单元的第一实施例的概要示意图。

[0012] 图5为位置选择信号、扫描信号与时脉信号的概要示意图。

[0013] 图6为图2中无线接收单元的第一实施例的另一实施态样的概要示意图。

[0014] 图7为图2中无线接收单元的第二实施例的概要示意图。

[0015] 图8为位置选择信号、扫描信号、时脉信号、斜坡电压与控制信号的概要示意图。

[0016] 图9为图2中无线接收单元的第二实施例的另一实施态样的概要示意图。

[0017] 图10为像素阵列结构的第二实施例的概要示意图。

[0018] 图11为图10中第一接收单元的一实施例的概要示意图。

[0019] 图12为图10中第二接收单元的一实施例的概要示意图。

[0020] 图13为像素阵列结构的第二实施例的另一实施态样的概要示意图。

[0021] 图14为天线布局走线和遮光图案层的关系概要示意图。

[0022] 图15为图14中沿I-I剖线的概要示意图。

[0023] 其中，附图标记：

[0024] 100 像素阵列结构 110 基板

[0025] 120 无线接收单元 121 第一天线

[0026] 122 重置单元 123 整流单元

[0027] 124 第二天线 125 第一天线

[0028] 126 第二天线 130 位置选择单元

[0029] 131-133 开关模块 140 栅极驱动电路

[0030] 150 遮光图案层 160 对向基板

[0031] 200 像素阵列结构 210 基板

[0032] 220 第一接收单元 221 第一充电电路

[0033] 222 第一放电电路 230 第二接收单元

[0034] 231 第二充电电路 232 第二放电电路

[0035] 300 像素阵列结构

[0036] A1 第一天线 A2 第二天线

[0037] A3 第三天线 A4 第四天线

[0038] B11-Bnm 像素区块 CK 时脉信号

[0039] D1-Dy 数据线 D11-Dyn 数据线

[0040] gnd 地电压 G1-Gx 扫描线

[0041] G11-Gxm 扫描线 I1 第一充电信号

[0042] I2 第一放电信号 I3 第二充电信号

[0043] I4 第二放电信号 M1 第一晶体管

[0044] M2 第二晶体管 M3 第三晶体管

[0045] M4 第一晶体管 M5 第二晶体管

[0046] M6 第一晶体管 M7 第二晶体管

[0047] P 像素单元 P11-Pxy 像素单元

[0048] Ramp 斜坡电压 S1 位置选择信号

[0049] S11-S13 选定信号 Sc 截断信号

[0050] Sd 数据信号 Sd1-Sdy 数据信号

[0051] Se1 第一感应信号 Se2 第二感应信号

[0052] Se3 第三感应信号 Se4 第四感应信号

[0053] Ss1-Ssx 扫描信号 Vc 控制信号

[0054] Vdd 电源电压 L1 布局走线

[0055] S100～S120 步骤

具体实施方式

[0056] 以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。

[0057] 图1为像素阵列结构的第一实施例的概要示意图。请参阅图1，像素阵列结构100包含多个扫描线G1-Gy以及以阵列形式排列的多个像素区块B11-Bnm。于此，扫描线G1-Gx区分成多组扫描线(G1-G3/G4-G6/G(x-2)-Gx)。各像素区块(B11-Bnm中任一者)耦接一组扫描线(G1-G3/G4-G6/G(x-2)-Gx)。其中，同一横排(即沿着扫描线G1-Gx的延伸方向)的像素区块B11-B1m/B21-B2m/Bn1-Bnm可耦接同一组扫描线(G1-G3/G4-G6/G(x-2)-Gx)。其中，n、m、x与y均为正整数。n小于x，且m小于y。

[0058] 在一实施例中，像素阵列结构100可更包含一基板110，且扫描线G1-Gx与像素区块B11-B23均配置于基板110上。此外，像素阵列结构100可更包含一栅极驱动电路140，并且栅极驱动电路140亦设置于基板110上。栅极驱动电路140耦接扫描线G1-Gx的一端。并且，于显示过程中，栅极驱动电路140经由扫描线G1-Gx提供扫描信号给对应的像素区块B11-Bnm。

[0059] 各像素区块(B11-Bnm中任一者)的内部架构大致上相同。虽然图式中显示各像素区块(B11-Bnm中任一者)具有9个像素单元P为示范，但此数量并非本发明的限制。换言之，各像素区块(B11-Bnm中任一者)可具有i*j个像素单元P1j-Pij。j等于此像素区块B11中数据线D1-Dj的数量，且i等于每一组扫描线G1-Gi的数量。其中，i为小于n且小于x的正整数，且j为小于m且小于y的正整数。

[0060] 为方便说明，以下以一个像素区块B11、i＝3且j＝3为例来进行说明。

[0061] 图2为图1中像素区块的一实施例的概要示意图，且图3为驱动像素区块方法的一实施例的流程示意图。请参阅图1至图3，像素区块B11包含多个数据线D1-D3、多个像素单元P11-P33、无线接收单元120以及位置选择单元130。

[0062] 多个数据线D1-D3配置于基板110上，且交错于多个扫描线G1-G3。多个像素单元P11-P33以阵列形式排列，且各像素单元P11-P33耦接至多个扫描线G1-G3的其中之一以及多个数据线D1-D3的其中之一。位置选择单元130耦接于多个数据线D1-D3和无线接收单元120之间。

[0063] 像素区块B11可藉由无线接收单元120以无线方式依序接收每一数据线(D1、D2或D3)的数据信号Sd(步骤S110)，并利用位置选择单元130根据位置选择信号S1将数据信号Sd传送至多个数据线D1-D3之一(步骤S120)，以使得多个像素单元P11-P33之一在根据扫描线G1-G3所传送的扫描信号Ss1-Ss3而被驱动时，能经由耦接的数据线D1-D3载入对应的数据信号Sd，进而根据数据信号Sd显示相应的灰阶。举例来说，当扫描线G1以扫描信号Ss1驱动像素单元P11-P13时，无线接收单元120依序接收三个数据信号Sd，并且位置选择单元130将无线接收单元120依序导通至数据线D1-D3(即导通至数据线D1-D3中之一，但不导通至另二者)，以致使接收到的三个数据信号Sd中的第一个经由数据线D1载入至像素单元P11、接收到的三个数据信号Sd中的第二个经由数据线D2载入至像素单元P12、而接收到的三个数据信号Sd中的第三个经由数据线D3载入至像素单元P13。当扫描线G2以扫描信号Ss2驱动像素单元P21-P23时，无线接收单元120再依序接收三个数据信号Sd，并且位置选择单元130重复将无线接收单元120依序导通至数据线D1-D3，以致使再次接收到的三个数据信号Sd中的第一个经由数据线D1载入至像素单元P21、再次接收到的三个数据信号Sd中的第二个经由数据线D2载入至像素单元P22、而再次接收到的三个数据信号Sd中的第三个经由数据线D3载入至像素单元P23。并且，依此类推之。

[0064] 在一些实施例中，不同横排的像素区块B11-Bnm可共用同一组扫描信号Ss1-Ss3。举例而言，扫描线G1、G4可用以传送同样的扫描信号Ss1，扫描线G2、G5可用以传送同样的扫描信号Ss2，且扫描线G3、G6可用以传送同样的扫描信号Ss3。换言之，针对不同横排的像素区块B11-Bnm，相同对应位置的扫描线G1、G4/G2、G5/G3、G6能耦接至同一信号源(如，栅极驱动电路140的同一接脚)。举例来说，不同横排的像素区块B11-Bnm所耦接的第一条扫描线G1、G4耦接至同一信号源，且不同横排的像素区块B11-Bnm所耦接的第二条扫描线G2、G5耦接至同一信号源。并且，依此类推之。

[0065] 在一些实施例中，位置选择单元130可以一对多的多工器(Multiplexer)来实现。而在另一些实施例中，位置选择单元130可包含多个开关模块131-133，并且此些开关模块
131-133分别对应于数据线D1-D3。各开关模块131/132/133耦接于无线接收单元120和对应的数据线D1/D2/D3之间。此外，位置选择信号S1可包含多个选定信号S11-S13，且此些选定信号S11-S13分别提供给开关模块131-133。各开关模块131/132/133根据对应的选定信号S11/S12/S13导通无线接收单元120至对应的数据线D1/D2/D3，以使得数据信号Sd可传输至对应的数据线D1/D2/D3。需注意的是，在同一时点，多个开关模块131-133中仅会有一者可被导通。举例而言，当选定信号S11为高电平以致导通开关模块131时，其余的选定信号S12-S13为低电平以致不导通开关模块132-133。

[0066] 在一些实施例中，像素区块B11-B23可共用位置选择信号S11-S13，以使得各个像素区块B11-B23中位于相同对应位置的像素单元P11-P33(如，各个像素区块B11-B23中位于第一横排的第一个像素单元P11)可同步被导通至各自的无线接收单元120。换言之，像素区块B11-B23可同时运作。

[0067] 在步骤S110的一实施例中，无线接收单元120可利用无线感应的方式，例如以电磁感应来取得数据信号Sd，但本发明并非以此为限。在一些实施例中，无线接收单元120所接收到的射频信号(数据信号Sd)的振幅大小即可用以代表对应的像素单元所显示的灰阶值。

[0068] 在一些实施例中，在像素阵列结构100中，全部或一部分的像素区块B11-B23中的无线接收单元120能同时进行数据信号Sd的无线接收。因此，像素区块B11-B23中相邻多个像素区块或全部像素区块B11-B23中的无线接收单元120是以不同中心频率的接收频带进行数据信号Sd的无线接收，以避免信号相互干扰。在一些实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0069] 在此些实施例中，各像素区块(B11-Bnm中任一者)中的无线接收单元120与位置选择单元130能取代现有的数据驱动电路来提供数据信号Sd给对应的数据线D1-Dy。在一些实施例中，基板110上可不具有数据驱动电路。

[0070] 在一些实施例中，像素区块B11-Bnm的无线接收单元120对应于一个或多个无线发送单元(即，支持相同的中心频率的频带)，并且各无线发送单元耦接数据驱动电路。于此，一个无线发送单元对应于一个或多个无线接收单元120。各无线发送单元接收数据驱动电路输出的数据信号Sd并将其无线发送给对应的无线接收单元120(步骤S100)。换言之，在步骤S100中，无线发送单元可和对应的无线接收单元120进行无线感应，以使得对应的无线接收单元120可接收到数据信号Sd。

[0071] 在一些实施例中，无线发送单元可以一对一的方式传送数据信号Sd给像素区块B11-Bnm的无线接收单元120。在另一些实施例中，无线发送单元可以一对多的方式传送数据信号Sd至像素区块B11-Bnm的无线接收单元120。于此，当一个无线发送单元对应于多个无线接收单元120时，此无线发送单元的发送频带涵盖对应于的多个无线接收单元120的接收频带。

[0072] 在一些实施例中，无线发送单元可设置于不同于基板110的另一基板上。此些无线发送单元耦接同样设置在另一基板上的数据驱动电路。举例来说，无线接收单元120配置于显示面板(像素阵列结构100)上，而其对应的无线发送单元则配置于用以提供此显示面板光源的背光模块上。

[0073] 图4为图2中无线接收单元120的第一实施例的概要示意图。请参阅图1至图4，在一实施例中，无线接收单元120可包含一天线(以下称之为第一天线121)以及重置单元122。重置单元122耦接在第一天线121与位置选择单元130之间。

[0074] 第一天线121可利用第一接收频带感应并接收数据信号Sd。重置单元122可接收并受控于一时脉信号CK，以根据时脉信号CK来重置第一天线121所接收的数据信号Sd。

[0075] 图5为位置选择信号、扫描信号与时脉信号的概要示意图。请参阅图1至图5，在一实施例中，时脉信号CK可为固定周期且固定脉冲波宽的脉波信号，并此脉波信号具有导通期间与截止期间。重置单元122可于时脉信号CK的截止期间停止作动，以使得第一天线121所接收的数据信号Sd可被传输至位置选择单元130，并经由位置选择单元130根据位置选择信号S1传输至对应的数据线D1-D3。此外，重置单元122可在时脉信号CK的导通期间将第一天线121在前一个时点传送至位置选择单元130的数据信号Sd清除，以避免第一天线121在下一个时点将所接收到的数据信号Sd传送至位置选择单元130时会受到前一个时点的数据信号Sd的影响而出现错误。

[0076] 需注意的是，在图5中是以高电平来表示各信号的导通期间，并且以低电平来表示各信号的截止期间，但本发明并非以此为限。

[0077] 在一些实施例中，重置单元122可为一开关模块。开关模块的第一端耦接至第一天线121与位置选择单元130，且开关模块的第二端耦接至地电压gnd。开关模块的控制端耦接至时脉信号CK，以根据时脉信号CK导通第一天线121至地电压gnd，

[0078] 在一实施例中，无线接收单元120所接收的数据信号Sd可为一种交流信号。因此，无线接收单元120可更包含一整流单元123，且此整流单元123耦接于第一天线121与重置单元122之间以及耦接于第一天线121与位置选择单元130之间。整流单元123用以对第一天线121所接收的数据信号Sd进行整流，之后再将整流后的数据信号Sd输出至位置选择单元
130。

[0079] 在一些实施例中，整流单元123可为二极管(diode)，但本发明并非以此为限，整流单元123可以任何合适于信号整流的电路来实现。

[0080] 在一些实施例中，时脉信号CK能由基板110上的前级电路(信号源)提供给重置单元122，即以有线方式藉由拉线将重置单元122连接至信号源来接收时脉信号CK。再者，在另一些实施例中，时脉信号CK能以无线感应方式接收并提供重置单元122。

[0081] 图6为图2中无线接收单元的第一实施例的另一实施态样的概要示意图。请参阅图1至图6，在一实施态样中，无线接收单元120可更包含另一天线(以下称之为第二天线124)，且第二天线124耦接于重置单元122的控制端。第二天线124可利用第二接收频带以无线感应方式生成并提供时脉信号CK给重置单元122。其中，第二接收频带的中心频率和第一接收频带的中心频率并不相同，以使得第一天线121和第二天线124彼此不互相影响。在一实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于任一天线的完整频带(第一接收频带和第二接收频带)的一半。

[0082] 在一些实施例中，多个重置单元122能共用一个第二天线124，并由此共用的第二天线124提供时脉信号CK。换言之，像素阵列结构100可更包括一个或多个第二天线124(总数小于像素区块B11-Bnm的总数)。各第二天线124耦接多个重置单元122的控制端。第二天线124利用第二接收频带以无线感应方式生成并提供时脉信号CK给耦接的多个重置单元122。在一些实施例中，全部的像素区块B11-Bnm的重置单元122能共用同一个第二天线124。
在另一些实施例中，全部的像素区块B11-Bnm的重置单元122能由二个以上的第二天线124提供时脉信号CK。为了方便走线，各第二天线124可耦接相邻像素区块(B11-Bnm中的相邻多个)的重置单元122。

[0083] 在一些实施例中，第一天线121的中央抽头端和第二天线124的中央抽头端可耦接至地电压gnd，但本发明并非仅限于此。

[0084] 图7为图2中无线接收单元的第二实施例的概要示意图，且图8为位置选择信号、扫描信号、时脉信号、斜坡电压与控制信号的概要示意图。请参阅图1至图8，在另一实施例中，无线接收单元120可包含至少一天线(以下称之为第一天线125)以及至少三个晶体管(以下称之为第一晶体管M1、第二晶体管M2以及第三晶体管M3)。

[0085] 第一晶体管M1的第一端耦接至电源电压Vdd，且第一晶体管M1的控制端耦接至时脉信号CK。第二晶体管M2的第二端耦接至地电压gnd，且第二晶体管M2的控制端耦接至第一天线125。第一晶体管M1的第二端与第二晶体管M2的第一端互相连接至第三晶体管M3的控制端。第一晶体管M1的第二端与第二晶体管M2的第一端的相接处输出控制信号Vc至第三晶体管M3的控制端。第三晶体管M3的第一端耦接至位置选择单元130，且第三晶体管M3的第二端耦接至斜坡电压Ramp。第三晶体管M3的第一端输出数据信号Sd至位置选择单元130。

[0086] 第一天线125利用第一接收频带以无线方式接收一截断信号Sc。第三晶体管M3受控于时脉信号CK并根据截断信号Sc和斜坡电压Ramp产生对应的数据信号Sd。在一实施例中，第一晶体管M1可依据时脉信号CK导通而使得电源电压Vdd可经由第一晶体管M1对第三晶体管M3的控制端进行充电，进而拉升第三晶体管M3的控制端(控制信号Vc)的电平至高电平。并且，斜坡电压Ramp可以一充电斜率对第三晶体管M3的第二端进行充电，以逐渐拉升第三晶体管M3的第二端的电平。待第一天线125以无线方式接收到截断信号Sc而导通第二晶体管M2时，第三晶体管M3的控制端(控制信号Vc)的电平会被下拉至低电平，且由第一晶体管M1和第二晶体管M2共同产生的控制信号Vc会致使第三晶体管M3依据控制信号Vc所截的斜坡电压Ramp的电平产生对应的数据信号Sd给位置选择单元130。

[0087] 在一些实施例中，时脉信号CK能由基板110上的前级电路(信号源)提供给第一晶体管M1，即以有线方式藉由拉线将第一晶体管M1的控制端连接至信号源以接收时脉信号CK。再者，在另一些实施例中，时脉信号CK能以无线感应方式接收并提供第一晶体管M1。

[0088] 图9为图2中无线接收单元的第二实施例的另一实施态样的概要示意图。请参阅图1至图9，在一实施态样中，无线接收单元120可更包含另一天线(以下称之为第二天线126)，且第二天线126耦接至第一晶体管M1的控制端。第二天线126可利用第二接收频带以无线感应方式产生时脉信号CK给第一晶体管M1。其中，第二接收频带的中心频率和第一接收频带的中心频率并不相同，以使得第一天线125和第二天线126彼此不互相影响。在一实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于任一天线的完整频带(第一接收频带和第二接收频带)的一半。

[0089] 在一些实施例中，第一天线121(或125)所使用的第一接收频带的中心频率以及第二天线124(或126)所使用的第二接收频带的中心频率皆不大于像素单元P11-P33的操作频率，例如不超过13.56MHz(兆赫)。

[0090] 在一些实施例中，像素区块B11-Bnm的无线接收单元120可分别利用彼此不同的接收频带进行无线信号(射频形式的数据信号Sd)的接收。换言之，各像素区块(B11-Bnm中任一者)的无线接收单元120所使用的接收频带的中心频率彼此不相同，以避免互相影响。然而，本发明并非以此为限，在另一些实施例中，相邻多个像素区块(B11-Bnm中相邻多个)的无线接收单元120使用彼此不同的接收频带进行无线信号的接收，但当二个像素区块相隔的距离够远时，此二像素区块的无线接收单元120能使用相同接收频带进行无线信号的接收，即其所使用的接收频带的中心频率彼此相同或二中心频率的距离不超过二接收频带中任一者的一半。

[0091] 图10为像素阵列结构的第二实施例的概要示意图。请参阅图10，在此实施例中，素阵列结构200包含多个扫描线G1-Gx、多个数据线D1-Dy、多个像素单元P11-Pxy(通称P)以及多个第一接收单元220。扫描线G1-Gx交错于数据线D1-D，以界定出多个像素位置。此些像素单元P11-Pxy以阵列形式排列并且分别位于此些像素位置上。各像素单元(P11-P13中的任一者)耦接至多个扫描线G1-G3中之一以及多个数据线D1-D3中之一。各第一接收单元220a-220c耦接至多个数据线D1-D3中之一。

[0092] 在一实施例中，像素阵列结构200可更包含一基板210。多个扫描线G1-Gx配置于基板210上。多个数据线D1-Dy配置于基板210上，且多个像素单元P11-Pxy以阵列形式配置于基板210上。

[0093] 在一些实施例中，此些第一接收单元220利用彼此不同的接收频带以无线方式接收各自对应的数据信号Sd1-Sdy并提供给各自对应的数据线D1-D3。换言之，各第一接收单元220所利用的接收频带的中心频率互不相同，以使得各第一接收单元220不互相影响。在另一些实施例中，相邻的多个第一接收单元220利用彼此不同的接收频带以无线方式接收各自对应的数据信号，但当二个第一接收单元220相隔的距离够远时，此二第一接收单元220则能使用相同接收频带以无线方式接收各自对应的数据信号，即其所使用的接收频带的中心频率彼此相同或二中心频率的距离不超过二接收频带中任一者的一半。在一些实施例中，不同中心频率的接收频带可为接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0094] 在此些实施例中，此些第一接收单元220能取代现有的数据驱动电路来提供数据信号Sd1-Sdy给对应的数据线D1-Dy。在一些实施例中，基板210上可不具有数据驱动电路。

[0095] 在一些实施例中，此些第一接收单元220对应于一个或多个无线发送单元(即，支持相同的中心频率的频带)，并且各无线发送单元耦接数据驱动电路。于此，一个无线发送单元可对应于一个或多个第一接收单元220。各无线发送单元接收数据驱动电路输出的数据信号Sd1-Sdy并将其无线发送给对应的第一接收单元220。换言之，无线发送单元可和对应的第一接收单元220进行无线感应，以使得对应的第一接收单元220可接收到数据信号Sd1-Sdy。

[0096] 在一些实施例中，无线发送单元可以一对一的方式传送数据信号Sd1-Sdy给对应的第一接收单元220。在另一些实施例中，无线发送单元可以一对多的方式传送数据信号Sd1-Sdy给对应的第一接收单元220。于此，当一个无线发送单元对应于多个第一接收单元220时，此无线发送单元的发送频带涵盖对应于的多个第一接收单元220的接收频带。

[0097] 在一些实施例中，无线发送单元可设置于不同于基板110的另一基板上。此些无线发送单元耦接同样设置在另一基板上的数据驱动电路。举例来说，第一接收单元220配置于显示面板(像素阵列结构200)上，而其对应的无线发送单元则配置于用以提供此显示面板光源的背光模块上。

[0098] 各第一接收单元220的架构大致上相同，以下以耦接数据线D1的第一接收单元220为例来进行说明。

[0099] 图11为图10中第一接收单元220的一实施例的概要示意图。请参阅图10与图11，在一实施例中，第一接收单元220可包含第一充电电路221以及第一放电电路222。第一充电电路221耦接第一放电电路222，并且第一充电电路221与第一放电电路222的相接处耦接对应的数据线D1。第一充电电路221可以无线感应方式接收一第一感应信号Se1，并依据此第一感应信号Se1产生第一充电信号I1。第一放电电路222可以无线感应方式接收一第二感应信号Se2，并依据此第二感应信号Se2产生第一放电信号I2。第一接收单元220所接收的数据信号Sd1相应于第一充电信号I1与第一放电信号I2。其中，第一接收单元220提供给数据线D1的数据信号Sd1可为第一充电信号I1与第一放电信号I2之间的差值。

[0100] 在一些实施例中，在同一第一接收单元220中，第一充电电路221所使用的接收频带与第一放电电路222所使用的接收频带不同，即接收频带的中心频率不同。此外，相邻的多个第一接收单元220的第一充电电路221与第一放电电路222亦是使用彼此不同的接收频带，即接收频带的中心频率不同。在一些实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0101] 在一些实施例中，请参阅图11，第一充电电路221可包含第一天线A1以及第一晶体管M4。其中，第一晶体管M1的第一端与第一晶体管M1的控制端相互耦接并耦接至第一天线A1，且第一晶体管M1的第二端耦接至对应的数据线D1。此外，第一放电电路222可包含第二天线A2以及第二晶体管M5。其中，第二晶体管M5的第一端耦接至第二天线A2，且第二晶体管M5的第二端与第二晶体管M5的控制端相互耦接并耦接至对应的数据线D1。换言之，第二晶体管M5的第二端与其控制端可和第一晶体管M4的第二端相互连接以输出数据信号Sd1给数据线D1。在一些实施例中，同一第一接收单元220的第一天线A1与第二天线A2所使用的接收频带不同(即接收频带的中心频率不同)，亦不同于既定距离内的第一接收单元220的第一天线A1与第二天线A2所使用的接收频带。

[0102] 请参阅回图10，像素阵列结构200可更包含多个第二接收单元230，且各个第二接收单元230耦接至多个扫描线G1-Gx之一。

[0103] 在一些实施例中，此些第二接收单元230利用彼此不同的接收频带以无线方式接收各自对应的扫描信号Ss1-Ssx并提供给各自对应的扫描线G1-Gx。换言之，各第二接收单元230所利用的接收频带的中心频率互不相同，以使得各第二接收单元230不互相影响。在另一些实施例中，相邻的多个第二接收单元230利用彼此不同的接收频带以无线方式接收各自对应的扫描信号，但当二个第一接收单元220相隔的距离够远时，此二第一接收单元220则能使用相同接收频带以无线方式接收各自对应的数据信号，即其所使用的接收频带的中心频率彼此相同或二中心频率的距离不超过二接收频带中任一者的一半。在一些实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0104] 在一些实施例中，第二接收单元230所利用的接收频带和第一接收单元220所利用的接收频带皆不相同，以确保各个第一接收单元220和各个第二接收单元230不互相影响。在另一些实施例中，在既定范围内的第一接收单元220和第二接收单元230所利用的接收频带皆不相同，但当第一接收单元220和第二接收单元230中任二无线接收单元相隔的距离够远时，此二无线接收单元则能使用相同接收频带以无线方式接收各自对应的无线信号(射频形式的数据信号或扫描信号)，即其所使用的接收频带的中心频率彼此相同或二中心频率的距离不超过二接收频带中任一者的一半。在一些实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0105] 在此些实施例中，此些第二接收单元230能取代现有的栅极驱动电路来提供扫描信号Ss1-Ssx给对应的扫描线G1-Gx。在一些实施例中，基板210上可不具有栅极驱动电路。

[0106] 在一些实施例中，此些第二接收单元230对应于一个或多个无线发送单元(即，支持相同的中心频率的频带)，并且各无线发送单元耦接栅极驱动电路。于此，一个无线发送单元可对应于一个或多个第二接收单元230。各无线发送单元接收数据驱动电路输出的扫描信号Ss1-Ssx并将其无线发送给对应的第二接收单元230。换言之，无线发送单元可和对应的第二接收单元230进行无线感应，以使得对应的第二接收单元230可接收到扫描信号Ss1-Ssx。

[0107] 在一些实施例中，无线发送单元可以一对一的方式传送扫描信号Ss1-Ssx给对应的第二接收单元230。在另一些实施例中，无线发送单元可以一对多的方式传送扫描信号Ss1-Ssx给对应的第二接收单元230。于此，当一个无线发送单元对应于多个第二接收单元230时，此无线发送单元的发送频带涵盖对应于的多个第二接收单元230的接收频带。

[0108] 在一些实施例中，无线发送单元可设置于不同于基板110的另一基板上。此些无线发送单元耦接同样设置在另一基板上的数据驱动电路。举例来说，第二接收单元230配置于显示面板(像素阵列结构200)上，而其对应的无线发送单元则配置于用以提供此显示面板光源的背光模块上。

[0109] 各第二接收单元230的架构大致上相同，以下以耦接扫描线G1的第二接收单元230a为例来进行说明。

[0110] 图12为图10中第二接收单元的一实施例的概要示意图。请参阅图10与图12，在一实施例中，第二接收单元230可包含第二充电电路231以及第二放电电路232。第二充电电路231耦接第二放电电路232，并且第二充电电路231与第二放电电路232的相接处耦接对应的扫描线G1。第二充电电路231可以无线感应方式接收一第三感应信号Se3，并依据此第三感应信号Se3产生第二充电信号I3。第二放电电路232可以无线感应方式接收一第四感应信号Se4，并依据此第四感应信号Se4产生第二放电信号I4。第二接收单元230所接收的扫描信号Ss1可相应于第二充电信号I3与第二放电信号I4。其中，第二接收单元230提供给扫描线G1的扫描信号Ss1可为第一充电信号I1与第一放电信号I2之间的差值。

[0111] 在一些实施例中，在同一第二接收单元230中，第二充电电路231所使用的接收频带与第二放电电路232所使用的接收频带不同，即接收频带的中心频率不同。此外，相邻的多个第二接收单元230的第二充电电路231与第二放电电路232亦是使用彼此不同的接收频带，即接收频带的中心频率不同。在一些实施例中，不同中心频率的接收频带可为此些接收频带彼此分离(不重叠)或者重叠的频宽小于或等于完整频带的一半。

[0112] 在一些实施例中，请参阅图11，第二充电电路231可包含第三天线A3以及第三晶体管M6。其中，第三晶体管M6的第一端与第三晶体管M6的控制端相互耦接并耦接至第三天线A3，且第三晶体管M6的第二端耦接至对应的扫描线G1。此外，第二放电电路232可包含第四天线A4以及第四晶体管M7。其中，第四晶体管M7的第一端耦接至第四天线A4，且第四晶体管M7的第二端与第四晶体管M7的控制端相互耦接并耦接至对应的扫描线G1。换言之，第四晶体管M7的第二端与其控制端可和第三晶体管M6的第二端相互连接以输出扫描信号Ss1给扫描线G1。在一些实施例中，同一第二接收单元230的第三天线A3与第四天线A4所使用的接收频带不同(即接收频带的中心频率不同)，亦不同于既定距离内的第二接收单元230的第三天线A3与第四天线A4以及既定距离内的第一接收单元220的第一天线A1与第二天线A2所使用的接收频带。

[0113] 图13为像素阵列结构的第二实施例的另一实施态样的概要示意图。

[0114] 在一实施例中，数据线D1-Dy能一对一耦接第一接收单元220。在另一实施例中，同一条数据线Dy能切割为多个区段数据线Dy1-Dyn，并且各区段数据线Dy1-Dyn独立耦接一个第一接收单元220，如图12所示。其中，数据线D1-Dy可切割为一样切割数量的区段数据线Dy1-Dyn(即不同数据线的n为相同数值)。此外，数据线D1-Dy亦可切割为不一样切割数量的区段数据线Dy1-Dyn(即不同数据线的n为不同数值)。或者是，数据线D1-Dy中多个者切割为一样切割数量的区段数据线，并且数据线D1-Dy中有至少二种切割数量(即n有二种以上的数值)。

[0115] 在一实施例中，扫描线G1-Gx能一对一耦接第二接收单元230。在另一实施例中，同一扫描线Gx能切割为多个区段扫描线Gx1-Gxm，并且各区段扫描线Gx1-Gxm独立耦接一个第二接收单元230，如图12所示。其中，扫描线G1-Gx可切割为一样切割数量的区段扫描线Gx1-Gxm(即不同扫描线的m为相同数值)。此外，扫描线G1-Gx亦可切割为不一样切割数量的区段扫描线Gx1-Gxm(即不同扫描线的m为不同数值)。或者是，扫描线G1-Gx中多个者切割为一样切割数量的区段数据线，并且扫描线G1-Gx中有至少二种切割数量(即m有二种以上的数值)。

[0116] 在一些实施例中，同一条数据线Dy可使用相同的切割单位(如，i为相同数值)，即同一条数据线Dy中各区段数据线Dy1-Dyn上交错的扫描线的数量相同。在另一些实施例中，同一条数据线Dy可存在至少二种不同切割单位(即，i为不同数值)，即同一条数据线Dy中不同切割单位形成的区段数据线上交错的扫描线的数量不同。

[0117] 在一些实施例中，同一条扫描线Gx可使用相同的切割单位(如，j为相同数值)，即同一条扫描线Gx中各区段扫描线Gx1-Gxm上交错的数据线的数量相同。在另一些实施例中，同一条扫描线Gx可存在至少二种不同切割单位(即，j为不同数值)，即同一条扫描线Gx中不同切割单位形成的区段扫描线上交错的数据线的数量不同。

[0118] 在一些实施例中，数据线D1-Dy的切割单位可与扫描线G1-Gx的切割单位可均相同。在另一些实施例中，数据线D1-Dy的切割单位可与扫描线G1-Gx的切割单位可部分不同或全部不同。

[0119] 以数据线D1-Dy以相同切割单位(i)切割为一样切割数量的区段数据线Dy1-Dyn、扫描线G1-Gx以相同切割单位(j)切割为一样切割数量的区段扫描线Gx1-Gxm，且数据线D1-Dy与扫描线G1-Gx的切割单位均为3(i＝3且j＝3)为例，但本发明不限于此。请参阅图9至图12，像素阵列300可包含多个个像素区块B11-Bnm。于此，各个像素区块B11-Bnm的扫描线G1-Gx以及数据线D1-Dy彼此不共用，即各个像素区块(B11-Bnm中任一者)耦接三条区段数据线及三条区段扫描线。举例来说，像素区块B11耦接区段数据线D11-D31及区段扫描线G11-G13。并且，像素区块B11由其所耦接的区段数据线D11-D31提供对应的数据信号，以及由其所耦接的区段扫描线G11-G13提供对应的扫描信号。

[0120] 在一些实施例中，既定范围内的多条区段数据线所耦接的第一接收单元220与多条区段扫描线所耦接的第二接收单元230是利用不同的接收频带接收各自对应的无线信号(射频形式的数据信号或扫描信号)。在一实施例中，像素区块B11-Bnm、数据线D1-Dy、扫描线G1-Gx、第一接收单元220及第二接收单元230是设置在同一基板310上。其中，既定范围可涵盖基板310上所有第一接收单元220与所有第二接收单元230。此外，既定范围可仅涵盖基板310上部分第一接收单元220与部分第二接收单元230。

[0121] 在一些实施例中，前述实施例的像素阵列结构100中的栅极驱动电路140亦可以第二接收单元230取代之。其中，第二接收单元230的配置及运作方式大致上相同于前述，故不再赘述。

[0122] 图14为天线布局走线和遮光图案层的关系概要示意图，且图15为图14中沿I-I剖线的概要示意图。请参阅图1至图15，在一些实施例中，像素阵列结构100(200或300)可更包含遮光图案层150。遮光图案层150可用以遮蔽像素阵列结构100(200或300)中非用以显示的区域。

[0123] 在一些实施例中，前述的各天线(即第一天线121、第二天线124、第一天线125、第二天线126、第三天线A1以及第四天线A2)的布局走线L1和遮光图案层150的正投影(垂直投影在基板110上)重叠。换言之，各天线的布局走线L1可遮蔽于遮光图案层150之下，藉以不影响具有此像素阵列结构(100、200或300)的显示面板的开口率。

[0124] 在一些实施例中，像素阵列结构100(200或300)可更包含对向基板160。对向基板160相对基板110(210或310)设置，并且遮光图案层140邻近基板110(210或310)设置在对向基板160上。在遮光图案层150与像素单元P对基板110(210或310)的正投影下，遮光图案层
150位于各像素单元P的周边。

[0125] 综上所述，本发明实施例的像素阵列结构，其应用于显示面板。于此，本发明实施例的像素阵列结构能藉由各无线接收单元以无线方式接收对应的像素区块中各像素单元所需的数据信号，可使得各个像素区块所需的数据信号不会受到过多的阻抗影响。此外，本发明实施例的像素阵列装置因不需额外设置数据线，而可在后续制成显示面板后仍不影响其开口率，且可改善数据线摆放空间不足的问题。在一些实施例中，本发明实施例的像素阵列装置能将显示面板的显示画面划分成多个显示区域且此些显示区域能同时进行更新，以增加画面的一致性。在一些实施例中，本发明实施例的像素阵列装置可不在显示面板上设置任何驱动集成电路(即数据驱动电路及/或栅极驱动电路)或减少其设置数量，进而实现窄边框设计。本发明实施例的像素阵列装置于应用于大尺寸(大于或等于65吋)显示面板时，还能避免驱动能力不足造成信号转态时间变慢的问题，进而提升显示面板的可靠性。

[0126] 虽然本发明的技术内容已经以较佳实施例揭露如上，然其并非用以限定本发明，任何熟习此技艺者，在不脱离本发明的精神所作些许的更动与润饰，皆应涵盖于本发明的范畴内，因此本发明的保护范围当视后附的申请专利范围所界定者为准。

标题	发布/更新时间	阅读量
像素-专利编号CN110364554A	2020-05-12	849
像素-专利编号CN106486060A	2020-05-11	693
像素结构-专利编号CN109686299B	2020-05-13	213
像素结构-专利编号CN111090198A	2020-05-13	77
像素阵列-专利编号CN111009185A	2020-05-13	400
像素-专利编号CN104834141A	2020-05-11	548
像素-专利编号CN101183196B	2020-05-11	648
像素-专利编号CN104834141B	2020-05-12	550
像素-专利编号CN107038999A	2020-05-12	508
像素-专利编号CN108231001A	2020-05-11	557

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